Lattice 公 司 把 當 今 兩 種 最 新 的 系 統 設 計 技 術，VHDL 和 在 系 統 可 編 程 ( ISP ) 邏 輯 器 件 聯 系 在 一 起， 構 成 了isp-VHDl Viewlogic 系 統。isp-VHDL 是 進 行 電 子 系 統 設 計 的 強 有 力 的 工 具， 使 用 它 可 以 加 快 設 計 產 品 投 放 市 場 的 時 間。 isp-VHDL Viewlogic 軟 件 能 用 于 各 種 邏 輯 設 計， 這 套 軟 件 具 有 功 能 強 大 的 VHDL 綜 合、原 理 圖 輸 入、功 能 與 時 序 仿 真、ispDS+ 適 配 器 和 ispDOWNLOAD 能 力。
標簽： Lattice
上傳時間： 2014-01-06
上傳用戶：luopoguixiong
個人編寫的欣技8000應用程序(已經測試穩定的應用程序結構),大大簡化應用程序的編寫.可應用于欣技700~8000之內的機型
標簽： 8000 應用程序 700 編寫
上傳時間： 2015-07-11
上傳用戶：腳趾頭
ZLG500A12電子讀卡模塊使用指南文檔
標簽： 500A ZLG 500 A12
上傳時間： 2015-07-13
上傳用戶：李彥東
電子看板的物件程式，讓程式更好看 delphi 3.0, 4.0, 5.0, 6.0, 7.0 適用
標簽： 程式
上傳用戶：dongbaobao
帶加權的尋路算法演示(DELPHI源碼) 關于A*尋路算法的代碼在網上有很多，但用DELPHI的比較少，本人花了一天時間找到這個，代碼和界面都比較精煉，于是在關鍵處作了中文注釋，但愿對朋友們有用。
標簽： DELPHI 算法 加權 代碼
上傳時間： 2014-01-01
上傳用戶：han_zh
Verilog HDL語言編寫的5分頻電路。采用兩路時鐘相邏輯作用產生。
標簽： Verilog HDL 語言 編寫
上傳時間： 2015-07-18
上傳用戶：yulg
K條路 算法 計算最短路徑 CVC8
標簽： CVC8 算法 最短路徑 計算
上傳時間： 2015-07-19
上傳用戶：ma1301115706
一個用VerilogHDL語言編寫的多路解復用器
標簽： VerilogHDL 語言 編寫 多路
上傳時間： 2013-12-16
上傳用戶：yph853211
一個8路鍵盤源程序，很簡單的，沒有用編碼，比較經典好用！
標簽： 8路 鍵盤 源程序
上傳時間： 2014-12-03
上傳用戶：onewq
這是我最近買的一套CPLD開發板VHDL源程序并附上開發板的原理圖,希望對你是一個很好的幫助!其中內容為:8位優先編碼器,乘法器,多路選擇器,二進制轉BCD碼,加法器,減法器,簡單狀態機,四位比較器,7段數碼管,i2c總線,lcd液晶顯示,撥碼開關,串口,蜂鳴器,矩陣鍵盤,跑馬燈,交通燈,數字時鐘.
標簽： CPLD VHDL BCD 開發板
上傳時間： 2015-07-23
上傳用戶：李夢晗
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