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處理器系統(tǒng)(tǒng)

  • VK3606DM 6 KEYS 抗干擾并防水電容式觸摸按鍵SOP16

    一 產(chǎn)品描述 提供6個觸摸感應(yīng)按鍵,一對一直接輸出,對於防水和抗干擾方面有很優(yōu)異的表現(xiàn)!    二 產(chǎn)品特色 1 工作電壓範(fàn)圍:3.1V – 5.5V 2 工作電流:3mA@5V 3 6個觸摸感應(yīng)按鍵 4 提供一對一的直接輸出,未按鍵為高電平輸出,按鍵為低電平輸出 5 可以經(jīng)由調(diào)整 CAP 腳的外接電容,調(diào)整靈敏度,電容越大靈敏度越高 6 具有防水及水漫成片水珠覆蓋在觸摸按鍵面板,按鍵仍可有效判別 7 內(nèi)建 LDO 增加電源的抗干擾能力   三 產(chǎn)品應(yīng)用 各種大小家電,娛樂產(chǎn)品   四 功能描述 1 VK3606DM 於手指按壓觸摸盤,在 60ms 內(nèi)輸出對應(yīng)按鍵的狀態(tài)。 2 單鍵優(yōu)先判斷輸出方式處理, 如果 K1 已經(jīng)承認(rèn)了, 需要等 K1 放開後, 其他按 鍵才能再被承認(rèn),同時間只有一個按鍵狀態(tài)會被輸出。 3 具有防呆措施, 若是按鍵有效輸出連續(xù)超過 10 秒, 就會做復(fù)位。 4 環(huán)境調(diào)適功能,可隨環(huán)境的溫濕度變化調(diào)整參考值,確保按鍵判斷工作正常。 5 可分辨水與手指的差異,對水漫與水珠覆蓋按鍵觸摸盤,仍可正確判斷按鍵動作。但水不可於按鍵觸摸盤上形成“水柱”,若如此則如同手按鍵一般,會有按鍵承認(rèn)輸出。 6 內(nèi)建 LDO 及抗電源雜訊的處理程序,對電源漣波的干擾有很好的耐受能力。 7 不使用的按鍵請接地,避免太過靈敏而產(chǎn)生誤動

    標(biāo)簽: 3606 KEYS SOP VK 16 DM 抗干擾 防水

    上傳時間: 2019-08-08

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  • 6 KEYS 高抗干擾并防水電容式觸摸按鍵VK3606OM SOP16

    一.產(chǎn)品描述 提供6個觸摸感應(yīng)按鍵,一對一直接輸出,輸出為開漏(opendrain)型態(tài),適合作AD鍵。對於防水和抗干擾方面有很優(yōu)異的表現(xiàn)!   二。產(chǎn)品特色 1.工作電壓範(fàn)圍:3.1V – 5.5V 2.工作電流: 3mA@5V 3.6 個觸摸感應(yīng)按鍵 4.提供一對一的直接輸出,未按鍵為開漏(open drain)型態(tài)輸出,按鍵時為低電平。 5.可以經(jīng)由調(diào)整 CAP 腳的外接電容,調(diào)整靈敏度,電容越大靈敏度越高 6.具有防水及水漫成片水珠覆蓋在觸摸按鍵面板,按鍵仍可有效判別 7.內(nèi)建 LDO 增加電源的抗干擾能力   三。 產(chǎn)品應(yīng)用 各種大小家電,娛樂產(chǎn)品   四.功能描述 1.VK3606OM 於手指按壓觸摸盤,在 60ms 內(nèi)輸出對應(yīng)按鍵的狀態(tài)。 2.單鍵優(yōu)先判斷輸出方式處理, 如果 K1 已經(jīng)承認(rèn)了, 需要等K1 放開後, 其他按鍵才能再被承認(rèn),同時間只有一個按鍵狀態(tài)會被輸出。 3.具有防呆措施, 若是按鍵有效輸出連續(xù)超過 10 秒, 就會做復(fù)位。 4.環(huán)境調(diào)適功能,可隨環(huán)境的溫濕度變化調(diào)整參考值,確保按鍵判斷工作正常。 5.可分辨水與手指的差異,對水漫與水珠覆蓋按鍵觸摸盤,仍可正確判斷按鍵動作。但水不可於按鍵觸摸盤上形成“水柱”,若如此則如同手按鍵一般,會有按鍵承認(rèn)輸出。 6.內(nèi)建 LDO 及抗電源雜訊的處理程序,對電源漣波的干擾有很好的耐受能力。 7.K0~K5 中不使用的按鍵請接地,避免太過靈敏而產(chǎn)生誤動。 8.D0~D5 中不使用的輸出請接地,避免浮接會有漏電流的情 況。

    標(biāo)簽: KEYS 3606 SOP 16 VK OM 抗干擾 防水

    上傳時間: 2019-08-08

    上傳用戶:szqxw1688

  • 10 KEYS 高抗干擾并防水電容式觸摸按鍵VK3610IM SOP16

    一.產(chǎn)品描述   提供10個觸摸感應(yīng)按鍵及兩線式串列界面,並有中斷輸出INT腳與MCU聯(lián)繫。特性上對於防水和抗干擾方面有很優(yōu)異的表現(xiàn)!   二。產(chǎn)品特色   1. 工作電壓範(fàn)圍:3.1V – 5.5V   2. 工作電流:3mA@5V   3. 10 個觸摸感應(yīng)按鍵   4. 提供串列界面 SCK、SDA、INT 作為與 MCU 溝通方式。   5. 可以經(jīng)由調(diào)整 CAP 腳的外接電容,調(diào)整靈敏度,電容越大靈敏度越高   6.具有防水及水漫成片水珠覆蓋在觸摸按鍵面板,按鍵仍可有效判別   7. 內(nèi)建 LDO 增加電源的抗干擾能力   三。產(chǎn)品應(yīng)用   各種大小家電,娛樂產(chǎn)品   四.功能描述  1.VK3610IM 於手指按壓觸摸盤,在 60ms 內(nèi)輸出對應(yīng)按鍵的狀態(tài)。   2.單鍵優(yōu)先判斷輸出方式處理, 如果 K1 已經(jīng)承認(rèn)了, 需要等 K1 放開後, 其他按鍵才能再被承認(rèn),同時間只有一個按鍵狀態(tài)會被輸出。   3.具有防呆措施, 若是按鍵有效輸出連續(xù)超過 10 秒, 就會做復(fù)位。   4.環(huán)境調(diào)適功能,可隨環(huán)境的溫濕度變化調(diào)整參考值,確保按鍵判斷工作正常。   5.可分辨水與手指的差異,對水漫與水珠覆蓋按鍵觸摸盤,仍可正確判斷按鍵動作。但水不可於按鍵觸摸盤上形成“水柱”,若如此則如同手按鍵一般,會有按鍵承認(rèn)輸出。   6.內(nèi)建 LDO 及抗電源雜訊的處理程序,對電源漣波的干擾有很好的耐受能力。   7.不使用的按鍵請接地,避免太過靈敏而產(chǎn)生誤動。  

    標(biāo)簽: KEYS VK3610 SOP 10 16 IM VK 抗干擾

    上傳時間: 2019-08-08

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  • 8 KEYS 高抗干擾并防水+省電電容式觸摸按鍵VK3708BM SOP16

    一.產(chǎn)品描述   提供8個觸摸感應(yīng)按鍵,二進(jìn)制(BCD)編碼輸出,具有一個按鍵承認(rèn)輸出的顯示,按鍵後的資料會維持到下次按鍵,可先判斷按鍵承認(rèn)的狀態(tài)。提供低功耗模式,可使用於電池應(yīng)用的產(chǎn)品。對於防水和抗干擾方面有很優(yōu)異的表現(xiàn)!   二.產(chǎn)品特色   1.工作電壓範(fàn)圍:3.1V – 5.5V   2. 工作電流: 3mA (正常模式);15 uA (休眠模式) @5V   3. 8 個觸摸感應(yīng)按鍵   4.持續(xù)無按鍵 4 秒,進(jìn)入休眠模式   5. 提供二進(jìn)制(BCD)編碼直接輸出介面(上電 D2~D0/111)   6. 按鍵後離開,輸出狀態(tài)會維持到下次按鍵才會改變。   7. 提供按鍵承認(rèn)有效輸出,當(dāng)有按鍵時輸出低電平,無按鍵為高電平。   8. 可以經(jīng)由調(diào)整 CAP 腳的外接電容,調(diào)整靈敏度,電容越大靈敏度越高   9. 具有防水及水漫成片水珠覆蓋在觸摸按鍵面板,按鍵仍可有效判別   10. 內(nèi)建 LDO 增加電源的抗干擾能力   三.產(chǎn)品應(yīng)用   各種大小家電,娛樂產(chǎn)品   四.功能描述   1.VK3708BM 於手指按壓觸摸盤,在 60ms 內(nèi)輸出對應(yīng)按鍵的狀態(tài)。   2.單鍵優(yōu)先判斷輸出方式處理, 如果 K1 已經(jīng)承認(rèn)了, 需要等 K1 放開後, 其他按鍵才能再被承認(rèn),同時間只有一個按鍵狀態(tài)會被輸出。   3.具有防呆措施, 若是按鍵有效輸出連續(xù)超過 10 秒, 就會做復(fù)位。   4.環(huán)境調(diào)適功能,可隨環(huán)境的溫濕度變化調(diào)整參考值,確保按鍵判斷工作正常。   5.可分辨水與手指的差異,對水漫與水珠覆蓋按鍵觸摸盤,仍可正確判斷按鍵動作。但水不可於按鍵觸摸盤上形成“水柱”,若如此則如同手按鍵一般,會有按鍵承認(rèn)輸出。   6.內(nèi)建 LDO 及抗電源雜訊的處理程序,對電源漣波的干擾有很好的耐受能力。   7.不使用的按鍵請接地,避免太過靈敏而產(chǎn)生誤動。 聯(lián)系人:許碩          QQ:191 888 5898   聯(lián)系電話:188 9858 2398(微信)

    標(biāo)簽: KEYS 3708 SOP 16 BM VK 抗干擾 防水 省電

    上傳時間: 2019-08-08

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  • Windows系統(tǒng)入侵檢測管理流程

    這份 資 安 事 件 應(yīng) 變 小抄,專給想要 調(diào)查安全事件的 網(wǎng) 管 人 員 。 記?。好鎸κ录r, 跟著 資 安 事 件 應(yīng) 變 方 法 的流程,記下記錄不要驚慌。如果需要請立刻聯(lián)絡(luò)臺

    標(biāo)簽: Windows 系統(tǒng) 流程

    上傳時間: 2020-10-13

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  • FPGA的作用與簡介.pdf

    FPGA的作用與簡介.pdf1. 什么是 FPGA ? 一個 FPGA 是一種包含有一個可重配置的門陣列邏輯電路矩陣的設(shè)備。通過配置, FPGA 的內(nèi)部電路以一定方式相連接,從而創(chuàng)建了軟件應(yīng)用的一個硬件實(shí)現(xiàn)。與處 理器不同,F(xiàn)PGA 使用專用硬件進(jìn)行邏輯處理,而不具有操作系統(tǒng)。FPGA 在本質(zhì) 上是完全并行的,故不同的處理操作不必競爭相同的資源。因此,增加額外的處理 時,應(yīng)用某一部分的性能不會受影響。而且,多個控制循環(huán)可以以不同的速率在單 個 FPGA 設(shè)備上運(yùn)行。基于 FPGA 的控制系統(tǒng)可以加強(qiáng)關(guān)鍵互鎖邏輯,也可以通 過設(shè)計(jì)防止操作人員強(qiáng)奪 I/O。然而,不同于擁有固定硬件資源的硬連接的印制電 路板(PCB)設(shè)計(jì),基于 FPGA 的系統(tǒng)可以完全重新連接其內(nèi)部電路,以支持控制 系統(tǒng)在現(xiàn)場部署后可以重新配置。FPGA 設(shè)備提供了專用硬件電路所特有的性能與 可靠性。 單個 FPGA 可以通過在單個集成電路(IC)芯片上集成數(shù)百萬個邏輯門以代替數(shù) 以千計(jì)的分立元件。一個 FPGA 芯片的內(nèi)部資源包括一個被 I/O 組塊環(huán)圍的可配置 邏輯組塊(CLB)矩陣。在 FPGA 矩陣內(nèi),信號通過可編程的互連開關(guān)和連線傳遞。 CompactRIO 入門教程 2 CompactRIO 入 門 教 程 圖 2.FPGA 芯片的內(nèi)部構(gòu)造

    標(biāo)簽: fpga

    上傳時間: 2022-02-18

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  • 飛凌嵌入式-LS1043A LS1046A核心板硬件設(shè)計(jì)手冊

    飛凌嵌入式-LS1043A LS1046A核心板硬件設(shè)計(jì)手冊第一章 NXP QorIQ LS104xA 簡介 QorIQ? LS104xA 處理器是恩智浦面向嵌入式網(wǎng)絡(luò)推出的一款四核 64 位 ARM?處理器。LS1023A (雙 核版本)和 LS104xA (四核版本)可通過支持無風(fēng)扇設(shè)計(jì)的靈活 I/O 封裝,提供超過 10 Gbps 的性能。這款 SoC 是專為小規(guī)格網(wǎng)絡(luò)和工業(yè)應(yīng)用而設(shè)計(jì)的解決方案,針對經(jīng)濟(jì)型低端 PCB 進(jìn)行了 BOM 優(yōu)化,降低了 電源成本,采用了單時鐘設(shè)計(jì)。全新 0.9V 版本的 LS104xA 和 LS1023A 能夠面向無線 LAN 和以太網(wǎng)供電 系統(tǒng)提供額外的功耗節(jié)省。全新 23x23 封裝方式,支持引腳兼容設(shè)計(jì),可擴(kuò)展至 LS1046A (四核 A72 處 理器)。QorIQ LS104xA 能夠提升雙核 32 位 ARM 產(chǎn)品的性能,并且延續(xù)了 QorIQ 系列一貫的 I/O 靈活性, 集成了 QUICC Engine?,繼續(xù)提供對 HDLC、TDM 或 Profibus 的無縫支持。 FET104xA-C 核心板 CPU 采用的是 LS1043AXE8QQB 和 LS1046AXE8T1A。如下為 LS1043A 和 LS1046A 的應(yīng)用處理框圖:

    標(biāo)簽: 嵌入式

    上傳時間: 2022-03-06

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  • 基于LLC諧振電路的高效率ACDC變換技術(shù)研究阻抗特性

    隨著電力電子技術(shù)的飛速發(fā)展,高頻開關(guān)電源由于其諸多優(yōu)點(diǎn)已經(jīng)廣泛深入到國防、工業(yè)、民用等各個領(lǐng)域,與人們的工作、生活密切相關(guān),由此引發(fā)的電網(wǎng)諧波污染也越來越受到人們的重視,對其性能,體積,效率,功率密度等的要求也越來越高。因此,研究具有高功率因數(shù)、高效率的ACDC變換技術(shù),對于抑制諧波污染、節(jié)釣?zāi)茉醇皩?shí)現(xiàn)綠色電能變換具有重要意義通過分析目前功率因數(shù)校正PFC)技術(shù)與直流變換(DcDC)技術(shù)的研究現(xiàn)狀,采用了具有兩級結(jié)構(gòu)的AcDc變換技術(shù),對PFC控制技術(shù),直流變換軟開關(guān)實(shí)現(xiàn)等內(nèi)容進(jìn)行了研究。前級PFC部分采用先進(jìn)的單周期控制技術(shù),通過對其應(yīng)用原理、穩(wěn)定性與優(yōu)勢性能的研究,實(shí)璄了主電路及控電路的參數(shù)設(shè)計(jì)與優(yōu)化,簡化了PFC控制電路結(jié)構(gòu)、根據(jù)控制電路特點(diǎn)與系統(tǒng)環(huán)路穩(wěn)性要求,完成了電流環(huán)路與整個控制環(huán)路設(shè)計(jì),確保了系統(tǒng)穩(wěn)定性,提高了系統(tǒng)動態(tài)響應(yīng)。通過建立電路閉環(huán)仿真模型,驗(yàn)證了單周期控制抑制輸入電壓與負(fù)載擾動的優(yōu)勢性能及連續(xù)功率因數(shù)校正的優(yōu)點(diǎn),優(yōu)化了電路參數(shù)后級直流變換主電路采用LLC諧振拓?fù)?,通過變頻控制使直流變換環(huán)節(jié)具有軾開關(guān)特性。分析了不同開關(guān)頻率范圍內(nèi)電路工作原理,并建立了基波等效電路,采用基波分析法對VLc需城電路的電反增益性,輸入阻抗持性進(jìn)行了研究,確定了電路軟開關(guān)工作范圖。以基波分析結(jié)果為基礎(chǔ)進(jìn)行了合理的電路參數(shù)優(yōu)化設(shè)計(jì),保證了直流變換環(huán)節(jié)在全輸入電壓范圍、全負(fù)載范圍內(nèi)能實(shí)現(xiàn)橋臂開關(guān)管零電壓開通zVS},較大范圍內(nèi)邊整流二極管零電流關(guān)斷區(qū)CS),并將諧振電路中的電壓電流應(yīng)力降到最小,極大的提高了系統(tǒng)效率同時,為了提高系統(tǒng)功率密度,選擇了優(yōu)化的磁性元器件結(jié)構(gòu),實(shí)現(xiàn)了諧振感性元件與變壓器的磁性器件集成,大大減小了變換電路的體積在理論研究與參數(shù)設(shè)計(jì)的基礎(chǔ)上,搭建了實(shí)驗(yàn)樣機(jī),分別對PFC部分和DcDC部分進(jìn)行了實(shí)驗(yàn)驗(yàn)證與結(jié)果分析。經(jīng)實(shí)驗(yàn)驗(yàn)證ACDc變換電路功率因數(shù)在0.988以上,直瓿變換電路能實(shí)現(xiàn)全范圖軟開關(guān),實(shí)現(xiàn)了高效率AcDC變換。關(guān)鍵詞:ACDC變換:功率因數(shù)校正:;高效率;LLC諧振電路:單周期控制

    標(biāo)簽: llc 諧振電路

    上傳時間: 2022-03-24

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  • GD32F10X系列中文用戶手冊

    GD32F10x系列器件是基于ARM? Cortex?-M3處理器的32位通用微控制器。ARM? Cortex?- M3處理器包括三條AHB總線分別稱為I-CODE總線、D-Code總線和系統(tǒng)總線。Cortex?-M3處 理器的所有存儲訪問,根據(jù)不同的目的和目標(biāo)存儲空間,都會在這三條總線上執(zhí)行。存儲器的 組織采用了哈佛結(jié)構(gòu),預(yù)先定義的存儲器映射和高達(dá)4 GB的存儲空間,充分保證了系統(tǒng)的靈活 性和可擴(kuò)展性。

    標(biāo)簽: mcu

    上傳時間: 2022-04-21

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  • cadence-allegro16.6高級教程

    主要內(nèi)容介紹 Allegro 如何載入 Netlist,進(jìn)而認(rèn)識新式轉(zhuǎn)法和舊式轉(zhuǎn)法有何不同及優(yōu)缺點(diǎn)的分析,透過本章學(xué)習(xí)可以對 Allegro 和 Capture 之間的互動關(guān)係,同時也能體驗(yàn)出 Allegro 和 Capture 同步變更屬性等強(qiáng)大功能。Netlist 是連接線路圖和 Allegro Layout 圖檔的橋樑。在這裏所介紹的 Netlist 資料的轉(zhuǎn)入動作只是針對由 Capture(線路圖部分)產(chǎn)生的 Netlist 轉(zhuǎn)入 Allegro(Layout部分)1. 在 OrCAD Capture 中設(shè)計(jì)好線路圖。2. 然後由 OrCAD Capture 產(chǎn)生 Netlist(annotate 是在進(jìn)行線路圖根據(jù)第五步產(chǎn)生的資料進(jìn)行編改)。 3. 把產(chǎn)生的 Netlist 轉(zhuǎn)入 Allegro(layout 工作系統(tǒng))。 4. 在 Allegro 中進(jìn)行 PCB 的 layout。 5. 把在 Allegro 中產(chǎn)生的 back annotate(Logic)轉(zhuǎn)出(在實(shí)際 layout 時可能對原有的 Netlist 有改動過),並轉(zhuǎn)入 OrCAD Capture 裏進(jìn)行回編。

    標(biāo)簽: cadence allegro

    上傳時間: 2022-04-28

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