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自己里連接

  • MyGui.rar

    這是自己做的一個gui 及供初學(xué)者參考 如有問題可以一起討論 可發(fā)到我的郵箱里 完成的功能就是 對uicontrol的應(yīng)用

    標(biāo)簽: MyGui

    上傳時間: 2013-05-25

    上傳用戶:lanwei

  • 硬件cpu&rom課程設(shè)計.rar

    這是有關(guān)cpu和存儲器掛接的一個硬件課程設(shè)計,圖片是用protel 99 se 畫的,程序用唐都儀器調(diào)試通過,僅為一個理論性的東西。自己寫的,請多指教。

    標(biāo)簽: cpu rom 硬件

    上傳時間: 2013-07-22

    上傳用戶:17826829386

  • USB3.0–SATA橋接芯片MB86C30A的主要規(guī)范,pdf datasheet

    USB3.0–SATA橋接芯片MB86C30A的主要規(guī)范:*CBC (密碼段鏈接):一種適合加密模塊數(shù)據(jù)的AES 模式。*XTS (帶調(diào)整和密文竊取的XEX 加密模式):IEE

    標(biāo)簽: datasheet SATA USB 3.0

    上傳時間: 2013-06-10

    上傳用戶:asdfasdfd

  • 基于FPGA技術(shù)的星載高速復(fù)接器設(shè)計

    隨著空間科學(xué)任務(wù)的增加,需要處理的空間科學(xué)數(shù)據(jù)量激增,要求建立一個高速的空間數(shù)據(jù)連接網(wǎng)絡(luò).高速復(fù)接器作為空間飛行器星上網(wǎng)絡(luò)的關(guān)鍵設(shè)備,其性能對整個空間數(shù)據(jù)網(wǎng)絡(luò)的性能起著重要影響.該文闡述了利用先入先出存儲器FIFO進(jìn)行異步速率調(diào)整,應(yīng)用VHDL語言和可編程門陣列FPGA技術(shù),對多個信號源數(shù)據(jù)進(jìn)行數(shù)據(jù)打包、信道選通調(diào)度和多路復(fù)接的方法.設(shè)計中,用VHDL語言對高速復(fù)接器進(jìn)行行為級建模,為了驗證這個模型,首先使用軟件進(jìn)行仿真,通過編寫testbench程序模擬FIFO的動作特點(diǎn),對程序輸入信號進(jìn)行仿真,在軟件邏輯仿真取得預(yù)期結(jié)果后,繼續(xù)設(shè)計硬件電路,設(shè)計出的實際電路實現(xiàn)了將來自兩個不同速率的信源數(shù)據(jù)(1394總線數(shù)據(jù)和1553B總線數(shù)據(jù))復(fù)接成一路符合CCSDS協(xié)議的位流業(yè)務(wù)數(shù)據(jù).在實驗調(diào)試中對FPGA的輸出數(shù)據(jù)進(jìn)行檢驗,同時對設(shè)計方法進(jìn)行驗證.驗證結(jié)果完全符合設(shè)計目標(biāo).應(yīng)用硬件可編程邏輯芯片F(xiàn)PGA設(shè)計高速復(fù)接器,大幅度提高了數(shù)據(jù)的復(fù)接速率,可應(yīng)用于未來的星載高速數(shù)據(jù)系統(tǒng)中,能夠完成在軌系統(tǒng)的數(shù)據(jù)復(fù)接任務(wù).

    標(biāo)簽: FPGA 星載 復(fù)接器

    上傳時間: 2013-07-17

    上傳用戶:wfl_yy

  • 數(shù)字復(fù)接器的FPGA設(shè)計與實現(xiàn)

    該文首先分析了線路碼的一般問題;其次分析了正碼速調(diào)整的基本原理及所涉及的一般問題,并說明了用FPGA進(jìn)行電路設(shè)計的一般方法;最后分析了該系統(tǒng)所產(chǎn)生的抖動,如抖動的產(chǎn)生,分類以及如何減小抖動等,并對該課題所產(chǎn)生的兩類抖動即正碼速調(diào)整引入的侯時抖動和平滑鎖相環(huán)引入的抖動進(jìn)行了分析,并用Matlab仿真工具對鎖相環(huán)的抖動與其環(huán)路帶寬之間的關(guān)系進(jìn)行了仿真與計算. 作者的工作主要包括: 1.利用FPGA完成了復(fù)接、分接系統(tǒng)的設(shè)計和調(diào)試.2.利用FPGA完成了HDB3線路碼的設(shè)計與調(diào)試.3.利用鎖相環(huán)完成了碼速恢復(fù).4,對該復(fù)接分接系統(tǒng)所產(chǎn)生的抖動進(jìn)行了理論分析和仿真.5.對FPGA進(jìn)行了誤碼率測試,誤碼性能優(yōu)于10

    標(biāo)簽: FPGA 數(shù)字復(fù)接器

    上傳時間: 2013-04-24

    上傳用戶:songnanhua

  • 基于vc6.0串口通信動態(tài)鏈接庫(DLL)的設(shè)計與應(yīng)用

    在比較常用串口通信實現(xiàn)形式的利弊基礎(chǔ)上,針對某廠輪胎里程試驗機(jī)監(jiān)控系統(tǒng)的特點(diǎn),設(shè)計并實現(xiàn)了串口通信動態(tài)鏈接庫(DLL),詳細(xì)介紹了多線程理論、重疊I/O方式,給出了程序流程圖,對一些關(guān)鍵代碼進(jìn)行了說明

    標(biāo)簽: 6.0 DLL vc 串口通信

    上傳時間: 2013-07-19

    上傳用戶:songnanhua

  • 基于FPGA的FFT處理器的實現(xiàn)

    現(xiàn)場可編程門陣列(FPGA)是近年來迅速發(fā)展起來的新型可編程器件。隨著它的不斷應(yīng)用和發(fā)展,也使電子設(shè)計的規(guī)模和集成度不斷提高。同時也帶來了電子系統(tǒng)設(shè)計方法和設(shè)計思想的不斷推陳出新。 隨著數(shù)字電子技術(shù)的發(fā)展,數(shù)字信號處理的理論和技術(shù)廣泛的應(yīng)用于通訊、語音處理、計算機(jī)和多媒體等領(lǐng)域。快速傅里葉變換(FFT)作為數(shù)字信號處理的核心技術(shù)之一,是離散傅里葉變換的運(yùn)算時間縮短了幾個數(shù)量級。FFT已經(jīng)成為現(xiàn)代信號處理的重要理論之一。 該文的目的就是研究如何應(yīng)用FPGA實現(xiàn)FFT算法,研制具有自己知識產(chǎn)權(quán)的FFT信號處理器具有重要的理論意義和實用意義。 設(shè)計采用基4算法設(shè)計了一個具有實用價值的FFT實時硬件處理器。其中使用了改進(jìn)的CORDIC流水線結(jié)構(gòu)設(shè)計了FFT的蝶型運(yùn)算單元,將硬件不易于實現(xiàn)、運(yùn)算緩慢的乘法單元轉(zhuǎn)換成硬件易于實現(xiàn)、運(yùn)算快捷的加法單元。并根據(jù)基4算法的尋址特點(diǎn)設(shè)計了簡單快速的地址發(fā)生器。整體采用流水線的工作方式,并將雙端口RAM、只讀ROM全部內(nèi)置在FPGA芯片內(nèi)部,使整個系統(tǒng)的數(shù)據(jù)交換和處理速度得以提高。 整個設(shè)計利用ALTERA公司提供的QUARTUSⅡ4.0開發(fā)軟件,采用先進(jìn)的層次化設(shè)計思想,使用一片F(xiàn)PGA芯片完成了整個FFT處理器的電路設(shè)計。整體設(shè)計經(jīng)過時序仿真和硬件仿真,運(yùn)行速度達(dá)到100MHz以上。

    標(biāo)簽: FPGA FFT 處理器

    上傳時間: 2013-07-01

    上傳用戶:FFAN

  • 快速傅里葉變換

    上傳快速傅里葉變換 FFT源碼與大家分享 TI的DSP

    標(biāo)簽: 快速傅里葉變換

    上傳時間: 2013-04-24

    上傳用戶:whenfly

  • 基于FPGA的人臉檢測系統(tǒng)設(shè)計

    人臉識別技術(shù)繼指紋識別、虹膜識別以及聲音識別等生物識別技術(shù)之后,以其獨(dú)特的方便、經(jīng)濟(jì)及準(zhǔn)確性而越來越受到世人的矚目。作為人臉識別系統(tǒng)的重要環(huán)節(jié)—人臉檢測,隨著研究的深入和應(yīng)用的擴(kuò)大,在視頻會議、圖像檢索、出入口控制以及智能人機(jī)交互等領(lǐng)域有著重要的應(yīng)用前景,發(fā)展速度異常迅猛。 FPGA的制造技術(shù)不斷發(fā)展,它的功能、應(yīng)用和可靠性逐漸增加,在各個行業(yè)也顯現(xiàn)出自身的優(yōu)勢。FPGA允許用戶根據(jù)自己的需要來建立自己的模塊,為用戶的升級和改進(jìn)留下廣闊的空間。并且速度更高,密度也更大,其設(shè)計方法的靈活性降低了整個系統(tǒng)的開發(fā)成本,F(xiàn)PGA 設(shè)計成為電子自動化設(shè)計行業(yè)不可缺少的方法。 本文從人臉檢測算法入手,總結(jié)基于FPGA上的嵌入式系統(tǒng)設(shè)計方法,使用IBM的Coreconnect掛接自定義模塊技術(shù)。經(jīng)過訓(xùn)練分類器、定點(diǎn)化、以及硬件加速等方法后,能夠使人臉檢測系統(tǒng)在基于Xilinx的Virtex II Pro開發(fā)板上平臺上,達(dá)到實時的檢測效果。本文工作和成果可以具體描述如下: 1. 算法分析:對于人臉檢測算法,首先確保的是檢測率的準(zhǔn)確性程度。本文所采用的是基于Paul Viola和Michael J.Jones提出的一種基于Adaboost算法的人臉檢測方法。算法中較多的是積分圖的特征值計算,這便于進(jìn)一步的硬件設(shè)計。同時對檢測算法進(jìn)行耗時分析確定運(yùn)行速度的瓶頸。 2. 軟硬件功能劃分:這一步考慮市場可以提供的資源狀況,又要考慮系統(tǒng)成本、開發(fā)時間等諸多因素。Xilinx公司提供的Virtex II Pro開發(fā)板,在上面有可以供利用的Power PC處理器、可擴(kuò)展的存儲器、I/O接口、總線及數(shù)據(jù)通道等,通過分析可以對算法進(jìn)行細(xì)致的劃分,實現(xiàn)需要加速的模塊。 3. 定點(diǎn)化:在Adaboost算法中,需要進(jìn)行大量的浮點(diǎn)計算。這里采用的方法是直接對數(shù)據(jù)位進(jìn)行操作它提取指數(shù)和尾數(shù),然后對尾數(shù)執(zhí)行移位操作。 4. 改進(jìn)檢測用的級聯(lián)分類器的訓(xùn)練,提出可以迅速提高分類能力、特征數(shù)量大大減小的一種訓(xùn)練方法。 5. 最后對系統(tǒng)的整體進(jìn)行了驗證。實驗表明,在視頻輸入輸出接入的同時,人臉檢測能夠達(dá)到17fps的檢測速度,并且獲得了很好的檢測率以及較低的誤檢率。

    標(biāo)簽: FPGA 人臉檢測 系統(tǒng)設(shè)計

    上傳時間: 2013-04-24

    上傳用戶:大融融rr

  • 基于FPGA的RS碼編譯碼器的設(shè)計與實現(xiàn)

    研制發(fā)射微小衛(wèi)星,是我國利用空間技術(shù)服務(wù)經(jīng)濟(jì)建設(shè)、造福人類的重要途徑。現(xiàn)代微小衛(wèi)星在短短20年里能取得長足的發(fā)展,主要取決于微小衛(wèi)星自身的一系列特點(diǎn):重量輕,體積小,成本低,性能高,安全可靠,發(fā)射方便、快捷靈活等。在衛(wèi)星通信系統(tǒng)中,由于傳輸信道的多徑和各種噪聲的影響,信號在接收端會引起差錯,通過信道編碼環(huán)節(jié),可對這些不可避免的差錯進(jìn)行檢測和糾正。 在微小衛(wèi)星通信鏈路中,信道編碼器的任務(wù)是差錯控制。本文采用符合空間數(shù)據(jù)系統(tǒng)咨詢委員會CCSDS標(biāo)準(zhǔn)的鏈接碼進(jìn)行信道編碼,即內(nèi)碼為(2,1,6)的卷積碼,外碼為(255,223)的RS碼,中間進(jìn)行交織操作。其中,里德-索羅蒙碼(簡稱RS碼)是一種重要的非二進(jìn)制BCH碼,是分組碼中糾錯能力最強(qiáng)的糾錯碼,一次可以糾正多個突發(fā)錯誤,廣泛地用于空間通信中。 本文針對南京航空航天大學(xué)自行研制的微小衛(wèi)星通信分系統(tǒng)的技術(shù)要求,在用SystemView和C語言仿真的基礎(chǔ)上,用硬件描述語言Verilog設(shè)計了RS(255,223)編碼器和譯碼器,使用Modelsim軟件進(jìn)行了功能仿真,并通過Xilinx公司的軟件ISE對設(shè)計進(jìn)行綜合、布局布線,最后生成可下載的比特流文件下載到Xilinx公司的型號為XC3S2000的FPGA芯片中,完成了電路的設(shè)計并實現(xiàn)了編碼譯碼的功能,表明本文設(shè)計的信道編解碼器的正確性和實用性,滿足了微小衛(wèi)星通信分系統(tǒng)的技術(shù)要求。

    標(biāo)簽: FPGA RS碼 編譯碼器

    上傳時間: 2013-08-01

    上傳用戶:lili123

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