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自動(dòng)送鉆系統(tǒng)(tǒng)

  • 自定制Nios處理器的FFT算法指令

    本文深入研究了Nios 自定制指令的軟硬件接口,基于Altera 的IP 核FFT V2.2.0實(shí)現(xiàn)了變換長(zhǎng)度為1024 點(diǎn)的高速復(fù)數(shù)FFT 算法,提出了一種在Nios 嵌入式系統(tǒng)中定制用戶FFT 算

    標(biāo)簽: Nios FFT 定制 處理器

    上傳時(shí)間: 2013-04-24

    上傳用戶:hfmm633

  • 基于LMS自適應(yīng)濾波器信息采集系統(tǒng)設(shè)計(jì)

    設(shè)計(jì)并實(shí)現(xiàn)具有硬件濾波空氣清新器的信息采集系統(tǒng),根據(jù)空氣的復(fù)雜性以及隨機(jī)性,結(jié)合自適應(yīng)濾波器的原理,提出一種新的空氣信息采集系統(tǒng)設(shè)計(jì)方法。該方法利用最小均方(LMS)自適應(yīng)濾波器進(jìn)行軟件濾波,針對(duì)空氣

    標(biāo)簽: LMS 自適應(yīng)濾波器 信息采集 系統(tǒng)設(shè)計(jì)

    上傳時(shí)間: 2013-06-14

    上傳用戶:sjb555

  • 電能計(jì)量裝置安裝接線規(guī)則 DL/T 825-2002

    電能計(jì)量裝置安裝接線規(guī)則 DL/T 825-2002:本標(biāo)準(zhǔn)規(guī)定了電力系統(tǒng)中計(jì)費(fèi)用和非計(jì)費(fèi)用交流電能計(jì)量裝置的接線方式及安裝規(guī)定。

    標(biāo)簽: 2002 825 DL 電能計(jì)量

    上傳時(shí)間: 2013-06-30

    上傳用戶:yuanhong95

  • 基于ARM的織機(jī)送經(jīng)和卷取控制系統(tǒng)的設(shè)計(jì)

    目前,織機(jī)向著高速化、智能化方向發(fā)展,無梭織機(jī)也越來越占主導(dǎo)地位,開發(fā)中高檔織機(jī)控制系統(tǒng)是當(dāng)前紡織機(jī)械領(lǐng)域的重要課題。織機(jī)的電子送經(jīng)和卷取控制系統(tǒng)是中高檔織機(jī)控制的關(guān)鍵技術(shù)之一,同時(shí)它也是無梭織機(jī)優(yōu)越于有梭織機(jī)的重要特征之一,因此研究送經(jīng)和卷取控制系統(tǒng)具有重要意義。 本文研究的內(nèi)容是織機(jī)的送經(jīng)和卷取控制系統(tǒng),主要目的是保證織機(jī)在織造過程中紗線張力的動(dòng)態(tài)穩(wěn)定。主要工作如下: (1)在分析送經(jīng)卷取系統(tǒng)原理和功能的基礎(chǔ)上,提出了一種用較低成本完成所需控制功能的解決方案——以ARM嵌入式處理器S3C44B0為中心構(gòu)建硬件平臺(tái),以嵌入式操作系統(tǒng)uClinux為基礎(chǔ)構(gòu)建軟件平臺(tái)。 (2)利用嵌入式處理器S3C44B0豐富的硬件資源,對(duì)電子送經(jīng)卷取控制系統(tǒng)進(jìn)行硬件設(shè)計(jì):包括以S3C44B0為核心的最小系統(tǒng)電路的設(shè)計(jì)、與上位機(jī)通訊接口電路的設(shè)計(jì)、經(jīng)紗張力檢測(cè)與采樣電路的設(shè)計(jì)、伺服電機(jī)驅(qū)動(dòng)接口電路的設(shè)計(jì)和編碼器接口電路的設(shè)計(jì)等. (3)利用嵌入式操作系統(tǒng)uClinux高實(shí)時(shí)、多任務(wù)等優(yōu)點(diǎn),對(duì)電子送經(jīng)卷取控制系統(tǒng)進(jìn)行軟件設(shè)計(jì): ●在分析uClinux系統(tǒng)的特點(diǎn)和功能的基礎(chǔ)上,完成了在硬件電路板上的移植; ●在分析系統(tǒng)引導(dǎo)程序功能的基礎(chǔ)上,完成了Boot Loader的設(shè)計(jì); ●完成了系統(tǒng)設(shè)備驅(qū)動(dòng)程序的設(shè)計(jì):包括串口驅(qū)動(dòng)程序設(shè)計(jì)、A/D驅(qū)動(dòng)程序的設(shè)計(jì)和IIC驅(qū)動(dòng)程序的設(shè)計(jì)等; ●在對(duì)織機(jī)工藝了解的基礎(chǔ)上,以模塊化的思想完成了系統(tǒng)應(yīng)用程序的設(shè)計(jì):包括張力傳感器數(shù)據(jù)采集模塊、控制算法模塊和通訊模塊等; (4)詳細(xì)介紹了整個(gè)控制系統(tǒng)的調(diào)試過程。 本文設(shè)計(jì)的系統(tǒng)能使控制的經(jīng)紗張力恒定,反應(yīng)快速,控制精度高,很好地解決了開車痕等問題,能滿足中高檔織機(jī)的要求,具有實(shí)際應(yīng)用價(jià)值。

    標(biāo)簽: ARM 控制系統(tǒng)

    上傳時(shí)間: 2013-04-24

    上傳用戶:athjac

  • 39839電感量計(jì)算小巧實(shí)用的綠色軟件,根據(jù)輸入的線圈長(zhǎng)度、線圈直徑、導(dǎo)線直徑、線圈匝數(shù)及工作頻率快速計(jì)算出電感量、自分布電容、空載Q值、自諧振頻率

    39839電感量計(jì)算小巧實(shí)用的綠色軟件,根據(jù)輸入的線圈長(zhǎng)度、線圈直徑、導(dǎo)線直徑、線圈匝數(shù)及工作頻率快速計(jì)算出電感量、自分布電容、空載Q值、自諧振頻率

    標(biāo)簽: 39839 電感量 計(jì)算 線圈

    上傳時(shí)間: 2013-06-03

    上傳用戶:夜月十二橋

  • 基于H.264的網(wǎng)絡(luò)視頻監(jiān)控的FPGA實(shí)現(xiàn)研究

    隨著科學(xué)技術(shù)的發(fā)展與公共安全保障需求的提高,視頻監(jiān)控系統(tǒng)在工業(yè)生產(chǎn)、日常生活、警備與軍事方面的應(yīng)用越來越廣泛。采用基于 FPGA 的SOPC技術(shù)、H.264壓縮編碼技術(shù)和網(wǎng)絡(luò)傳輸控制技術(shù)實(shí)現(xiàn)網(wǎng)絡(luò)視頻監(jiān)控系統(tǒng),在穩(wěn)定性、功能、成本與擴(kuò)展性等方面都有著突出的優(yōu)勢(shì),具有重要的學(xué)術(shù)意義與實(shí)用意義, 本課題所設(shè)計(jì)的網(wǎng)絡(luò)視頻監(jiān)控系統(tǒng)由以Nios Ⅱ?yàn)楹诵牡那度胧綀D像服務(wù)器、相關(guān)網(wǎng)絡(luò)設(shè)備與若干PC機(jī)客戶端組成。嵌入式圖像服務(wù)器實(shí)時(shí)采集圖像,采用H.264 編碼算法進(jìn)行壓縮,并持續(xù)監(jiān)聽網(wǎng)絡(luò)。PC機(jī)客戶端可通過網(wǎng)絡(luò)對(duì)服務(wù)器進(jìn)行遠(yuǎn)程訪問,接收編碼數(shù)據(jù),使用H.264解碼算法重建圖像并實(shí)時(shí)顯示,使監(jiān)控人員有效地掌握現(xiàn)場(chǎng)情況, 在嵌入式圖像服務(wù)器設(shè)計(jì)階段,本文首先進(jìn)行了芯片選型與開發(fā)平臺(tái)選擇。然后構(gòu)建圖像采集子系統(tǒng),采用雙緩存乒乓交換的方法設(shè)計(jì)圖像采集用戶自定義模塊。接著設(shè)計(jì)雙Nios Ⅱ架構(gòu)的SOPC系統(tǒng),闡述了雙軟核設(shè)計(jì)中定制連接、內(nèi)存芯片共享、數(shù)據(jù)搬移、通信與互斥的解決方法。同時(shí)完成了網(wǎng)絡(luò)服務(wù)器的設(shè)計(jì),采用μC/OS-Ⅱ進(jìn)行多任務(wù)的管理與調(diào)度, H.264視頻壓縮編解碼算法設(shè)計(jì)與實(shí)現(xiàn)是本文的重點(diǎn)。文中首先分析H.264.標(biāo)準(zhǔn),規(guī)劃編解碼器結(jié)構(gòu)。接著設(shè)計(jì)了16×16幀內(nèi)預(yù)測(cè)算法,并設(shè)計(jì)宏塊掃描方式,采用兩次判決策略進(jìn)行預(yù)測(cè)模式選擇。然后設(shè)計(jì)4×4子塊掃描方式,編寫整數(shù)變換與量化算法程序。熵編碼采用Exp-Golomb編碼與CAVLC相結(jié)合的方案,針對(duì)除拖尾系數(shù)之外的非零系數(shù)值編碼子算法,實(shí)現(xiàn)了一種基于表示范圍判別的編碼方法。最后設(shè)計(jì)了網(wǎng)絡(luò)傳輸?shù)拇a流組成格式,并針對(duì)編碼算法設(shè)計(jì)相應(yīng)解碼算法。使用VC++完成算法驗(yàn)證,并進(jìn)行測(cè)試,觀察不同參數(shù)下壓縮率與失真度的變化。 算法驗(yàn)證完成后,本文進(jìn)行了PC機(jī)客戶端設(shè)計(jì),使其具有遠(yuǎn)程訪問、H.264解碼與實(shí)時(shí)顯示的功能。同時(shí)將H.264 編碼算法程序移植到NiosⅡ中,并將嵌入式圖像服務(wù)器與若干客戶端接入網(wǎng)絡(luò)進(jìn)行聯(lián)合調(diào)試,構(gòu)建完整的網(wǎng)絡(luò)視頻監(jiān)控系統(tǒng), 實(shí)驗(yàn)結(jié)果表明,本系統(tǒng)視頻壓縮率高,監(jiān)控圖像質(zhì)量良好,充分證明了系統(tǒng)軟硬件與圖像編解碼算法設(shè)計(jì)成功。本系統(tǒng)具有成本低、擴(kuò)展性好及適用范圍廣等優(yōu)點(diǎn),發(fā)展前景十分廣闊。

    標(biāo)簽: FPGA 264 網(wǎng)絡(luò)視頻監(jiān)控 實(shí)現(xiàn)研究

    上傳時(shí)間: 2013-08-03

    上傳用戶:88mao

  • 短波電臺(tái)擴(kuò)頻—自適應(yīng)天線抗干擾系統(tǒng)的設(shè)計(jì)及FPGA實(shí)現(xiàn)

    自適應(yīng)天線技術(shù)、擴(kuò)頻技術(shù)是提高通信系統(tǒng)抗干擾能力的有效手段.本課題短波電臺(tái)擴(kuò)頻-自適應(yīng)天線抗干擾系統(tǒng)的目的是將自適應(yīng)天線技術(shù)與擴(kuò)頻技術(shù)結(jié)合起來,使短波通信系統(tǒng)具有對(duì)抗各種干擾的性能,保證在惡劣的電磁環(huán)境中實(shí)現(xiàn)正常通信.本文主要工作如下:·研究了強(qiáng)干擾環(huán)境下的PN碼同步,給出了設(shè)計(jì)中關(guān)鍵指標(biāo)的選取原則;·分析了參考信號(hào)提取的原理,提出了適合于本課題的設(shè)計(jì)方案;·給出了擴(kuò)頻偽隨機(jī)碼PN1、導(dǎo)引信號(hào)偽隨機(jī)碼PN2的選取方法;·基于FPGA,給出了系統(tǒng)設(shè)計(jì)中PN碼同步,參考信號(hào)提取的具體實(shí)現(xiàn).

    標(biāo)簽: FPGA 短波電臺(tái) 擴(kuò)頻 天線抗干擾

    上傳時(shí)間: 2013-04-24

    上傳用戶:zzbbqq99n

  • 基于FPGA的雙自觸發(fā)脈沖激光測(cè)距關(guān)鍵技術(shù)研究

    激光測(cè)距技術(shù)被廣泛應(yīng)用于現(xiàn)代工業(yè)測(cè)量、航空與大地的測(cè)量、國防及通信等諸多領(lǐng)域。本文從已獲得廣泛應(yīng)用的脈沖激光測(cè)距技術(shù)入手,重點(diǎn)分析了近年提出的自觸發(fā)脈沖激光測(cè)距技術(shù)(STPLR)特別是其中的雙自觸發(fā)脈沖激光測(cè)距技術(shù)(BSTPLR),通過分析發(fā)現(xiàn)其核心部件之一就是用于測(cè)量激光脈沖飛行時(shí)間(周期)的高精度高速計(jì)數(shù)器,而目前一般的方式是采用昂貴的進(jìn)口高速計(jì)數(shù)器或?qū)S眉呻娐?ASIC)來完成,這使得激光測(cè)距儀在研發(fā)、系統(tǒng)的改造升級(jí)和自主知識(shí)產(chǎn)權(quán)保護(hù)等諸多方面受到制約,同時(shí)在其整體性能上特別是在集成化、小型化和高可靠性方面帶來阻礙。為此,本文研究了采用現(xiàn)場(chǎng)可編程門陣列(FPGA)來實(shí)現(xiàn)脈沖激光測(cè)距中的高精度高速計(jì)數(shù)及其他相關(guān)功能,基本解決了以上存在的問題。 論文通過對(duì)雙自觸發(fā)脈沖激光測(cè)距的主要技術(shù)要求和技術(shù)指標(biāo)進(jìn)行分析,對(duì)其中的信號(hào)處理單元采用了FPGA+單片機(jī)的設(shè)計(jì)形式。由FPGA主控芯片(EPF10K20TC144-4)作為周期測(cè)量模塊,在整個(gè)測(cè)距系統(tǒng)中是信號(hào)處理的核心部件,借助其用戶可編程特性及很高的內(nèi)部時(shí)鐘頻率,設(shè)計(jì)了專用于BSTPLR的高速高精度計(jì)數(shù)芯片,負(fù)責(zé)對(duì)測(cè)距信號(hào)產(chǎn)生電路中的時(shí)刻鑒別電路輸出信號(hào)進(jìn)行計(jì)數(shù)。數(shù)據(jù)處理模塊則主要由單片機(jī)(AT89C51)來實(shí)現(xiàn)。系統(tǒng)可以通過鍵盤預(yù)置門控信號(hào)的寬度以均衡測(cè)量的精度和速度,測(cè)量結(jié)果采用7位LED數(shù)碼管顯示。本設(shè)計(jì)在近距離(大尺寸)范圍內(nèi)實(shí)驗(yàn)測(cè)試時(shí)基本滿足設(shè)計(jì)要求。

    標(biāo)簽: FPGA 自觸發(fā)脈沖 激光測(cè)距 關(guān)鍵技術(shù)

    上傳時(shí)間: 2013-04-24

    上傳用戶:dapangxie

  • G729A語音編解碼算法研究及FPGA實(shí)現(xiàn)

    語音編碼技術(shù)始終是語音研究的熱點(diǎn)。語音編碼作為多媒體通信中信息傳輸?shù)囊粋€(gè)重要環(huán)節(jié),越來越受到廣泛的重視。G729是由美國、法國、日本和加拿大的幾家著名國際電信實(shí)體聯(lián)合開發(fā)的,國際電信聯(lián)盟(ITU-T)于1995年11月正式通過了G729。96年ITU-T又制定了G729的簡(jiǎn)化方案G729A,主要降低了計(jì)算的復(fù)雜度以便于實(shí)時(shí)實(shí)現(xiàn)。因其具有良好的合成語音質(zhì)量、適中的復(fù)雜度、較低的時(shí)延等優(yōu)點(diǎn),G729A標(biāo)準(zhǔn)已被廣泛應(yīng)用在VOIP網(wǎng)關(guān)、IP電話中。 論文利用Altera公司的新一代可編程邏輯器件在數(shù)字信號(hào)處理領(lǐng)域的優(yōu)勢(shì),對(duì)G729A語音編碼中的線性預(yù)測(cè)(LP)濾波器系數(shù)提取的FPGA(現(xiàn)場(chǎng)可編程門陣列,F(xiàn)ield Programmable Gate Array)實(shí)現(xiàn)進(jìn)行了深入研究。論文首先對(duì)語音信號(hào)處理及其發(fā)展進(jìn)行介紹,深入討論了G729A語音編解碼技術(shù)。第二,對(duì)Altera公司的Stratix系列可編程器件的內(nèi)部結(jié)構(gòu)進(jìn)行了研究,分析了在QuartusII開發(fā)平臺(tái)上進(jìn)行FPGA設(shè)計(jì)的流程。第三,基于FPGA,對(duì)G729A編碼系統(tǒng)的LP分析部分做了具體設(shè)計(jì),其中包括自相關(guān)函數(shù)和杜賓(Durbin)遞推兩個(gè)主要功能模塊,并對(duì)其工作過程進(jìn)行了詳細(xì)的分析。第四,針對(duì)系統(tǒng)所使用的除法運(yùn)算都是商小于1的特點(diǎn),設(shè)計(jì)并實(shí)現(xiàn)了一個(gè)系統(tǒng)專用的除法器模塊。最后,在Altera FPGA目標(biāo)芯片EP1S30F780C7上,對(duì)LP分析系統(tǒng)進(jìn)行了驗(yàn)證,證明了方案的可行性。

    標(biāo)簽: G729A FPGA 語音編解碼 算法研究

    上傳時(shí)間: 2013-04-24

    上傳用戶:miaochun888

  • 基于FPGA的圖像壓縮卡設(shè)計(jì)

    目前的國內(nèi)的CCD高清攝相頭能夠輸出一組視頻信號(hào)和數(shù)字圖像信號(hào),雖然視頻信號(hào)能夠直接在監(jiān)視器顯示,但是輸出的數(shù)字圖像信號(hào)占用存儲(chǔ)空間太大,不便于進(jìn)行傳輸。本文設(shè)計(jì)了一種基于FPGA的數(shù)字圖像壓縮卡。 在過去的十幾年中,國際標(biāo)準(zhǔn)化組織制訂了一系列的國際視頻編碼標(biāo)準(zhǔn)并廣泛應(yīng)用到各種領(lǐng)域。It.264/AVC是ITU-T和ISO聯(lián)合推出的新標(biāo)準(zhǔn),采用了近幾年視頻編碼方面的先進(jìn)技術(shù),以較高編碼效率和網(wǎng)絡(luò)友好性成為新一代國際視頻編碼標(biāo)準(zhǔn)。 新發(fā)展的H.264/AVC比原有的視頻編碼標(biāo)準(zhǔn)大幅度提高了編碼效率,但其運(yùn)算復(fù)雜度也大大增加,本文簡(jiǎn)要分析了H.264/AVC的復(fù)雜度及其優(yōu)化的途徑,給出了主要模塊的優(yōu)化算法實(shí)驗(yàn)結(jié)果。 H.264/AVC仍基于以前視頻編碼標(biāo)準(zhǔn)的運(yùn)動(dòng)補(bǔ)償混合編碼方案,主要不同有:增強(qiáng)的運(yùn)動(dòng)預(yù)測(cè)能力,準(zhǔn)確匹配的較小塊變換,自適應(yīng)環(huán)內(nèi)濾波器,增強(qiáng)的熵編碼。測(cè)試結(jié)果表明這些新特征使H.264/AVC編碼器提高50%編碼效率的同時(shí),增加了一個(gè)數(shù)量級(jí)的復(fù)雜度。實(shí)際中恰當(dāng)?shù)厥褂肏.264/AVC編碼工具可以較低的實(shí)現(xiàn)復(fù)雜度得到與復(fù)雜配置相當(dāng)?shù)木幋a效率。故實(shí)際編碼系統(tǒng)開發(fā)需要在運(yùn)算復(fù)雜性和編碼效率之間進(jìn)行折衷、兼顧考慮。H.264/AVC引入的新編碼特征既增加基本模塊的復(fù)雜度,也成倍增加算法的復(fù)雜度。針對(duì)它們的作用和實(shí)現(xiàn)方法的不同,可采用不同的硬件實(shí)現(xiàn)方法。本文基于上述思路進(jìn)行優(yōu)化,具體的工作包括:針對(duì)去塊濾波的復(fù)雜性,本文提出一種適合硬件實(shí)現(xiàn)的算法,使其在節(jié)省了資源的同時(shí),很好的達(dá)到了標(biāo)準(zhǔn)所定義的性能。針對(duì)變換量化的復(fù)雜性,本文提出一種既滿足整體的硬件流水結(jié)構(gòu),又極大的降低了硬件資源的實(shí)現(xiàn)方法。針對(duì)碼率控制的實(shí)現(xiàn),本文提出了一種有別于傳統(tǒng)實(shí)現(xiàn)方式的算法,在保證實(shí)時(shí)性的同時(shí),極大的提高了編碼器的性能。本文基于上述算法還進(jìn)行Baseline Profile編碼器的研究,給出了一種實(shí)時(shí)編碼器結(jié)構(gòu),實(shí)現(xiàn)了對(duì)高清圖像格式(720P)的實(shí)時(shí)編碼,并將其和當(dāng)前業(yè)界先進(jìn)水平進(jìn)行了對(duì)比,表明本文所實(shí)現(xiàn)得結(jié)構(gòu)能夠達(dá)到當(dāng)前業(yè)界的先進(jìn)水平。

    標(biāo)簽: FPGA 圖像 壓縮卡

    上傳時(shí)間: 2013-07-23

    上傳用戶:yepeng139

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