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紅外目標(biāo)(biāo)檢測(cè)(cè)

  • PLC在球面軸承外滾道超精機(jī)中的應(yīng)用

    本文提出了利用PLC控制球面軸承外滾道超精機(jī)實(shí)現(xiàn)自動(dòng)磨削功能的見解和方法,給出了控制系統(tǒng)方案及軟、硬件結(jié)構(gòu)的設(shè)計(jì)思想,對(duì)于工業(yè)實(shí)現(xiàn)相關(guān)機(jī)床的改造具有較高的應(yīng)用與參考價(jià)值。1 引言以往深溝球面內(nèi)外套精磨床是采用繼電器進(jìn)行控制的,控制部分體積龐大,響應(yīng)時(shí)間長,且可靠性不高,經(jīng)常出現(xiàn)故障,磨床磨削工件的功能單一,有的磨床只能進(jìn)粗磨,有的磨床只能進(jìn)行精磨。完成一個(gè)成品工件加工,先在粗磨磨床進(jìn)行粗磨,然后再將其送到精磨磨機(jī)進(jìn)行精磨。基于這種情況,我們采用可編程序控制器對(duì)其控制電路進(jìn)行了技術(shù)改造,將兩臺(tái)磨床的功能集中到一臺(tái)磨床上實(shí)現(xiàn),即粗磨、精磨一次完成。這樣不僅可以減小控制部分體積、增強(qiáng)系統(tǒng)的可靠性,而且提高了系統(tǒng)的利用率,降低了成本,在實(shí)際應(yīng)用中取得了很好的效果,對(duì)于工業(yè)企業(yè)實(shí)現(xiàn)相關(guān)機(jī)床的改造具有較高的應(yīng)用與參考價(jià)值。

    標(biāo)簽: PLC 超精機(jī) 中的應(yīng)用

    上傳時(shí)間: 2013-12-11

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  • PLC的控制系統(tǒng)設(shè)計(jì)

    教學(xué)提示: PLC的控制系統(tǒng)是由PLC作為控制器來構(gòu)成的電氣控制系統(tǒng)。PLC的控制系統(tǒng)設(shè)計(jì)就是設(shè)計(jì)根據(jù)控制對(duì)象的控制要求制定電控方案,選擇 PLC機(jī)型,進(jìn)行PLC的外圍電氣電路設(shè)計(jì)以及PLC程序的設(shè)計(jì)、調(diào)試。要完成好PLC控制系統(tǒng)的設(shè)計(jì)任務(wù),除掌握必要的電氣設(shè)計(jì)基礎(chǔ)知識(shí)外,還必須經(jīng)過反復(fù)實(shí)踐,深入生產(chǎn)現(xiàn)場(chǎng),將不斷積累的經(jīng)驗(yàn)應(yīng)用到設(shè)計(jì)中來 教學(xué)要求:通過本章教學(xué)使學(xué)生初步掌握PLC控制系統(tǒng)設(shè)計(jì)的幾種常用方法和步驟,能夠根據(jù)控制對(duì)象的控制要求制定合理的控制方案,確定經(jīng)濟(jì)合理的PLC機(jī)型,進(jìn)行PLC的外圍電路和程序的設(shè)計(jì) 7.1 PLC控制系統(tǒng)設(shè)計(jì)原則和步驟7.1.1 PLC控制系統(tǒng)設(shè)計(jì)的一般原則7.1.2 PLC控制系統(tǒng)設(shè)計(jì)步驟7.2 PLC控制系統(tǒng)的硬件設(shè)計(jì)7.2.1 I/O點(diǎn)數(shù)的簡化與擴(kuò)展7.2.2 PLC的選型及模塊選型7.2.3 PLC的外圍電路設(shè)計(jì)7.3 PLC控制系統(tǒng)的軟件設(shè)計(jì)7.3.2 繼電器接觸器控制線路轉(zhuǎn)換設(shè)計(jì)法7.3.3 邏輯設(shè)計(jì)方法7.4 PLC的控制系統(tǒng)設(shè)計(jì)實(shí)例

    標(biāo)簽: PLC 控制系統(tǒng)設(shè)計(jì)

    上傳時(shí)間: 2013-10-08

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  • 采用高速串行收發(fā)器Rocket I/O實(shí)現(xiàn)數(shù)據(jù)率為2.5 G

    摘要: 串行傳輸技術(shù)具有更高的傳輸速率和更低的設(shè)計(jì)成本, 已成為業(yè)界首選, 被廣泛應(yīng)用于高速通信領(lǐng)域。提出了一種新的高速串行傳輸接口的設(shè)計(jì)方案, 改進(jìn)了Aurora 協(xié)議數(shù)據(jù)幀格式定義的弊端, 并采用高速串行收發(fā)器Rocket I/O, 實(shí)現(xiàn)數(shù)據(jù)率為2.5 Gbps的高速串行傳輸。關(guān)鍵詞: 高速串行傳輸; Rocket I/O; Aurora 協(xié)議 為促使FPGA 芯片與串行傳輸技術(shù)更好地結(jié)合以滿足市場(chǎng)需求, Xilinx 公司適時(shí)推出了內(nèi)嵌高速串行收發(fā)器RocketI/O 的Virtex II Pro 系列FPGA 和可升級(jí)的小型鏈路層協(xié)議———Aurora 協(xié)議。Rocket I/O支持從622 Mbps 至3.125 Gbps的全雙工傳輸速率, 還具有8 B/10 B 編解碼、時(shí)鐘生成及恢復(fù)等功能, 可以理想地適用于芯片之間或背板的高速串行數(shù)據(jù)傳輸。Aurora 協(xié)議是為專有上層協(xié)議或行業(yè)標(biāo)準(zhǔn)的上層協(xié)議提供透明接口的第一款串行互連協(xié)議, 可用于高速線性通路之間的點(diǎn)到點(diǎn)串行數(shù)據(jù)傳輸, 同時(shí)其可擴(kuò)展的帶寬, 為系統(tǒng)設(shè)計(jì)人員提供了所需要的靈活性[4]。但該協(xié)議幀格式的定義存在弊端,會(huì)導(dǎo)致系統(tǒng)資源的浪費(fèi)。本文提出的設(shè)計(jì)方案可以改進(jìn)Aurora 協(xié)議的固有缺陷,提高系統(tǒng)性能, 實(shí)現(xiàn)數(shù)據(jù)率為2.5 Gbps 的高速串行傳輸, 具有良好的可行性和廣闊的應(yīng)用前景。

    標(biāo)簽: Rocket 2.5 高速串行 收發(fā)器

    上傳時(shí)間: 2013-10-13

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  • 通用陣列邏輯GAL實(shí)現(xiàn)基本門電路的設(shè)計(jì)

    通用陣列邏輯GAL實(shí)現(xiàn)基本門電路的設(shè)計(jì) 一、實(shí)驗(yàn)?zāi)康?1.了解GAL22V10的結(jié)構(gòu)及其應(yīng)用; 2.掌握GAL器件的設(shè)計(jì)原則和一般格式; 3.學(xué)會(huì)使用VHDL語言進(jìn)行可編程邏輯器件的邏輯設(shè)計(jì); 4.掌握通用陣列邏輯GAL的編程、下載、驗(yàn)證功能的全部過程。 二、實(shí)驗(yàn)原理 1. 通用陣列邏輯GAL22V10 通用陣列邏輯GAL是由可編程的與陣列、固定(不可編程)的或陣列和輸出邏輯宏單元(OLMC)三部分構(gòu)成。GAL芯片必須借助GAL的開發(fā)軟件和硬件,對(duì)其編程寫入后,才能使GAL芯片具有預(yù)期的邏輯功能。GAL22V10有10個(gè)I/O口、12個(gè)輸入口、10個(gè)寄存器單元,最高頻率為超過100MHz。 ispGAL22V10器件就是把流行的GAL22V10與ISP技術(shù)結(jié)合起來,在功能和結(jié)構(gòu)上與GAL22V10完全相同,并沿用了GAL22V10器件的標(biāo)準(zhǔn)28腳PLCC封裝。ispGAl22V10的傳輸時(shí)延低于7.5ns,系統(tǒng)速度高達(dá)100MHz以上,因而非常適用于高速圖形處理和高速總線管理。由于它每個(gè)輸出單元平均能夠容納12個(gè)乘積項(xiàng),最多的單元可達(dá)16個(gè)乘積項(xiàng),因而更為適用大型狀態(tài)機(jī)、狀態(tài)控制及數(shù)據(jù)處理、通訊工程、測(cè)量儀器等領(lǐng)域。ispGAL22V10的功能框圖及引腳圖分別見圖1-1和1-2所示。 另外,采用ispGAL22V10來實(shí)現(xiàn)諸如地址譯碼器之類的基本邏輯功能是非常容易的。為實(shí)現(xiàn)在系統(tǒng)編程,每片ispGAL22V10需要有四個(gè)在系統(tǒng)編程引腳,它們是串行數(shù)據(jù)輸入(SDI),方式選擇(MODE)、串行輸出(SDO)和串行時(shí)鐘(SCLK)。這四個(gè)ISP控制信號(hào)巧妙地利用28腳PLCC封裝GAL22V10的四個(gè)空腳,從而使得兩種器件的引腳相互兼容。在系統(tǒng)編程電源為+5V,無需外接編程高壓。每片ispGAL22V10可以保證一萬次在系統(tǒng)編程。 ispGAL22V10的內(nèi)部結(jié)構(gòu)圖如圖1-3所示。 2.編譯、下載源文件 用VHDL語言編寫的源程序,是不能直接對(duì)芯片編程下載的,必須經(jīng)過計(jì)算機(jī)軟件對(duì)其進(jìn)行編譯,綜合等最終形成PLD器件的熔斷絲文件(通常叫做JEDEC文件,簡稱為JED文件)。通過相應(yīng)的軟件及編程電纜再將JED數(shù)據(jù)文件寫入到GAL芯片,這樣GAL芯片就具有用戶所需要的邏輯功能。  3.工具軟件ispLEVER簡介 ispLEVER 是Lattice 公司新推出的一套EDA軟件。設(shè)計(jì)輸入可采用原理圖、硬件描述語言、混合輸入三種方式。能對(duì)所設(shè)計(jì)的數(shù)字電子系統(tǒng)進(jìn)行功能仿真和時(shí)序仿真。編譯器是此軟件的核心,能進(jìn)行邏輯優(yōu)化,將邏輯映射到器件中去,自動(dòng)完成布局與布線并生成編程所需要的熔絲圖文件。軟件中的Constraints Editor工具允許經(jīng)由一個(gè)圖形用戶接口選擇I/O設(shè)置和引腳分配。軟件包含Synolicity公司的“Synplify”綜合工具和Lattice的ispVM器件編程工具,ispLEVER軟件提供給開發(fā)者一個(gè)簡單而有力的工具。

    標(biāo)簽: GAL 陣列 邏輯 門電路

    上傳時(shí)間: 2013-11-17

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  • pcb layout design(臺(tái)灣硬件工程師15年經(jīng)驗(yàn)

    PCB LAYOUT 術(shù)語解釋(TERMS)1. COMPONENT SIDE(零件面、正面)︰大多數(shù)零件放置之面。2. SOLDER SIDE(焊錫面、反面)。3. SOLDER MASK(止焊膜面)︰通常指Solder Mask Open 之意。4. TOP PAD︰在零件面上所設(shè)計(jì)之零件腳PAD,不管是否鑽孔、電鍍。5. BOTTOM PAD:在銲錫面上所設(shè)計(jì)之零件腳PAD,不管是否鑽孔、電鍍。6. POSITIVE LAYER:單、雙層板之各層線路;多層板之上、下兩層線路及內(nèi)層走線皆屬之。7. NEGATIVE LAYER:通常指多層板之電源層。8. INNER PAD:多層板之POSITIVE LAYER 內(nèi)層PAD。9. ANTI-PAD:多層板之NEGATIVE LAYER 上所使用之絕緣範(fàn)圍,不與零件腳相接。10. THERMAL PAD:多層板內(nèi)NEGATIVE LAYER 上必須零件腳時(shí)所使用之PAD,一般稱為散熱孔或?qū)住?1. PAD (銲墊):除了SMD PAD 外,其他PAD 之TOP PAD、BOTTOM PAD 及INNER PAD 之形狀大小皆應(yīng)相同。12. Moat : 不同信號(hào)的 Power& GND plane 之間的分隔線13. Grid : 佈線時(shí)的走線格點(diǎn)2. Test Point : ATE 測(cè)試點(diǎn)供工廠ICT 測(cè)試治具使用ICT 測(cè)試點(diǎn) LAYOUT 注意事項(xiàng):PCB 的每條TRACE 都要有一個(gè)作為測(cè)試用之TEST PAD(測(cè)試點(diǎn)),其原則如下:1. 一般測(cè)試點(diǎn)大小均為30-35mil,元件分布較密時(shí),測(cè)試點(diǎn)最小可至30mil.測(cè)試點(diǎn)與元件PAD 的距離最小為40mil。2. 測(cè)試點(diǎn)與測(cè)試點(diǎn)間的間距最小為50-75mil,一般使用75mil。密度高時(shí)可使用50mil,3. 測(cè)試點(diǎn)必須均勻分佈於PCB 上,避免測(cè)試時(shí)造成板面受力不均。4. 多層板必須透過貫穿孔(VIA)將測(cè)試點(diǎn)留於錫爐著錫面上(Solder Side)。5. 測(cè)試點(diǎn)必需放至於Bottom Layer6. 輸出test point report(.asc 檔案powerpcb v3.5)供廠商分析可測(cè)率7. 測(cè)試點(diǎn)設(shè)置處:Setup􀃆pads􀃆stacks

    標(biāo)簽: layout design pcb 硬件工程師

    上傳時(shí)間: 2013-11-17

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  • 電路板布局原則

    電路板布局………………………………………42.1 電源和地…………………………………………………………………….42.1.1 感抗……………………………………………………………………42.1.2 兩層板和四層板………………………………………………………42.1.3 單層板和二層板設(shè)計(jì)中的微處理器地……………………………….42.1.4 信號(hào)返回地……………………………………………………………52.1.5 模擬數(shù)字和高壓…………………………………………………….52.1.6 模擬電源引腳和模擬參考電壓……………………………………….52.1.7 四層板中電源平面因該怎么做和不應(yīng)該怎么做…………………….52.2 兩層板中的電源分配……………………………………………………….62.2.1 單點(diǎn)和多點(diǎn)分配……………………………………………………….62.2.2 星型分配………………………………………………………………62.2.3 格柵化地……………………………………………………………….72.2.4 旁路和鐵氧體磁珠……………………………………………………92.2.5 使噪聲靠近磁珠……………………………………………………..102.3 電路板分區(qū)………………………………112.4 信號(hào)線……………………………………………………………………...122.4.1 容性和感性串?dāng)_……………………………………………………...122.4.2 天線因素和長度規(guī)則………………………………………………...122.4.3 串聯(lián)終端傳輸線…………………………………………………..132.4.4 輸入阻抗匹配………………………………………………………...132.5 電纜和接插件……………………………………………………………...132.5.1 差模和共模噪聲……………………………………………………...142.5.2 串?dāng)_模型……………………………………………………………..142.5.3 返回線路數(shù)目……………………………………..142.5.4 對(duì)板外信號(hào)I/O的建議………………………………………………142.5.5 隔離噪聲和靜電放電ESD ……………………………………….142.6 其他布局問題……………………………………………………………...142.6.1 汽車和用戶應(yīng)用帶鍵盤和顯示器的前端面板印刷電路板………...152.6.2 易感性布局…………………………………………………………...15

    標(biāo)簽: 電路板 布局

    上傳時(shí)間: 2013-10-19

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  • 印刷電路板設(shè)計(jì)原則

    減小電磁干擾的印刷電路板設(shè)計(jì)原則 內(nèi) 容 摘要……1 1 背景…1 1.1 射頻源.1 1.2 表面貼裝芯片和通孔元器件.1 1.3 靜態(tài)引腳活動(dòng)引腳和輸入.1 1.4 基本回路……..2 1.4.1 回路和偶極子的對(duì)稱性3 1.5 差模和共模…..3 2 電路板布局…4 2.1 電源和地…….4 2.1.1 感抗……4 2.1.2 兩層板和四層板4 2.1.3 單層板和二層板設(shè)計(jì)中的微處理器地.4 2.1.4 信號(hào)返回地……5 2.1.5 模擬數(shù)字和高壓…….5 2.1.6 模擬電源引腳和模擬參考電壓.5 2.1.7 四層板中電源平面因該怎么做和不應(yīng)該怎么做…….5 2.2 兩層板中的電源分配.6 2.2.1 單點(diǎn)和多點(diǎn)分配.6 2.2.2 星型分配6 2.2.3 格柵化地.7 2.2.4 旁路和鐵氧體磁珠……9 2.2.5 使噪聲靠近磁珠……..10 2.3 電路板分區(qū)…11 2.4 信號(hào)線……...12 2.4.1 容性和感性串?dāng)_……...12 2.4.2 天線因素和長度規(guī)則...12 2.4.3 串聯(lián)終端傳輸線…..13 2.4.4 輸入阻抗匹配...13 2.5 電纜和接插件……...13 2.5.1 差模和共模噪聲……...14 2.5.2 串?dāng)_模型……..14 2.5.3 返回線路數(shù)目..14 2.5.4 對(duì)板外信號(hào)I/O的建議14 2.5.5 隔離噪聲和靜電放電ESD .14 2.6 其他布局問題……...14 2.6.1 汽車和用戶應(yīng)用帶鍵盤和顯示器的前端面板印刷電路板...15 2.6.2 易感性布局…...15 3 屏蔽..16 3.1 工作原理…...16 3.2 屏蔽接地…...16 3.3 電纜和屏蔽旁路………………..16 4 總結(jié)…………………………………………17 5 參考文獻(xiàn)………………………17  

    標(biāo)簽: 印刷電路板 設(shè)計(jì)原則

    上傳時(shí)間: 2013-10-22

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  • PCB LAYOUT初學(xué)者必看!

    PCB LAYOUT技術(shù)大全---初學(xué)者必看!  PROTEL相關(guān)疑問 1.原理圖常見錯(cuò)誤: (1)ERC報(bào)告管腳沒有接入信號(hào): a. 創(chuàng)建封裝時(shí)給管腳定義了I/O屬性; b.創(chuàng)建元件或放置元件時(shí)修改了不一致的grid屬性,管腳與線沒有連上; c. 創(chuàng)建元件時(shí)pin方向反向,必須非pin name端連線。 (2)元件跑到圖紙界外:沒有在元件庫圖表紙中心創(chuàng)建元件。 (3)創(chuàng)建的工程文件網(wǎng)絡(luò)表只能部分調(diào)入pcb:生成netlist時(shí)沒有選擇為global。 (4)當(dāng)使用自己創(chuàng)建的多部分組成的元件時(shí),千萬不要使用annotate. 2.PCB中常見錯(cuò)誤: (1)網(wǎng)絡(luò)載入時(shí)報(bào)告NODE沒有找到: a. 原理圖中的元件使用了pcb庫中沒有的封裝;  b. 原理圖中的元件使用了pcb庫中名稱不一致的封裝; c. 原理圖中的元件使用了pcb庫中pin number不一致的封裝。如三極管:sch中pin number 為e,b,c, 而pcb中為1,2,3。

    標(biāo)簽: LAYOUT PCB 初學(xué)者

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  • GMM600主要外購件匯總表

    GMM600主要外購件

    標(biāo)簽: GMM 600

    上傳時(shí)間: 2013-11-15

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  • 《中國-五工W4GD高壓大功率變頻控制系統(tǒng)》用戶使用說明書

    ——國際CE認(rèn)證 ——國際船舶認(rèn)證 ——德國技術(shù)合作 ——國際認(rèn)可的中國品牌! ◆中國-五工W4GD高壓大功率變頻控制系統(tǒng)——節(jié)能,穩(wěn)壓,精度高,現(xiàn)場(chǎng)總線CPU、I/O控制技術(shù),拒內(nèi)對(duì)外干擾、抗外對(duì)內(nèi)干擾能力強(qiáng)。

    標(biāo)簽: W4GD 大功率 變頻控制 使用說明書

    上傳時(shí)間: 2013-11-25

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