VHDL寫的LMS算法程序。利用本地正弦信號，根據(jù)LMS算法對輸入信號進(jìn)行跟蹤。用以產(chǎn)生和輸入信號同頻同相的本地信號。
標(biāo)簽： VHDL LMS 算法 程序
上傳時(shí)間： 2013-09-03
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基于FPGA的usb程序，采用VHDL語言編寫。\r\n開發(fā)環(huán)境為ISE或者M(jìn)AXPLUS2。
標(biāo)簽： FPGA usb 程序
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CPLD7256的例子程序，已經(jīng)調(diào)試通過，是學(xué)習(xí)的好資料。
標(biāo)簽： CPLD 7256 程序
上傳用戶：jcljkh
控制面板程序設(shè)計(jì)－在控制面板上加一個(gè)測試組件
標(biāo)簽： 控制 面板 程序設(shè)計(jì) 測試
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lua腳本語言調(diào)用allegro游戲程序庫的接口?？缙脚_(tái)
標(biāo)簽： allegro lua 腳本 游戲程序
上傳時(shí)間： 2013-09-04
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設(shè)計(jì)出優(yōu)秀fpga程序的十條戒律，設(shè)計(jì)指導(dǎo)
標(biāo)簽： fpga 程序
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串口通訊接口程序，有對話的控件。數(shù)據(jù)接收和發(fā)送
標(biāo)簽： DDS-FPGA 串口通訊 接口程序
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這是一段控制1394芯片的cpld的verilog程序,可以參考,在實(shí)際項(xiàng)目中已經(jīng)采用.
標(biāo)簽： verilog 1394 cpld 控制
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基于FPGA的256-QAM實(shí)現(xiàn) 寫FPGA的QAM調(diào)制程序有幫助
標(biāo)簽： FPGA QAM 256 調(diào)制
上傳時(shí)間： 2013-09-05
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ASK調(diào)制與解調(diào)VHDL程序及仿真 \r\nFSK調(diào)制與解調(diào)VHDL程序及仿真\r\nPSK調(diào)制與解調(diào)VHDL程序及仿真\r\n基帶碼發(fā)生器程序設(shè)計(jì)與仿真\r\n頻率計(jì)程序設(shè)計(jì)與仿真
標(biāo)簽： VHDL ASK 調(diào)制與解調(diào) 程序
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