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FPGA開(kāi)發(fā)板上自帶的LED測(cè)試?yán)?/a>

標(biāo)簽： FPGA LED 開(kāi)發(fā)板 測(cè)試

上傳時(shí)間： 2013-08-13

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Altera_FPGA管腳弱上拉電阻的軟件設(shè)置方法

Altera_FPGA管腳弱上拉電阻的軟件設(shè)置方法

標(biāo)簽： Altera_FPGA 管腳 上拉電阻 軟件

上傳時(shí)間： 2013-08-13

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OFDM基帶調(diào)制系統(tǒng)在FPGA上的實(shí)現(xiàn)

OFDM基帶調(diào)制系統(tǒng)在FPGA上的實(shí)現(xiàn)，供數(shù)字信號(hào)處理專業(yè)參考

標(biāo)簽： OFDM FPGA 基帶 調(diào)制系統(tǒng)

上傳時(shí)間： 2013-08-14

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OFDM基帶調(diào)制系統(tǒng)在FPGA上的實(shí)現(xiàn)

OFDM基帶調(diào)制系統(tǒng)在FPGA上的實(shí)現(xiàn)，適合通信專業(yè)的人參考設(shè)計(jì)

標(biāo)簽： OFDM FPGA 基帶 調(diào)制系統(tǒng)

上傳時(shí)間： 2013-08-15

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FPGA開(kāi)發(fā)板上寫的Verilog代碼 功能是從電腦端發(fā)送一個(gè)字節(jié)

FPGA開(kāi)發(fā)板上寫的Verilog代碼：\r\n功能是從電腦端發(fā)送一個(gè)字節(jié)，然后把它接收回來(lái)。\r\n

標(biāo)簽： Verilog FPGA 開(kāi)發(fā)板 代碼

上傳時(shí)間： 2013-08-15

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采用Altera公司的FPGA芯片，在MAX+plus II軟件平臺(tái)上實(shí)現(xiàn)多路HDLC電路

采用Altera公司的FPGA芯片，在MAX+plus II軟件平臺(tái)上實(shí)現(xiàn)多路HDLC電路

標(biāo)簽： Altera FPGA HDLC plus

上傳時(shí)間： 2013-08-16

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DSP2812開(kāi)發(fā)板板上的CPLD源代碼

DSP2812開(kāi)發(fā)板板上的CPLD源代碼

標(biāo)簽： 2812 CPLD DSP 開(kāi)發(fā)板

上傳時(shí)間： 2013-08-16

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ＲＳ編碼在ＦＰＧＡ上實(shí)現(xiàn)的理論和方法

ＲＳ編碼在ＦＰＧＡ上實(shí)現(xiàn)的理論和方法，對(duì)設(shè)計(jì)ＲＳ編碼很有幫助，且ＦＯＧＡ資源占有少

標(biāo)簽： 編碼

上傳時(shí)間： 2013-08-16

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USB在FPGA上的實(shí)現(xiàn)

USB在FPGA上的實(shí)現(xiàn)，包括源碼測(cè)試平臺(tái)，測(cè)試向量，很實(shí)用。

標(biāo)簽： FPGA USB

上傳時(shí)間： 2013-08-18

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如何如何使用verilog Hdl以及如何使其在FPGA開(kāi)發(fā)板上實(shí)現(xiàn)

lab1——FPGA這個(gè)文件中體統(tǒng)了如何如何使用verilog Hdl以及如何使其在FPGA開(kāi)發(fā)板上實(shí)現(xiàn)

標(biāo)簽： verilog FPGA Hdl 如何使用

上傳時(shí)間： 2013-08-18

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