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禪道;項(xiàng)(xiàng)目管理

  • EDA工程建模及其管理方法研究2

    EDA工程建模及其管理方法研究2 1 隨著微電子技術(shù)與計(jì)算機(jī)技術(shù)的日益成熟,電子設(shè)計(jì)自動(dòng)化(EDA)技術(shù)在電子產(chǎn)品與集成電路 (IC)芯片特別是單片集成(SoC)芯片的設(shè)計(jì)應(yīng)用中顯得越來(lái)越重要。EDA技術(shù)采用“自上至下”的設(shè)計(jì)思想,允許設(shè)計(jì)人員能夠從系統(tǒng)功能級(jí)或電路功能級(jí)進(jìn)行產(chǎn)品或芯片的設(shè)計(jì),有利于產(chǎn)品在系統(tǒng)功能上的綜合優(yōu)化,從而提高了電子設(shè)計(jì)項(xiàng)目的協(xié)作開(kāi)發(fā)效率,降低新產(chǎn)品的研發(fā)成本。 近十年來(lái),EDA電路設(shè)計(jì)技術(shù)和工程管理方面的發(fā)展主要呈現(xiàn)出兩個(gè)趨勢(shì): (1) 電路的集成水平已經(jīng)進(jìn)入了深亞微米的階段,其復(fù)雜程度以每年58%的幅度迅速增加,芯片設(shè)計(jì)的抽象層次越來(lái)越高,而產(chǎn)品的研發(fā)時(shí)限卻不斷縮短。 (2) IC芯片的開(kāi)發(fā)過(guò)程也日趨復(fù)雜。從前期的整體設(shè)計(jì)、功能分,到具體的邏輯綜合、仿真測(cè)試,直至后期的電路封裝、排版布線,都需要反復(fù)的驗(yàn)證和修改,單靠個(gè)人力量無(wú)法完成。IC芯片的開(kāi)發(fā)已經(jīng)實(shí)行多人分組協(xié)作。由此可見(jiàn),如何提高設(shè)計(jì)的抽象層次,在較短時(shí)間內(nèi)設(shè)計(jì)出較高性能的芯片,如何改進(jìn)EDA工程管理,保證芯片在多組協(xié)作設(shè)計(jì)下的兼容性和穩(wěn)定性,已經(jīng)成為當(dāng)前EDA工程中最受關(guān)注的問(wèn)題。

    標(biāo)簽: EDA 工程建模 管理方法

    上傳時(shí)間: 2013-10-15

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  • 通用陣列邏輯GAL實(shí)現(xiàn)基本門電路的設(shè)計(jì)

    通用陣列邏輯GAL實(shí)現(xiàn)基本門電路的設(shè)計(jì) 一、實(shí)驗(yàn)?zāi)康?1.了解GAL22V10的結(jié)構(gòu)及其應(yīng)用; 2.掌握GAL器件的設(shè)計(jì)原則和一般格式; 3.學(xué)會(huì)使用VHDL語(yǔ)言進(jìn)行可編程邏輯器件的邏輯設(shè)計(jì); 4.掌握通用陣列邏輯GAL的編程、下載、驗(yàn)證功能的全部過(guò)程。 二、實(shí)驗(yàn)原理 1. 通用陣列邏輯GAL22V10 通用陣列邏輯GAL是由可編程的與陣列、固定(不可編程)的或陣列和輸出邏輯宏單元(OLMC)三部分構(gòu)成。GAL芯片必須借助GAL的開(kāi)發(fā)軟件和硬件,對(duì)其編程寫入后,才能使GAL芯片具有預(yù)期的邏輯功能。GAL22V10有10個(gè)I/O口、12個(gè)輸入口、10個(gè)寄存器單元,最高頻率為超過(guò)100MHz。 ispGAL22V10器件就是把流行的GAL22V10與ISP技術(shù)結(jié)合起來(lái),在功能和結(jié)構(gòu)上與GAL22V10完全相同,并沿用了GAL22V10器件的標(biāo)準(zhǔn)28腳PLCC封裝。ispGAl22V10的傳輸時(shí)延低于7.5ns,系統(tǒng)速度高達(dá)100MHz以上,因而非常適用于高速圖形處理和高速總線管理。由于它每個(gè)輸出單元平均能夠容納12個(gè)乘積項(xiàng),最多的單元可達(dá)16個(gè)乘積項(xiàng),因而更為適用大型狀態(tài)機(jī)、狀態(tài)控制及數(shù)據(jù)處理、通訊工程、測(cè)量?jī)x器等領(lǐng)域。ispGAL22V10的功能框圖及引腳圖分別見(jiàn)圖1-1和1-2所示。 另外,采用ispGAL22V10來(lái)實(shí)現(xiàn)諸如地址譯碼器之類的基本邏輯功能是非常容易的。為實(shí)現(xiàn)在系統(tǒng)編程,每片ispGAL22V10需要有四個(gè)在系統(tǒng)編程引腳,它們是串行數(shù)據(jù)輸入(SDI),方式選擇(MODE)、串行輸出(SDO)和串行時(shí)鐘(SCLK)。這四個(gè)ISP控制信號(hào)巧妙地利用28腳PLCC封裝GAL22V10的四個(gè)空腳,從而使得兩種器件的引腳相互兼容。在系統(tǒng)編程電源為+5V,無(wú)需外接編程高壓。每片ispGAL22V10可以保證一萬(wàn)次在系統(tǒng)編程。 ispGAL22V10的內(nèi)部結(jié)構(gòu)圖如圖1-3所示。 2.編譯、下載源文件 用VHDL語(yǔ)言編寫的源程序,是不能直接對(duì)芯片編程下載的,必須經(jīng)過(guò)計(jì)算機(jī)軟件對(duì)其進(jìn)行編譯,綜合等最終形成PLD器件的熔斷絲文件(通常叫做JEDEC文件,簡(jiǎn)稱為JED文件)。通過(guò)相應(yīng)的軟件及編程電纜再將JED數(shù)據(jù)文件寫入到GAL芯片,這樣GAL芯片就具有用戶所需要的邏輯功能。  3.工具軟件ispLEVER簡(jiǎn)介 ispLEVER 是Lattice 公司新推出的一套EDA軟件。設(shè)計(jì)輸入可采用原理圖、硬件描述語(yǔ)言、混合輸入三種方式。能對(duì)所設(shè)計(jì)的數(shù)字電子系統(tǒng)進(jìn)行功能仿真和時(shí)序仿真。編譯器是此軟件的核心,能進(jìn)行邏輯優(yōu)化,將邏輯映射到器件中去,自動(dòng)完成布局與布線并生成編程所需要的熔絲圖文件。軟件中的Constraints Editor工具允許經(jīng)由一個(gè)圖形用戶接口選擇I/O設(shè)置和引腳分配。軟件包含Synolicity公司的“Synplify”綜合工具和Lattice的ispVM器件編程工具,ispLEVER軟件提供給開(kāi)發(fā)者一個(gè)簡(jiǎn)單而有力的工具。

    標(biāo)簽: GAL 陣列 邏輯 門電路

    上傳時(shí)間: 2013-11-17

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  • protel99se安裝說(shuō)明(如何安裝)

    工作環(huán)境設(shè)置及軟件安裝這章介紹工作環(huán)境的設(shè)置及軟件安裝方面知識(shí)。為什么要進(jìn)行工作環(huán)境設(shè)置呢?因?yàn)楝F(xiàn)在的PCB 工程師要設(shè)計(jì)的文件很多。文件多了如果不進(jìn)行管理就會(huì)很混亂,導(dǎo)致以后的維護(hù)十分困難。所以要從剛開(kāi)始學(xué)習(xí)的時(shí)候養(yǎng)成一個(gè)好的操作習(xí)慣,這是很有必要的。2.1 建立自己的工作目錄在電腦的桌面上打開(kāi)我的電腦,在我的電腦中打開(kāi)D盤。在D 盤中建立三個(gè)文件夾。分別為“D:\EDA”“D:\EDA_LIB”“D:\EDA_PROJECT 三個(gè)文件夾”。如下圖所示:圖2-1-1 “建立工作目錄”建立好三個(gè)文件夾后,在這三個(gè)文件夾中分別另建立一個(gè)新文夾,并命名為Protel99se。三個(gè)文件夾的作用分別是:EDA文件夾是用來(lái)存放安裝文件;EDA—LIB 文件夾是用來(lái)存放元件庫(kù)。EDA—PROJECT 文件夾是用來(lái)存放設(shè)計(jì)數(shù)據(jù)。2.2 對(duì)Protel 99se 進(jìn)行安裝設(shè)置好工作目錄后,就可以對(duì)軟件進(jìn)行安裝。圖2-1-2就是Protel 99se的安裝程序。其中“Protel99SP6”是升級(jí)補(bǔ)丁,“Protel99 漢化”是漢化文件。(1)雙擊Setup 安裝圖標(biāo)對(duì)軟件進(jìn)行安裝。

    標(biāo)簽: protel 99 se 安裝說(shuō)明

    上傳時(shí)間: 2013-10-31

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  • pcb layout design(臺(tái)灣硬件工程師15年經(jīng)驗(yàn)

    PCB LAYOUT 術(shù)語(yǔ)解釋(TERMS)1. COMPONENT SIDE(零件面、正面)︰大多數(shù)零件放置之面。2. SOLDER SIDE(焊錫面、反面)。3. SOLDER MASK(止焊膜面)︰通常指Solder Mask Open 之意。4. TOP PAD︰在零件面上所設(shè)計(jì)之零件腳PAD,不管是否鑽孔、電鍍。5. BOTTOM PAD:在銲錫面上所設(shè)計(jì)之零件腳PAD,不管是否鑽孔、電鍍。6. POSITIVE LAYER:?jiǎn)巍㈦p層板之各層線路;多層板之上、下兩層線路及內(nèi)層走線皆屬之。7. NEGATIVE LAYER:通常指多層板之電源層。8. INNER PAD:多層板之POSITIVE LAYER 內(nèi)層PAD。9. ANTI-PAD:多層板之NEGATIVE LAYER 上所使用之絕緣範(fàn)圍,不與零件腳相接。10. THERMAL PAD:多層板內(nèi)NEGATIVE LAYER 上必須零件腳時(shí)所使用之PAD,一般稱為散熱孔或?qū)住?1. PAD (銲墊):除了SMD PAD 外,其他PAD 之TOP PAD、BOTTOM PAD 及INNER PAD 之形狀大小皆應(yīng)相同。12. Moat : 不同信號(hào)的 Power& GND plane 之間的分隔線13. Grid : 佈線時(shí)的走線格點(diǎn)2. Test Point : ATE 測(cè)試點(diǎn)供工廠ICT 測(cè)試治具使用ICT 測(cè)試點(diǎn) LAYOUT 注意事項(xiàng):PCB 的每條TRACE 都要有一個(gè)作為測(cè)試用之TEST PAD(測(cè)試點(diǎn)),其原則如下:1. 一般測(cè)試點(diǎn)大小均為30-35mil,元件分布較密時(shí),測(cè)試點(diǎn)最小可至30mil.測(cè)試點(diǎn)與元件PAD 的距離最小為40mil。2. 測(cè)試點(diǎn)與測(cè)試點(diǎn)間的間距最小為50-75mil,一般使用75mil。密度高時(shí)可使用50mil,3. 測(cè)試點(diǎn)必須均勻分佈於PCB 上,避免測(cè)試時(shí)造成板面受力不均。4. 多層板必須透過(guò)貫穿孔(VIA)將測(cè)試點(diǎn)留於錫爐著錫面上(Solder Side)。5. 測(cè)試點(diǎn)必需放至於Bottom Layer6. 輸出test point report(.asc 檔案powerpcb v3.5)供廠商分析可測(cè)率7. 測(cè)試點(diǎn)設(shè)置處:Setup􀃆pads􀃆stacks

    標(biāo)簽: layout design pcb 硬件工程師

    上傳時(shí)間: 2013-11-17

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  • pcb layout規(guī)則

    LAYOUT REPORT .............. 1   目錄.................. 1     1. PCB LAYOUT 術(shù)語(yǔ)解釋(TERMS)......... 2     2. Test Point : ATE 測(cè)試點(diǎn)供工廠ICT 測(cè)試治具使用............ 2     3. 基準(zhǔn)點(diǎn) (光學(xué)點(diǎn)) -for SMD:........... 4     4. 標(biāo)記 (LABEL ING)......... 5     5. VIA HOLE PAD................. 5     6. PCB Layer 排列方式...... 5     7.零件佈置注意事項(xiàng) (PLACEMENT NOTES)............... 5     8. PCB LAYOUT 設(shè)計(jì)............ 6     9. Transmission Line ( 傳輸線 )..... 8     10.General Guidelines – 跨Plane.. 8     11. General Guidelines – 繞線....... 9     12. General Guidelines – Damping Resistor. 10     13. General Guidelines - RJ45 to Transformer................. 10     14. Clock Routing Guideline........... 12     15. OSC & CRYSTAL Guideline........... 12     16. CPU

    標(biāo)簽: layout pcb

    上傳時(shí)間: 2013-10-29

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  • 華碩內(nèi)部的PCB基本規(guī)范

    PCB LAYOUT 基本規(guī)範(fàn)項(xiàng)次 項(xiàng)目 備註1 一般PCB 過(guò)板方向定義:􀀹 PCB 在SMT 生產(chǎn)方向?yàn)槎踢呥^(guò)迴焊爐(Reflow), PCB 長(zhǎng)邊為SMT 輸送帶夾持邊.􀀹 PCB 在DIP 生產(chǎn)方向?yàn)镮/O Port 朝前過(guò)波焊爐(Wave Solder), PCB 與I/O 垂直的兩邊為DIP 輸送帶夾持邊.1.1 金手指過(guò)板方向定義:􀀹 SMT: 金手指邊與SMT 輸送帶夾持邊垂直.􀀹 DIP: 金手指邊與DIP 輸送帶夾持邊一致.2 􀀹 SMD 零件文字框外緣距SMT 輸送帶夾持邊L1 需≧150 mil.􀀹 SMD 及DIP 零件文字框外緣距板邊L2 需≧100 mil.3 PCB I/O port 板邊的螺絲孔(精靈孔)PAD 至PCB 板邊, 不得有SMD 或DIP 零件(如右圖黃色區(qū)).PAD

    標(biāo)簽: PCB 華碩

    上傳時(shí)間: 2013-11-06

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  • 面向航空發(fā)動(dòng)機(jī)裝配過(guò)程管理與控制關(guān)鍵技術(shù)

    為了對(duì)航空發(fā)動(dòng)機(jī)裝配過(guò)程進(jìn)行有效地監(jiān)控與控制,提高產(chǎn)品的裝配質(zhì)量與效率,降低出錯(cuò)率,本文提出了一種裝配過(guò)程控制的管理平臺(tái),建立了裝配技術(shù)狀態(tài)的數(shù)據(jù)模型, 實(shí)現(xiàn)對(duì)整個(gè)裝配數(shù)據(jù)的管理與跟蹤,采用三維裝配工藝可視化提高了裝配的理解性,并對(duì)物料的流轉(zhuǎn)狀態(tài)進(jìn)行控制,從而對(duì)整個(gè)航空發(fā)動(dòng)機(jī)裝配過(guò)程進(jìn)行有效的控制。

    標(biāo)簽: 航空發(fā)動(dòng)機(jī) 控制 關(guān)鍵技術(shù) 裝配

    上傳時(shí)間: 2013-11-19

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  • 水資源無(wú)線遠(yuǎn)程抄表監(jiān)控管理系統(tǒng)

    水資源無(wú)線遠(yuǎn)程抄表監(jiān)控管理系統(tǒng)系統(tǒng)適用于從江河、湖泊和地下水取水的各類取水戶水資源取水計(jì)量實(shí)時(shí)監(jiān)測(cè)。

    標(biāo)簽: 水資源 無(wú)線遠(yuǎn)程 抄表 監(jiān)控管理

    上傳時(shí)間: 2015-01-02

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  • 道依茨柴油發(fā)動(dòng)機(jī)電控技術(shù)維修培訓(xùn)1

    發(fā)動(dòng)機(jī)技術(shù),道依茨柴油發(fā)動(dòng)機(jī)電控技術(shù)維修培訓(xùn)一。

    標(biāo)簽: 柴油發(fā)動(dòng)機(jī) 電控技術(shù) 維修培訓(xùn)

    上傳時(shí)間: 2013-10-26

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  • 柴油機(jī)的運(yùn)行管理與應(yīng)急處理

    簡(jiǎn)介對(duì)船用柴油機(jī)的日常操作,維護(hù)管理,和應(yīng)急情況下的處理程序。

    標(biāo)簽: 柴油機(jī) 應(yīng)急處理 運(yùn)行管理

    上傳時(shí)間: 2013-10-24

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