基于FPGA的智能控制器設(shè)計(jì)及測試方法研究
標(biāo)簽： FPGA 智能控制器 方法研究 測試
上傳時(shí)間： 2013-08-08
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CPLD初始化程序,用于DSP5416與SAA7111A的時(shí)序控制初始化.
標(biāo)簽： 7111A CPLD 5416 7111
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使用FPGA實(shí)現(xiàn)直方圖基本處理——均衡化、規(guī)定化的例子
標(biāo)簽： FPGA 直方圖 均衡
上傳時(shí)間： 2013-08-16
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自己做的FPGA下的頻率計(jì)模塊化設(shè)計(jì) 附有完整的程序和仿真圖紙
標(biāo)簽： FPGA 頻率計(jì) 模塊化設(shè)計(jì) 仿真
上傳時(shí)間： 2013-08-20
上傳用戶：wanqunsheng
智能機(jī)器小車主要完成尋跡功能，由機(jī)械結(jié)構(gòu)和控制單元兩個部分組成。機(jī)械結(jié)構(gòu)是一個由底盤、前后輔助輪、控制板支架、傳感器支架、左右驅(qū)動輪、步進(jìn)電機(jī)等組成。控制單元部分主要由主要包含傳感器及其調(diào)理電路、步進(jìn)電機(jī)及驅(qū)動電路、控制器三個部分。本設(shè)計(jì)的核心為控制器部分，采用Altera MAX7000S系列的EPM7064LC84-15作主控芯片。CPLD芯片的設(shè)計(jì)主要在MAX+plusⅡ10.0環(huán)境下利用VHDL語言編程實(shí)現(xiàn)。驅(qū)動步進(jìn)電機(jī)電路主要利用ULN2803作為驅(qū)動芯片。
標(biāo)簽： CPLD 設(shè)計(jì)實(shí)現(xiàn) 智能機(jī)
上傳時(shí)間： 2013-08-30
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Protel 99SE SP6 漢化補(bǔ)丁，一鍵漢化，超級有用！當(dāng)然，Protel 99SE要先升級到sp6！
標(biāo)簽： Protel SP6 99 SE
上傳時(shí)間： 2013-09-10
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proteus單片機(jī)可視化仿真軟件自學(xué)教程，適合于入門學(xué)習(xí)。
標(biāo)簽： proteus 單片機(jī) 仿真軟件 可視化
上傳時(shí)間： 2013-09-25
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Proteus6.9.04漢化文件，可以用來漢化Proteus6.9.04。
標(biāo)簽： Proteus 04 漢化文件
上傳時(shí)間： 2013-09-26
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proteus7.7下載、安裝、漢化全程說明win7可用
標(biāo)簽： proteus win7 7.7
上傳時(shí)間： 2013-10-07
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Proteus7.10專業(yè)版+Proteus7.8（破解 +漢化 )
標(biāo)簽： Proteus 7.10 7.8 破解
上傳時(shí)間： 2014-03-26
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