5個源程序都是在VisualDSP環境下開發出來的,目標處理器是4片AD公司的TS1O1 DSP。其中:1)IDE_FAT32用來在硬盤上創建FAT32文件系統;2)i2c_test編寫IIC總線;3)codec_a_in_pal_cf_frame是加載到FLASH的程序,板子在脫離PC自動上電時會把PAL制的圖像直接存到CF卡里,CF卡的文件系統是FAT16;4)codec_a_in_pal_buf_boottest是可加載的DSP圖像直通程序;5)ADSP-TS101prog_driver是flash的驅動程序。
標簽: VisualDSP 源程序 環境
上傳時間: 2014-02-04
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源程序是在VisualDSP環境下開發出來的,目標處理器是4片AD公司的TS1O1 DSP。IDE_FAT32用來在硬盤上創建FAT32文件系統;2)i2c_test編寫IIC總線;3)codec_a_in_pal_cf_frame是加載到FLASH的程序,板子在脫離PC自動上電時會把PAL制的圖像直接存到CF卡里,CF卡的文件系統是FAT16;4)codec_a_in_pal_buf_boottest是可加載的DSP圖像直通程序;5)ADSP-TS101prog_driver是flash的驅動程序。
上傳時間: 2013-12-25
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上傳時間: 2014-01-06
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上傳時間: 2015-03-22
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運行可執行程序CAR.exe,選擇1,小鳥飛過;選擇2,汽車開過;選擇3,退出。
標簽: CAR exe 運行 可執行
上傳時間: 2015-03-23
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運行可執行程序testword.exe,出現菜單主界面,按回車鍵出現由26個字母組成的亂序行,這時其中任一字母落下,在鍵盤上敲入該字母,如果輸入正確,字母消失;按ESC鍵返回主界面;按空格見暫停;按‘E’退出。
標簽: testword exe 運行 可執行
上傳時間: 2013-12-23
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減1計數器 一、設計要求 用Verilog HDL語言設計一個計數器。 要求計數器具有異步置位/復位功能,可以進行自增和自減計數,其計數周期為2^N(N為二進制位數)。 二、設計原理 輸入/輸出說明: d:異步置數數據輸入; q:當前計數器數據輸出; clock:時鐘脈沖; count_en:計數器計數使能控制(1:計數/0:停止計數); updown:計數器進行自加/自減運算控制(1:自加/0:自減); load_d
標簽: Verilog 計數器 HDL 減
上傳時間: 2015-03-28
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1 程序開發步驟如下 (1) 打開vc,選擇菜單項file->new,選擇projects選項并建立一個名為"floppy"的win32 console applicatoin工程;創建時注意指定創建該工程的目錄; (2) 在工程中創建源文件"floppy.cpp":選擇菜單項project->add to project->files,在選擇框中輸入自己想要創建的文件名,這里是"floppy.cpp";在接下來詢問是否創建新文件時回答"yes";然后通過Workspace->FileView->Source Files打開該文件,在其中編輯本程序的源代碼;編輯結束后通過菜單項File->Save進行保存; (3) 同(2)步驟再加入文件"floppy.h"; (4) 通過調用菜單命令項build->build all進行編譯連接,可以在指定的工程目錄下得到debug->floppy.exe程序;現在即可以運行該程序;由于沒有命令行參數,故不必在控制臺下來運行,直接運行即可; 2 補充說明 這里僅僅給出了編譯結果和源程序,沒有所創建工程的其他文件。
標簽: 程序開發
上傳時間: 2014-01-02
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