(臺達)開關(guān)電源基本原理與設(shè)計介紹,比較實用
標(biāo)簽: 開關(guān)電源
上傳時間: 2013-06-15
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采用單片機SPCE061A 為控制核心, 實現(xiàn)0 到2A 數(shù)控可調(diào)直流恒流源. 電流測量采用康錳銅電阻絲作為精 密取樣電阻, 利用A/ D 輸入口進行電流檢測和監(jiān)控. 輸出電流控制采用單片機的D/ A 口輸出模擬量; 恒流部分的 控制端采用閉環(huán)反饋控制形式, 受控部分采用達林頓管進行擴流、采用LCD 點陣圖液晶顯示屏實時顯示. 該電流源 可用于污水泵站的儀表中采用單片機SPCE061A 為控制核心, 實現(xiàn)0 到2A 數(shù)控可調(diào)直流恒流源. 電流測量采用康錳銅電阻絲作為精 密取樣電阻, 利用A/ D 輸入口進行電流檢測和監(jiān)控. 輸出電流控制采用單片機的D/ A 口輸出模擬量; 恒流部分的 控制端采用閉環(huán)反饋控制形式, 受控部分采用達林頓管進行擴流、采用LCD 點陣圖液晶顯示屏實時顯示. 該電流源 可用于污水泵站的儀表中
上傳時間: 2013-07-22
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可以用H.264編碼解碼器源碼(c語言)
上傳時間: 2013-07-08
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該論文的工作主要分為兩部分,第一部分是介紹與數(shù)字高清晰度電視(HDTV)碼流發(fā)生器配套的信源解碼板的設(shè)計與實現(xiàn).信源解碼板是整個碼流發(fā)生器的重要組成部分,該論文在介紹相關(guān)標(biāo)準(zhǔn)MPEG-2和AC-3以及整個碼流發(fā)生器功能的基礎(chǔ)上提出了用ST公司的芯片組實現(xiàn)HDTV信源解碼板的設(shè)計方案.論文詳細分析了各個功能模塊的具體設(shè)計方法以及實現(xiàn)時應(yīng)注意的問題.目前該課題已經(jīng)成功結(jié)題,各項技術(shù)指標(biāo)完全符合合作單位的要求.該論文的第二部分主要是進行基于FPGA的顯示器測試信號發(fā)生器的研究與開發(fā).在對測試信號發(fā)生器所需產(chǎn)生的13種測試圖案和所要適應(yīng)的18種顯示格式的介紹之后,該論文提出了以FLEX10K50為核心控制芯片的顯示器測試信號發(fā)生器的設(shè)計方案.該論文詳細討論了FPGA設(shè)計中各個功能模塊的劃分和設(shè)計實現(xiàn)方法,并介紹了對FLEX10K50進行配置的方法.
標(biāo)簽: HDTV FPGA 碼流 發(fā)生器
上傳時間: 2013-04-24
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qq源碼示例,有空自己看吧,包含一個服務(wù)器端和客戶端-qq source examples
標(biāo)簽: 源碼
上傳時間: 2013-04-24
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數(shù)字濾波作為數(shù)字信號處理技術(shù)的重要組成部分,廣泛應(yīng)用于諸如信號分離、恢復(fù)、整形等多種場合中,本文討論的FIR濾波器因其具有嚴格的線性相位特性而得到廣泛的應(yīng)用。在工程實踐中,往往要求信號處理具有實時性和靈活性,但目前常用的一些軟件或硬件實現(xiàn)方法則難以同時達到兩方面的要求。 可編程邏輯器件是一種用戶根據(jù)需要而自行構(gòu)造邏輯功能的數(shù)字集成電路。本課題研究FIR的FPGA解決方案體現(xiàn)電子系統(tǒng)的微型化和單片化,主要完成的工作如下: (1)以FIR濾波器的基本理論為依據(jù),研究適應(yīng)工程實際的數(shù)字濾波器的設(shè)計方法: (2)對分布式算法進行了較為深入的研究。在闡述算法原理的基礎(chǔ)上,分析了利用FPGA特有的查找表結(jié)構(gòu)完成這一運算的方法,從而解決了常系數(shù)乘法運算硬件實現(xiàn)的問題; (3)以—FIR低通濾波器為例說明FIR數(shù)字濾波器的具體實現(xiàn)方法,采用層次化、模塊化、參數(shù)化的設(shè)計思想,完成對整個FIR濾波器的功能模塊的劃分,以及各個功能模塊的具體設(shè)計; (4)設(shè)計參數(shù)可調(diào)的FIR低通濾波器的硬件電路:以EPFlK50TCl44-l為核心,包括A/D轉(zhuǎn)換電路、D/A轉(zhuǎn)換電路以及在系統(tǒng)配置電路等。以話音作為輸入信號,進行了實際濾波效果的測試。 實驗系統(tǒng)的測試結(jié)果表明,和傳統(tǒng)的數(shù)字濾波器相比較具有更好的實時性、準(zhǔn)確性、靈活性和實用性。
標(biāo)簽: FPGA 沖激響應(yīng) 數(shù)字濾波器
上傳時間: 2013-07-19
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開關(guān)電源是利用現(xiàn)代電力電子技術(shù),控制開關(guān)晶體管開通和關(guān)斷的時間比率,維持穩(wěn)定輸出電壓的一種電源,一般由PWM(脈沖寬度調(diào)制)控制IC和 MOSFET構(gòu)成。本文利用開關(guān)電源芯片UC3842設(shè)計制作一款新穎的單端反激式、寬電壓輸入范圍、12V8A固定電壓輸出的96W 開關(guān)穩(wěn)壓電源,適用于需要較大電流的直流場合(如對汽車電瓶充電)。
標(biāo)簽: 3842 UC 反激式開關(guān)電源
上傳時間: 2013-06-10
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關(guān)于開關(guān)電源反激高頻變壓器很詳細的的計算方法。(12V/5A)
標(biāo)簽: 12V4A 反激變壓器 設(shè)計方法
上傳時間: 2013-04-24
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常用有源晶振封裝尺寸及實物圖.應(yīng)該能幫助一些人吧!!
上傳時間: 2013-06-11
上傳用戶:lanwei
直接數(shù)字合成(DDS)技術(shù)采用全數(shù)字的合成方法,所產(chǎn)生的信號具有頻率分辨率高、頻率切換速度快、頻率切換時相位連續(xù)、輸出相位噪聲低和可以產(chǎn)生任意波形等諸多優(yōu)點。本文研究的是一種基于DDS/FPGA的多波形信號源系統(tǒng),其中,DDS技術(shù)是其核心技術(shù)。DDS可以精確地控制合成信號的三個參量:幅度、相位以及頻率,因此利用DDS技術(shù)可以合成任意波形。但因其數(shù)字化合成的固有特點,使其輸出信號中存在大量雜散信號。雜散信號的主要來源是:相位截斷帶來的雜散信號;幅度量化帶來的雜散信號;DAC的非線性特性帶來的雜散信號。這些雜散信號嚴重影響了合成信號的頻譜純度。因此抑制這些雜散信號是提高合成信號譜質(zhì)的關(guān)鍵。 本文在研究各種抑制DDS雜散技術(shù)的基礎(chǔ)上,提出了中和加擾技術(shù),這可以在很大程度上減小雜散對DDS輸出信號譜質(zhì)的影響。 EP1S808956C6是一款高性能的FPGA芯片,其超強的數(shù)據(jù)處理能力十分適合應(yīng)用于DDS多波形信號源的開發(fā)。在QuartusⅡ平臺下運用Verilog HDL語言和原理圖設(shè)計可以很方便地應(yīng)用各種抑制雜散信號的方法來提高輸出信號的譜質(zhì)。 結(jié)合高速DDS技術(shù)和FPGA兩者的優(yōu)點,本文設(shè)計了一種基于DDS/FPGA的多波形信號源,它能完成正弦波、余弦波、三角波、鋸齒波、方波、AM、SSB、FM、2ASK、2FSK、π/4-QDPSK等多種信號。使得所設(shè)計的信號源可以適應(yīng)多種不同的工作環(huán)境,給工作帶了方便。
上傳時間: 2013-07-27
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