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混合模型

混合模型（hybridmodel）是幾種不同模型組合而成的一種模型。它允許一個(gè)項(xiàng)目能沿著最有效的路徑發(fā)展。也可定義為由固定效應(yīng)和隨機(jī)效應(yīng)（隨機(jī)誤差除外）兩部分組成的統(tǒng)計(jì)分析模型。如由幾個(gè)高斯分布混合起來的模型叫高斯混合模型，幾個(gè)線性模型混合在一起的模型叫線性混合模型。一般的，被模擬的系統(tǒng)幾乎不可能按照一種模式一步一步地進(jìn)行，會受到很多外界因素的干擾。而混合模型能夠適應(yīng)不同的系統(tǒng)和不同情況的需要而提出一種靈活多樣的動態(tài)方法。混合模型分為分析、綜合、運(yùn)行和廢棄四個(gè)階段，各階段的重疊為設(shè)計(jì)員提出了模型選擇。[1]

  • 可變點(diǎn)流水線結(jié)構(gòu)FFT處理器

    隨著電子技術(shù)和集成電路技術(shù)的飛速發(fā)展，數(shù)字信號處理已經(jīng)廣泛地應(yīng)用于通信、信號處理、生物醫(yī)學(xué)以及自動控制等領(lǐng)域中。離散傅立葉變換(DFT)及其快速算法FFT作為數(shù)字信號處理中的基本變換，有著廣泛的應(yīng)用。特別是近年來，基于FFT的ODFM技術(shù)的興起，進(jìn)一步推動了對高速FFT處理器的研究。 FFT 算法從出現(xiàn)到現(xiàn)在已有四十多年代歷史，算法理論已經(jīng)趨于成熟，但是其具體實(shí)現(xiàn)方法卻值得研究。面向高速、大容量數(shù)據(jù)流的FFT實(shí)時(shí)處理，可以通過數(shù)據(jù)并行處理或者采用多級流水線結(jié)構(gòu)來實(shí)現(xiàn)。特別是流水線結(jié)構(gòu)使得FFT處理器在進(jìn)行不同點(diǎn)數(shù)的FFT計(jì)算時(shí)可以通過對模塊級數(shù)的控制很容易的實(shí)現(xiàn)。 本文在分析和比較了各種FFT算法后，選擇了基2和基4混合頻域抽取算法作為FFr處理器的實(shí)現(xiàn)算法，并提出了一種高速、處理點(diǎn)數(shù)可變的流水線結(jié)構(gòu)FFT處理器的實(shí)現(xiàn)方法。利用這種方法實(shí)現(xiàn)的FFT處理器成功的應(yīng)用到DAB接收機(jī)中，RTL級仿真結(jié)果表明FFT輸出結(jié)果與C模型輸出一致，在FPGA環(huán)境下仿真波形正確，用Ouaaus Ⅱ軟件綜合的最高工作頻率達(dá)到133MHz，滿足了高速處理的設(shè)計(jì)要求。

    標(biāo)簽： FFT 流水線結(jié)構(gòu) 處理器

    上傳時(shí)間： 2013-05-29

    上傳用戶：GavinNeko

  • FPGA布線研究與實(shí)現(xiàn)

    現(xiàn)場可編程門陣列(FPGA)能夠減少電子系統(tǒng)的開發(fā)風(fēng)險(xiǎn)和開發(fā)成本，縮短上市時(shí)間，降低維護(hù)升級成本，故廣泛地應(yīng)用在電子系統(tǒng)中。最新的FPGA都采用了層次化的布線資源結(jié)構(gòu)，與以前的結(jié)構(gòu)發(fā)生了很大的變化。由于FPGA布線資源的固定性和有限性，因此需要開發(fā)適用于這種層次化的FPGA結(jié)構(gòu)并提高布線資源有效利用率的布線算法。同時(shí)由于晶體管尺寸的不斷減小，有必要在FPGA布線算法中考慮功耗和時(shí)序問題。 本論文所作的研究工作主要包括：提出一種基于Tile的FPGA結(jié)構(gòu)描述方法，對FPGA功耗模型和時(shí)序模型進(jìn)行了研究，實(shí)現(xiàn)了考慮FPGA功耗、布線資源利用率的布線算法。 在FPGA結(jié)構(gòu)描述方面，本文在分析現(xiàn)代商用FPGA層次化結(jié)構(gòu)及學(xué)術(shù)上對FPGA描述方法的基礎(chǔ)上，提出一種基于Tile的FPGA結(jié)構(gòu)描述。由于基本Tile的重復(fù)性，采用該方法可以簡化FPGA結(jié)構(gòu)的描述，同時(shí)由于該方法是以硬件結(jié)構(gòu)為根據(jù)，為FPGA軟硬件提供了簡單而靈活的接口，該方法在原型系統(tǒng)中測試證明是正確的。 在FPGA功耗模型方面，本文研究了ASIC中關(guān)于電路功耗計(jì)算的基本方法，并將其應(yīng)用到FPGA功耗分析中。在模型中的采用了混合的功耗模型，包括動態(tài)功耗模型和靜態(tài)功耗模型。動態(tài)功耗的計(jì)算采用基于節(jié)點(diǎn)狀態(tài)轉(zhuǎn)換率的開關(guān)級動態(tài)功耗計(jì)算和邏輯塊宏模型，靜態(tài)功耗則采用基于公式計(jì)算的晶體管漏電功耗模型和邏輯塊基于仿真的LUT/MUX表達(dá)式計(jì)算模型。這些功耗模型將運(yùn)用到我們后面的功耗計(jì)算和基于功耗驅(qū)動的布線算法中。 在FPGA布線算法研究和實(shí)現(xiàn)方面，本文在介紹基本的搜索算法之后，介紹了將FPGA硬件結(jié)構(gòu)轉(zhuǎn)變?yōu)镕PGA布線程序可識別的布線資源圖的方法，并將基本的搜索算法運(yùn)用的FPGA布線資源圖上，實(shí)現(xiàn)FPGA的基于布通率的布線算法。在此基礎(chǔ)上，借鑒了FPGA時(shí)序分析方法，將時(shí)序分析作為布線算法的一子模塊，對基于時(shí)序的布線算法進(jìn)行了研究；同時(shí)采用了FPGA功耗模型，在布線算法實(shí)現(xiàn)中考慮了動態(tài)功耗的問題。最后在布線算法中實(shí)現(xiàn)兩種啟發(fā)式策略以提高可布線資源有效利用率。

    標(biāo)簽： FPGA 布線

    上傳時(shí)間： 2013-04-24

    上傳用戶：long14578

  • PWM控制器SG3525的兩種宏模型

    給出了SG3525的兩種宏模型，以及如何建模！

    標(biāo)簽： 3525 PWM SG 控制器

    上傳時(shí)間： 2013-04-24

    上傳用戶：@小小羊

  • clue-s模型

    模型區(qū)域土地利用變化，協(xié)調(diào)土地利用需求與布局。

    標(biāo)簽： clue-s 模型

    上傳時(shí)間： 2013-06-22

    上傳用戶：ainimao

  • 《COM技術(shù)內(nèi)幕（微軟組件對象模型）》

    ·詳細(xì)說明：《COM技術(shù)內(nèi)幕（微軟組件對象模型）》清華大學(xué)出版社

    標(biāo)簽： COM 微軟 對象模型

    上傳時(shí)間： 2013-05-26

    上傳用戶：hn891122

  • 基于混合動力汽車用動力型鋰電池保護(hù)電路的研究

    ·合肥工業(yè)大學(xué)碩士學(xué)位論文基于混合動力汽車用動力型鋰電池保護(hù)電路的研究姓名：姚春元申請學(xué)位級別：碩士專業(yè)：電氣工程指導(dǎo)教師：李紅梅20080501

    標(biāo)簽： 混合動力汽車 動力 保護(hù)電路 鋰電池

    上傳時(shí)間： 2013-05-19

    上傳用戶：趙安qw

  • 有源濾波器Matlab仿真模型

    基于瞬時(shí)無功功率理論、滯環(huán)電流控制的三相電力有源濾波器Matlab仿真模型

    標(biāo)簽： Matlab 有源濾波器 仿真模型

    上傳時(shí)間： 2013-04-24

    上傳用戶：teddysha

  • 基于FPGA模型化設(shè)計(jì)的雷達(dá)信號

    隨著現(xiàn)場可編程門陣列(FPGA)在工業(yè)中的廣泛應(yīng)用，使得基于FPGA數(shù)字信號處理的實(shí)現(xiàn)在雷達(dá)信號處理中有著重要地位。模型化設(shè)計(jì)是一種自頂向下的面向FPGA的快速原型驗(yàn)證法，它不僅降低了FPGA設(shè)計(jì)門檻，而且縮短了開發(fā)周期，提高了設(shè)計(jì)效率。這使得FPGA模型化設(shè)計(jì)成為了FPGA系統(tǒng)設(shè)計(jì)的發(fā)展趨勢。本文針對常見雷達(dá)信號處理模塊的FPGA模型化實(shí)現(xiàn)，在以下幾個(gè)方面展開研究：首先對基于FPGA的模型化設(shè)計(jì)方法進(jìn)行了研究，給出了模型化設(shè)計(jì)方法的發(fā)展現(xiàn)狀和趨勢，并對本文中使用的模型化設(shè)計(jì)方法的軟件工具System Generator和AccelDSP進(jìn)行了介紹。其次使用這兩種軟件工具對FIR濾波器進(jìn)行了模型化設(shè)計(jì)并同RTL(寄存器傳輸級)設(shè)計(jì)方法進(jìn)行對比，全面分析了模型化設(shè)計(jì)方法和RTL設(shè)計(jì)方法的優(yōu)缺點(diǎn)。然后在簡明闡述雷達(dá)信號處理原理的基礎(chǔ)上，使用System Generator對數(shù)字下變頻(DDC)、脈沖壓縮、動目標(biāo)顯示(MTI)及恒虛警(CFAR)處理等雷達(dá)信號處理模塊進(jìn)行了自頂向下的模型化設(shè)計(jì)。在Simulink中進(jìn)行了功能仿真驗(yàn)證，生成了HDL代碼，并在Xilinx FPGA中進(jìn)行了RTL的時(shí)序仿真分析。關(guān)鍵詞：雷達(dá)信號處理 FPGA 模型化設(shè)計(jì) System Generator AccelDSP

    標(biāo)簽： FPGA 模型 雷達(dá)信號

    上傳時(shí)間： 2013-07-25

    上傳用戶：zhangsan123

  • Android多線程模型和service分析

    作者：華清遠(yuǎn)見3G學(xué)院。android多線程模型和service分析--華清遠(yuǎn)見android培訓(xùn)課件教程。

    標(biāo)簽： Android service 多線程 分

    上傳時(shí)間： 2013-07-05

    上傳用戶：CETM008

  • 語音識別配套的VQ及DHMM模型訓(xùn)練程序(C語言)

    ·詳細(xì)說明：語音識別配套的VQ及DHMM模型訓(xùn)練程序，C語言，已經(jīng)定點(diǎn)化，可直接移植到8位MCU或16位DSP中。與目前市面的語音識別玩具的算法基本一致，非常實(shí)用，僅供大家參考，別去搶人家飯碗才好.

    標(biāo)簽： DHMM 語音識別 C語言 模型

    上傳時(shí)間： 2013-07-31

    上傳用戶：84425894

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