電極壓力是電阻點焊的主要參數(shù)之一,電極壓力的恒定性、可調(diào)性對于保證焊點的質(zhì)量是非常重要的,但是,目前生產(chǎn)中普遍使用的氣動焊槍,不具備調(diào)節(jié)電極壓力的功能。本文的目的就是研制一種新型的伺服驅(qū)動的懸掛式點焊槍,該焊槍能夠在焊接的過程中對電極壓力進行實時的調(diào)節(jié),從而實現(xiàn)復(fù)雜的焊接循環(huán),提高焊接質(zhì)量。 焊槍采用伺服電機作為動力裝置,以滾珠絲杠為主要傳動機構(gòu),結(jié)構(gòu)簡單緊湊,運動平穩(wěn)靈活。壓力控制系統(tǒng)采用32位的ARM微處理器作為核心,與采用傳統(tǒng)的單片機相比,系統(tǒng)的工作頻率大幅提高,硬件功能更加強大,更適合電極壓力的實時控制。此外,在系統(tǒng)中移植了uC/OS-Ⅱ?qū)崟r操作系統(tǒng),并在此基礎(chǔ)上構(gòu)建了一個分層次的、多任務(wù)的、消息機制的軟件系統(tǒng),充分發(fā)揮了ARM的性能,提高了系統(tǒng)的穩(wěn)定性和實時性。 利用伺服焊槍進行了焊接試驗,在焊接過程中,伺服電機工作在力矩模式下,采用開環(huán)的控制方式,利用電壓信號控制電極的壓力和速度,通過驅(qū)動器的反饋信號檢測電極的壓力和位置,使用I/O口控制焊接電源。 實驗結(jié)果證明,本課題研制的伺服焊槍的機械裝置的精度和響應(yīng)速度均能夠滿足焊接的需要,而且可以實現(xiàn)快速漸進,低速爬行,電極輕接觸,快速預(yù)壓等功能,有助于延長電極壽命和提高焊接效率。而且,使用伺服焊槍進行了低碳鋼焊接試驗,采用馬鞍形的加壓方式,與恒定壓力條件相比,焊接中飛濺大幅減少,焊點強度和塑性增加,焊接質(zhì)量有明顯提高。
上傳時間: 2013-04-24
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I/O并行口直接驅(qū)動LED顯示1. 實驗任務(wù) 如圖13所示,利用AT89S51單片機的P0端口的P0.0-P0.7連接到一個共陰數(shù)碼管的a-h(huán)的筆段上,數(shù)碼管的公共端接地。在數(shù)碼
標(biāo)簽: LED 并行口 直接驅(qū)動 電路圖
上傳時間: 2013-06-15
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隨著Intemet網(wǎng)絡(luò)技術(shù)、無線接入技術(shù)和無線通信技術(shù)的快速發(fā)展,傳真技術(shù)有了許多新的研究方向。PC傳真需利用傳真軟件進行傳真,其功能受到傳真軟件的限制,而IP傳真需投入的通信基礎(chǔ)設(shè)施較大。無線傳真技術(shù)具有方便快捷的特性,可快速適應(yīng)市場的多樣化需求,充分發(fā)揮無線通信的優(yōu)勢,使用戶真正擁有自己的“移動辦公室”,是當(dāng)前無線通信研究領(lǐng)域的一個重點內(nèi)容。 本課題在對傳真通信相關(guān)基礎(chǔ)理論以及GSM無線網(wǎng)絡(luò)研究的基礎(chǔ)上,設(shè)計和研制了基于G3傳真的GSM網(wǎng)絡(luò)無線傳真接入終端。在本課題的設(shè)計中,建立了兩段級聯(lián)的傳真線路,分別是主處理器與對端傳真機之間的傳真線路(通過T32協(xié)議實現(xiàn))和主處理器與本地傳真機之間的傳真線路(通過T31協(xié)議實現(xiàn)),本課題依據(jù)T30規(guī)定的呼叫控制流程完成了這兩條傳真線路間的協(xié)議轉(zhuǎn)換(T.32協(xié)議和T3l協(xié)議的轉(zhuǎn)換),并結(jié)合GSM網(wǎng)絡(luò)延時長、干擾大的特性進行了時延處理。同時解決了無線傳真接入終端中涉及到的手機本地號段的存取算法,并在設(shè)計本課題嵌入式軟件的同時抽樣出基于ARM技術(shù)的系統(tǒng)軟件設(shè)計方案(即類似于嵌入式操作系統(tǒng)但比操作系統(tǒng)簡化的一個系統(tǒng)框架)。 通過本課題研制出的基于ARM的GSM網(wǎng)絡(luò)G3無線傳真接入終端,利用現(xiàn)有的G3傳真機就可在GSM網(wǎng)絡(luò)中實現(xiàn)無線傳真業(yè)務(wù)。目前該無線傳真接入終端已在北京、西安、深圳等地的商用網(wǎng)絡(luò)上取得了成功的測試。
標(biāo)簽: ARM GSM 網(wǎng)絡(luò) 無線
上傳時間: 2013-04-24
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11201頻率計算器含有多種頻率計算工具,有LC諧振頻率計算軟件,RC諧振頻率計算工具,并含有多種軟件
上傳時間: 2013-07-26
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VLSI(超大規(guī)模集成電路)的快速發(fā)展,使得FPGA技術(shù)得到了迅猛發(fā)展,F(xiàn)PGA的快速發(fā)展又為實時圖像處理在算法、系統(tǒng)結(jié)構(gòu)上帶來了新的方法和思路,全景圖像處理是實時圖像處理中一個嶄新的領(lǐng)域,其在視頻監(jiān)視領(lǐng)域內(nèi)有廣泛的應(yīng)用前景。 本文首先介紹了全景圖像處理的發(fā)展?fàn)顩r,課題的主要背景、國內(nèi)外發(fā)展現(xiàn)狀、課題的研究意義、課題的來源和本文的主要研究工作及論文組織結(jié)構(gòu)。然后在第二章中介紹了FPGA的發(fā)展,F(xiàn)PGA/CPLD的特點,并介紹了Cyclone Ⅱ系列FPGA的硬件結(jié)構(gòu),硬件描述語言,開發(fā)工具Quartus Ⅱ以及FPGA開發(fā)的一般原則。 文章的重點放在了電路板的設(shè)計部分,也就是本文的第三章。在介紹電路設(shè)計部分之前首先介紹一些高速數(shù)字電路設(shè)計中的一些概念、高速數(shù)字電路設(shè)計中常見問題,并對常見問題給出了一般解決方法。 在FPGA電路板設(shè)計部分中,對FPGA電路的設(shè)計過程作了詳細(xì)的說明,其中著重介紹了采用了FBGA封裝的EP2C35芯片的電路設(shè)計要點,多層電路板設(shè)計要點,F(xiàn)PGA供電管腳的處理注意事項,F(xiàn)PGA芯片中PLL模塊的設(shè)計以及FPGA的配置方法,并給出了作者的設(shè)計思路。FPGA供電電源也是電路板設(shè)計的要點所在,文章中也著重對其進行了介紹,提及了FPGA電源設(shè)計指標(biāo)要求及電壓功耗估計,并根據(jù)現(xiàn)有的FPGA電源解決方案提出了設(shè)計思路和方法。同時文章中對FPGA芯片外圍器件電路包括圖像采集顯示芯片電路、圖像存儲電路、USB2.0接口電路的設(shè)計做了相應(yīng)的介紹。最終目的就是為基于FPGA的全景圖象處理搭建一個穩(wěn)定運行的平臺。 在第四章中介紹了IC總線控制器的狀態(tài)機圖及信號說明和相應(yīng)的仿真圖。 文章最后給出了FPGA硬件電路的調(diào)試結(jié)果,驗證了設(shè)計目的,為進一步的工作打下了良好的基礎(chǔ)。
上傳時間: 2013-04-24
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近年來,隨著控制系統(tǒng)規(guī)模的擴大和總線技術(shù)的發(fā)展,對數(shù)據(jù)采集和傳輸技術(shù)提出了更高的要求。目前,很多設(shè)備需要實現(xiàn)從單串口通信到多路串口通信的技術(shù)改進。同時,隨著以太網(wǎng)技術(shù)的發(fā)展和普及,這些設(shè)備的串行數(shù)據(jù)需要通過網(wǎng)絡(luò)進行傳輸,因而有必要尋求一種解決方案,以實現(xiàn)技術(shù)上的革新。 本文分別對串行通信和基于TCP/IP協(xié)議的以太網(wǎng)通信進行研究和分析,在此基礎(chǔ)上,設(shè)計一個嵌入式系統(tǒng)一基于APM處理器的多路串行通信與以太網(wǎng)通信系統(tǒng),來實現(xiàn)F8-DCS系統(tǒng)中多路串口數(shù)據(jù)采集和以太網(wǎng)之間的數(shù)據(jù)傳輸。主要作了如下工作:首先,分析了當(dāng)前串行通信的應(yīng)用現(xiàn)狀和以太網(wǎng)技術(shù)的發(fā)展動態(tài),通過比較傳統(tǒng)的多路串口通信系統(tǒng)的優(yōu)缺點,設(shè)計出了一種采用CPID技術(shù)和CAN總線技術(shù)相結(jié)合的新型技術(shù),并結(jié)合F8-DCS系統(tǒng)數(shù)據(jù)量大和實時性高的特點,對串行通訊幀同步的方法進行了詳細(xì)的研究。然后,根據(jù)課題的實際需求,對系統(tǒng)進行總體設(shè)計和功能模塊劃分,并詳細(xì)介紹了基于ARM7處理器的多路串口通信接口、以太網(wǎng)通信接口以及二者之間的數(shù)據(jù)傳輸接口的電路設(shè)計。在軟件設(shè)計上,對系統(tǒng)的啟動代碼、串行通信協(xié)議、串口驅(qū)動以及多串口與網(wǎng)口間雙向數(shù)據(jù)傳輸?shù)冗M行了詳細(xì)的論述。最后,將上述技術(shù)應(yīng)用于某大型火電廠主機F8-DCS系統(tǒng)I/O通訊網(wǎng)絡(luò)的測試與分析,達到了設(shè)計要求。
上傳時間: 2013-07-31
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嵌入式系統(tǒng)產(chǎn)品開發(fā)現(xiàn)已成為IT產(chǎn)業(yè)的主流發(fā)展方向之一,在不同應(yīng)用領(lǐng)域的嵌入式系統(tǒng)產(chǎn)品開發(fā)中,都涉及到的一個共性關(guān)鍵技術(shù)是:嵌入式系統(tǒng)開發(fā)平臺的研究與設(shè)計。 本文密切結(jié)合實際科研項目,采用軟、硬件協(xié)同設(shè)計的研究方法,設(shè)計了一套基于ARM微處理器架構(gòu)的嵌入式系統(tǒng)開發(fā)平臺,為應(yīng)用系統(tǒng)的開發(fā)者完成了大部分共性的底層設(shè)計工作,并針對現(xiàn)代酒店客房管理與控制系統(tǒng)的功能要求,以此平臺為基礎(chǔ),開發(fā)了一個樓層機控制系統(tǒng),并成功運用于深圳某國際大酒店的客房控制系統(tǒng)中,驗證了本文研發(fā)成果的有效性和推廣應(yīng)用價值。 論文首先分析了當(dāng)前國內(nèi)外嵌入式系統(tǒng)的研究現(xiàn)狀,然后研究了基于S3C44BOX開發(fā)板的硬件設(shè)計和實現(xiàn)過程,分別給出了電源模塊、MCU核心模塊、存儲器模塊、I/O接口模塊、通信接口模塊、調(diào)試以及系統(tǒng)擴展接口等主要模塊的設(shè)計方法和電氣原理圖;使用CPLD實現(xiàn)了多功能JTAG調(diào)試器,在SDT環(huán)境下完成了硬件調(diào)試工作;研究了嵌入式操作系統(tǒng)的移植技術(shù),針對VxWorks操作系統(tǒng)下載與應(yīng)用,開發(fā)了適用于S3C44BOX的板級支持包,成功完成了BootRom和VxWorks兩種映像的生成和加載;在論文的最后,研究了本平臺在酒店客房控制系統(tǒng)中的實際應(yīng)用方法,設(shè)計其作為樓層機的實現(xiàn)方案,討論了網(wǎng)絡(luò)通信與控制的工作原理,并給出了主要程序的流程圖。
標(biāo)簽: ARM 架構(gòu) 嵌入式 平臺設(shè)計
上傳時間: 2013-06-02
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偏振模色散(PMD)是限制光通信系統(tǒng)向高速率和大容量擴展的主要障礙,尤其是160Gb/s光傳輸系統(tǒng)中,由PMD引起的脈沖畸變現(xiàn)象更加嚴(yán)重。為了克服PMD帶來的危害,國內(nèi)外已經(jīng)開始了對PMD補償?shù)难芯?。但是目前的補償系統(tǒng)復(fù)雜、成本高且補償效果不理想,因此采用前向糾錯(FEC)和偏振擾偏器配合抑制PMD的方法,可以實現(xiàn)低成本的PMD補償。 在實驗中將擾偏器連入光時分復(fù)用系統(tǒng),通過觀察其工作前后的脈沖波形,發(fā)現(xiàn)擾偏器的應(yīng)用改善了系統(tǒng)的性能。隨著系統(tǒng)速率的提高,對擾偏器速率的要求也隨之提高,目前市場上擾偏器的速率無法滿足160Gb/s光傳輸系統(tǒng)要求。通過對偏振擾偏器原理的分析,決定采用高速控制電路驅(qū)動偏振控制器的方法來實現(xiàn)高速擾偏器的設(shè)計。擾偏器采用鈮酸鋰偏振控制器,其響應(yīng)時間小于100ns,是目前偏振控制器能夠達到的最高速率,但是將其用于160Gb/s高速光通信系統(tǒng)擾偏時,這個速率仍然偏低,因此,提出采用多段鈮酸鋰晶體并行擾偏的方法,彌補鈮酸鋰偏振控制器速率低的問題。通過對幾種處理器的分析和比較,選擇DSP+FPGA作為控制端,DSP芯片用于產(chǎn)生隨機數(shù)據(jù),F(xiàn)PGA芯片具有豐富的I/O引腳,工作頻率高,可以實現(xiàn)大量數(shù)據(jù)的快速并行輸出。這樣的方案可以充分發(fā)揮DSP和FPGA各自的優(yōu)勢。另外對數(shù)模轉(zhuǎn)換芯片也要求響應(yīng)速度快,本論文以FPGA為核心,完成了FPGA與其它芯片的接口電路設(shè)計。在QuartusⅡ集成環(huán)境中進行FPGA的開發(fā),使用VHDL語言和原理圖輸入法進行電路設(shè)計。 本文設(shè)計的偏振擾偏器在高速控制電路的驅(qū)動下,可以實現(xiàn)大量的數(shù)據(jù)處理,采用多段鈮酸鋰晶體并行工作的方法,可以提高偏振擾偏器的速率。利用本方案制作的擾偏器具有高擾偏速率,適合應(yīng)用于160Gb/s光通信系統(tǒng)中進行PMD補償。
上傳時間: 2013-04-24
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加密算法一直在信息安全領(lǐng)域起著極其重要的作用,它直接影響著國家的安全和發(fā)展.隨著計算機技術(shù)的飛速發(fā)展,原有的數(shù)據(jù)加密標(biāo)準(zhǔn)(DES)已不能滿足人們的保密要求.在未來的20年內(nèi),高級數(shù)據(jù)加密標(biāo)準(zhǔn)(AES)將替代DES成為新的數(shù)據(jù)加密標(biāo)準(zhǔn).在不對原有應(yīng)用系統(tǒng)作大的改動的情況下,3-DES算法有了很大的生存空間.該文介紹了DES和3-DES算法的概要,給出了一種電路實現(xiàn)模型,并基于XILINX公司的FPGA器件設(shè)計了IP核,介紹了I P核設(shè)計中主要模塊的設(shè)計方法.最后對該IP核進行了分析,給出它的性能參數(shù).該課題系統(tǒng)地論述了基3-DES算法的密碼IP核設(shè)計全過程.文章首先闡述了該設(shè)計的課題背景,給出了使用VHDL方法設(shè)計密碼電路的特點和研究思路和特點,然后對IP核的設(shè)計環(huán)境和密碼算法進行了介紹.在此基礎(chǔ)上,詳細(xì)討論了3-DES算法的密碼芯片設(shè)計方法和各個電路模塊實現(xiàn)的結(jié)構(gòu)圖,包括算法電路、譯碼電路、接口電路和控制模塊電路等.通過對各個模塊設(shè)計的介紹,闡明了使用VHDL語言設(shè)計專用集成電路的原理和特點.
上傳時間: 2013-04-24
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MPEG-4是目前非常流行的視頻壓縮標(biāo)準(zhǔn),基于MPEG-4的視頻處理系統(tǒng)有兩種體系結(jié)構(gòu):可編程結(jié)構(gòu)和專用結(jié)構(gòu).可編程結(jié)構(gòu)靈活,適用范圍廣,易于升級,但電路復(fù)雜,電路功耗大.專用視頻編解碼器結(jié)構(gòu)硬件開銷小,處理速度高.該文主要研究專用的MPEG-4視頻編解碼芯片設(shè)計方法.目前市場上MPEG-4視頻編解碼芯片主要是Simple Profile級別的,而我們設(shè)計的芯片要實現(xiàn)Advanced Simple Profile級別.該文采用了一種基于大規(guī)模FPGA的軟硬件相結(jié)的芯片設(shè)計方案,我們設(shè)計了基于FPGA的MPEG-4芯片設(shè)計開發(fā)平臺,完成算法的硬件仿真與測試.論文圍繞基于FPGA的MPEG-4芯片開發(fā)系統(tǒng)設(shè)計,分為兩個部分.第一部分介紹了目前國內(nèi)外實現(xiàn)MPEG-4視頻處理系統(tǒng)的主要方法和應(yīng)用,概述了國際上MPEG-4視頻編解碼芯片設(shè)計的一般方法及其發(fā)展趨勢,詳細(xì)描述了我們的基于FPGA的MPEG-4編解碼芯片開發(fā)系統(tǒng)的結(jié)構(gòu).第二部分重點講述了基于FPGA的MPEG-4芯片開發(fā)系統(tǒng)各個電路模塊的設(shè)計,包括電源模塊、FPGA配置模塊、時鐘生成模塊、視頻輸入/輸出模塊、RS232串口模塊、以太網(wǎng)接口模塊、USB接口模塊等.同時也介紹了I
標(biāo)簽: MPEG4 FPGA 編解碼芯片 開發(fā)系統(tǒng)
上傳時間: 2013-06-15
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