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注意事項

  • TL431設(shè)計使用規(guī)范

    TL431設(shè)計使用規(guī)范,介紹使用TL431時的注意事項,(主要是配合光耦PC817使用時的設(shè)計規(guī)范)

    標(biāo)簽: 431 TL

    上傳時間: 2013-05-20

    上傳用戶:wzr0701

  • STM32經(jīng)典例子

    STM32使用指南,描述了在使用過程中應(yīng)該要注意什么問題

    標(biāo)簽: STM 32

    上傳時間: 2013-07-01

    上傳用戶:nbdedu

  • 高速PCB設(shè)計指南

    詳細(xì)介紹了高速PCB設(shè)計中需要注意的問題以及注意這些問題的原因,對于設(shè)計高速PCB有非常大的幫助!

    標(biāo)簽: PCB 設(shè)計指南

    上傳時間: 2013-04-24

    上傳用戶:ukuk

  • Cadence Allegro SPB 16.3下載加破解方法和破解程序

    之前的內(nèi)容有點(diǎn)問題,2013.6.26重新修改了一下,軟件1.74GB,另有破解程序,licence,教程包,4.9MB 下面破解步驟,參考一下: Cadence SPB 16.3的破解, 安裝步驟: 1.關(guān)閉殺毒軟件啊 2.運(yùn)動setup.exe然后點(diǎn)擊“License Manager”,安裝過程中詢問license file時,選擇取消。結(jié)束安裝。 3.拷貝 cdslmd.exe到\"C:\\Cadence\\LicenseManager\\\"(安裝目錄),替代原文件。 4.復(fù)制license163.lic到安裝目錄 5.打開license163.lic,編輯第1行,將this_host修改為電腦名稱(電腦名稱不能為中文及注意英文大小寫) 6.運(yùn)行LicenseServerConfiguration.exe 7.選取license163.lic 8.端口填寫5280(此步一般不需要做) 9.編輯window主計算機(jī)名,檢查hostname是否正確。可使用LMTOOLS查看(此步一般不需要做) 10.安裝Cadence SPB/orCAD 選取默認(rèn)值 11.拷貝orcad_163.exe到C:\\Cadence\\安裝目錄, 12.運(yùn)行orcad_163.exe破解補(bǔ)丁 13.OK

    標(biāo)簽: Cadence Allegro 16.3 SPB

    上傳時間: 2013-07-23

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  • Cadence Allegro 16.6破解Crack+高速下載+教程 Win7下可用

    最新Cadence Allegro 16.6破解版,Windows 7下32位和64位,經(jīng)實際測試,順利運(yùn)行,請仔細(xì)閱讀安裝說明。 后面附有高速百度網(wǎng)盤下載鏈接,壓縮包中包括破解文件及安裝說明,下面 Cadence16.6的版本個人感覺值得更新,有很多更新真心很實用很強(qiáng)大,但最重要的Display net names的功能的加入實在是感激涕零啊,因為當(dāng)初從AD轉(zhuǎn)到Cadence16.3時最不習(xí)慣的就是PCB上木有NET顯示啊... 小弟win7安裝時破解方法如下: 具體的步驟: 1、安裝licensemanager,問license時,單擊cancel,然后finish. 2、接下來安裝cadence的product,即第二項,直到結(jié)束. 3、在任務(wù)管理器中確認(rèn)一下是否有這兩個進(jìn)程,有就結(jié)束掉,即cdsNameServer.exe和cdsMsgServer.exe,沒有就算了.(電腦開機(jī)沒運(yùn)行過Cadence軟件就不用執(zhí)行這一步). 5、把破解文件夾crack中LicenseManager文件夾下的pubkey、pubkey.exe和lLicenseManagerPubkey.bat放到Cadence\\LicenseManager目錄下并運(yùn)行l(wèi)LicenseManagerPubkey.bat (如果是WIN764位操作系統(tǒng)請把cdslmd.exe文件復(fù)制到Cadence\\LicenseManager目錄下覆蓋原文件。其他操作系統(tǒng)不用,直接下一步) 6、把破解文件夾crack里crack\\SPB_16.6\\tools的pubkey、pubkey.exe和Tools.bat放到Cadence\\SPB_16.6\\tools目錄下并運(yùn)行Tools.bat (注意看一下DOS窗口會不會一閃而過,如果運(yùn)行差不多一分鐘就說明破解成功) 7、打開破解文件夾crack里L(fēng)icGen文件夾,然后雙擊licgen.bat生成新的license.lic,習(xí)慣上把這license文件拷到桌面上放著. 8.在電腦開始菜單中的程序里找到cadence文件夾,點(diǎn)開再點(diǎn)開License Manager,運(yùn)行License servers configuration Unilily,彈出的對話框中點(diǎn)browes...指向第7步拷貝到桌面上的license.lic,打開 它(open)再點(diǎn)下一步(next),將Host Name項中主機(jī)名改成你的電腦系統(tǒng)里的主機(jī)名(完整的計算機(jī)名稱),然后點(diǎn)下一步按界面提示直到完成第7步. 9.在電腦開始菜單中的程序里找到cadence文件夾(windows7下),點(diǎn)開再點(diǎn)開,運(yùn)行License client configuration Unility,填入5280@(你的主機(jī)名),點(diǎn)下一步(next),最后點(diǎn)finish,完成這第8步. 10.在電腦開始菜單中的程序里找到cadence文件夾(windows7下),點(diǎn)開再點(diǎn)開,運(yùn)行Lm Tools,點(diǎn)Config Services項,Path to the license file項中,點(diǎn)Browes指向c:\\cadence\\License Manager\\license.dat(如果看不見icense.dat,請在類型中下拉選擇DAT類型),打開它 (open)再點(diǎn)Save Service.然后啟動一下服務(wù)。到此,破解完成. 11、如果以上步驟都完成了,打開軟件提示找不到證書,請打開環(huán)境變量,用戶變量中看看 CDS_LIC_FILE 變量值是否為 5280@(你的主機(jī)名),如果沒 CDS_LIC_FILE變量名,請?zhí)砑右粋€變量。變量名為CDS_LIC_FILE 變量值為 5280@(你的主機(jī)名) 12. 64位操作系統(tǒng),軟件破解完請把cdslmd.exe文件復(fù)制到Cadence\\LicenseManager目錄下覆蓋原文件。 附我用的破解文件,希望給win7安裝不成功的有點(diǎn)幫助

    標(biāo)簽: Cadence Allegro Crack 16.6

    上傳時間: 2013-07-23

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  • 關(guān)于FPGA的設(shè)計方面的諸多經(jīng)驗總結(jié)

    關(guān)于FPGA的設(shè)計方面的諸多經(jīng)驗總結(jié),討論了設(shè)計方面應(yīng)該注意的問題。

    標(biāo)簽: FPGA 方面 經(jīng)驗

    上傳時間: 2013-08-21

    上傳用戶:onewq

  • 用FPGA實現(xiàn)大型設(shè)計時

    用FPGA實現(xiàn)大型設(shè)計時,可能需要FPGA具有以多個時鐘運(yùn)行的多重數(shù)據(jù)通路,這種多時鐘FPGA設(shè)計必須特別小心,需要注意最大時鐘速率、抖動、最大時鐘數(shù)、異步時鐘設(shè)計和時鐘/數(shù)據(jù)關(guān)系。設(shè)計過程中最重要的一步是確定要用多少個不同的時鐘,以及如何進(jìn)行布線

    標(biāo)簽: FPGA 大型 計時

    上傳時間: 2013-08-23

    上傳用戶:q986086481

  • 華為內(nèi)部資料

    華為內(nèi)部資料,關(guān)于FPGA設(shè)計的詳細(xì)過程介紹,很不錯的。本文檔從FPGA器件結(jié)構(gòu)出發(fā)以速度路徑延時大小和面積資源占用率為主題描述在FPGA設(shè)計過程中應(yīng)當(dāng)注意的問題和可以采用的設(shè)計技巧。

    標(biāo)簽: 華為

    上傳時間: 2013-08-23

    上傳用戶:kangqiaoyibie

  • The Ten Commandments of Excellent Design - fpga

    The Ten Commandments of Excellent Design - fpga。硬件描述語言注意事項

    標(biāo)簽: Commandments Excellent Design fpga

    上傳時間: 2013-08-24

    上傳用戶:AbuGe

  • 自己現(xiàn)在用的CPLD下載線原理圖用74HC244芯片\r\n

    自己現(xiàn)在用的CPLD下載線,用74HC244芯片\r\n要注意設(shè)置下載模式

    標(biāo)簽: CPLD 244 74 HC

    上傳時間: 2013-08-31

    上傳用戶:dancnc

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