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正弦信號發(fā)生器
,2006altera大賽－基于軟核Nios的寬譜正弦信號發生器設計：摘要：本設計運用了基于 Nios II 嵌入式處理器的 SOPC 技
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TMS320V5402 利用定時器中斷產生正弦信號,最高頻率300KHZ
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原創：采用VHDL語言編寫的正弦信號發生器。rom采用quartus自帶的lpm生成
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基于FPGA的移相式DDS正弦信號發生器的VHDL源代碼
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正弦信號發生器畢業設計論文資料
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PIC 單片機之發生器
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