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標(biāo)(biāo)準(zhǔn)(zhǔn)化的

可視化的編譯器

可視化的編譯器，具有但不編譯能力，而且注釋非常詳細(xì)，值得學(xué)習(xí)編譯器的人看一看

標(biāo)簽： 可視化編譯器

上傳時(shí)間： 2017-02-02

上傳用戶：wlcaption
基于DE2 development board的工程用來顯示N制的電視信號(hào)。

基于DE2 development board的工程用來顯示N制的電視信號(hào)。

標(biāo)簽： development board DE2 工程

上傳時(shí)間： 2017-02-03

上傳用戶：15071087253
此函數(shù)把SPI的讀寫功能集成在一塊,傳遞的val既是向SPI寫的數(shù)據(jù),也是從SPI讀取的數(shù)據(jù),只需要在執(zhí)行讀或?qū)懼鞍袽CU的I/O腳設(shè)置成相應(yīng)的輸出或輸入即可。（因?yàn)樵诖蟛糠謶?yīng)用中,是把SPI的DI

此函數(shù)把SPI的讀寫功能集成在一塊,傳遞的val既是向SPI寫的數(shù)據(jù),也是從SPI讀取的數(shù)據(jù),只需要在執(zhí)行讀或?qū)懼鞍袽CU的I/O腳設(shè)置成相應(yīng)的輸出或輸入即可。（因?yàn)樵诖蟛糠謶?yīng)用中,是把SPI的DI和DO相連并用MCU的一個(gè)IO口來讀寫）。

標(biāo)簽： SPI MCU val 數(shù)據(jù)

上傳時(shí)間： 2013-12-27

上傳用戶：l254587896
Delaunay trianglation 是平面三角化的一種重要方法

Delaunay trianglation 是平面三角化的一種重要方法，也可以應(yīng)用于三維的四面體的生成。因?yàn)橛眠@種方法產(chǎn)生的四面休在有限元分析中具有其獨(dú)特的優(yōu)勢而受到重視。

標(biāo)簽： trianglation Delaunay

上傳時(shí)間： 2017-02-11

上傳用戶：myworkpost
漢化的version for WinCE

漢化的version for WinCE

標(biāo)簽： version WinCE for 漢化

上傳時(shí)間： 2017-02-13

上傳用戶：klin3139
段頁式虛擬存儲(chǔ)管理的地址轉(zhuǎn)換程序,操作系統(tǒng)的課程設(shè)計(jì),使用C++的控制臺(tái)程序,結(jié)構(gòu)化的.

段頁式虛擬存儲(chǔ)管理的地址轉(zhuǎn)換程序,操作系統(tǒng)的課程設(shè)計(jì),使用C++的控制臺(tái)程序,結(jié)構(gòu)化的.

標(biāo)簽： 程序頁虛擬存儲(chǔ)管理

上傳時(shí)間： 2013-12-21

上傳用戶：jyycc
RTX 實(shí)現(xiàn)Windows 實(shí)時(shí)化的組件

RTX 實(shí)現(xiàn)Windows 實(shí)時(shí)化的組件，Visual C++環(huán)境下的開發(fā)，需要具有實(shí)時(shí)化的RTX組件安裝在Windows開發(fā)環(huán)境性，此示例代碼用軟件方法來測試RTX時(shí)鐘的實(shí)時(shí)性

標(biāo)簽： Windows RTX

上傳時(shí)間： 2014-01-09

上傳用戶：xiaoxiang
一個(gè)類化的完整的AES實(shí)現(xiàn)方案.包含128Bit 256 Bit.不同的加密強(qiáng)度的完整的AES算法.同時(shí)也是一個(gè)成型的程序.可以用來直接加密需要保護(hù)的文件.

一個(gè)類化的完整的AES實(shí)現(xiàn)方案.包含128Bit 256 Bit.不同的加密強(qiáng)度的完整的AES算法.同時(shí)也是一個(gè)成型的程序.可以用來直接加密需要保護(hù)的文件.

標(biāo)簽： AES Bit 128 256

上傳時(shí)間： 2017-03-01

上傳用戶：lxm
用VHDL 語言設(shè)計(jì)交通燈控制系統(tǒng), 并在MAX+PLUS II 系統(tǒng)對(duì)FPGA/ CPLD 芯片進(jìn)行下載, 由于生成的是集成化的數(shù)字電路, 沒有傳統(tǒng)設(shè)計(jì)中的接線問題, 所以故障率低、可靠性高,

用VHDL 語言設(shè)計(jì)交通燈控制系統(tǒng), 并在MAX+PLUS II 系統(tǒng)對(duì)FPGA/ CPLD 芯片進(jìn)行下載, 由于生成的是集成化的數(shù)字電路, 沒有傳統(tǒng)設(shè)計(jì)中的接線問題, 所以故障率低、可靠性高, 而且體積小。體現(xiàn)了EDA 技術(shù)在數(shù)字電路設(shè)計(jì)中的優(yōu)越性。

標(biāo)簽： VHDL FPGA CPLD PLUS

上傳時(shí)間： 2013-12-28

上傳用戶：zhengzg
這是一個(gè)向量量子化的程序

這是一個(gè)向量量子化的程序，且生成兩種運(yùn)行環(huán)境，Dos界面以及l(fā)inux環(huán)境。有三個(gè)文件，lvq.zip為源碼，Winlvq為Dos運(yùn)行界面，另外一個(gè)為linux運(yùn)行環(huán)境。

標(biāo)簽： 向量量子化程序

上傳時(shí)間： 2017-03-12

上傳用戶：shizhanincc

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