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文件解析

  • 探討PROE的配置文件——系統配置文件config.pro

    PROE的配置文件讓不少初學者感到煩惱,盡管不少教材里都會提到關于PROE的配置文件。但大多數顯得過于理論化,而不便于初學者理解,可操作性不強。本文力求以通俗的語言結合實際運用向大家介紹PROE的配置文件,希望能給各位帶來幫助。

    標簽: config PROE pro 系統配置

    上傳時間: 2013-11-03

    上傳用戶:lps11188

  • PCB被動組件的隱藏特性解析

    PCB 被動組件的隱藏特性解析 傳統上,EMC一直被視為「黑色魔術(black magic)」。其實,EMC是可以藉由數學公式來理解的。不過,縱使有數學分析方法可以利用,但那些數學方程式對實際的EMC電路設計而言,仍然太過復雜了。幸運的是,在大多數的實務工作中,工程師并不需要完全理解那些復雜的數學公式和存在于EMC規范中的學理依據,只要藉由簡單的數學模型,就能夠明白要如何達到EMC的要求。本文藉由簡單的數學公式和電磁理論,來說明在印刷電路板(PCB)上被動組件(passivecomponent)的隱藏行為和特性,這些都是工程師想讓所設計的電子產品通過EMC標準時,事先所必須具備的基本知識。導線和PCB走線導線(wire)、走線(trace)、固定架……等看似不起眼的組件,卻經常成為射頻能量的最佳發射器(亦即,EMI的來源)。每一種組件都具有電感,這包含硅芯片的焊線(bond wire)、以及電阻、電容、電感的接腳。每根導線或走線都包含有隱藏的寄生電容和電感。這些寄生性組件會影響導線的阻抗大小,而且對頻率很敏感。依據LC 的值(決定自共振頻率)和PCB走線的長度,在某組件和PCB走線之間,可以產生自共振(self-resonance),因此,形成一根有效率的輻射天線。在低頻時,導線大致上只具有電阻的特性。但在高頻時,導線就具有電感的特性。因為變成高頻后,會造成阻抗大小的變化,進而改變導線或PCB 走線與接地之間的EMC 設計,這時必需使用接地面(ground plane)和接地網格(ground grid)。導線和PCB 走線的最主要差別只在于,導線是圓形的,走線是長方形的。導線或走線的阻抗包含電阻R和感抗XL = 2πfL,在高頻時,此阻抗定義為Z = R + j XL j2πfL,沒有容抗Xc = 1/2πfC存在。頻率高于100 kHz以上時,感抗大于電阻,此時導線或走線不再是低電阻的連接線,而是電感。一般而言,在音頻以上工作的導線或走線應該視為電感,不能再看成電阻,而且可以是射頻天線。

    標簽: PCB 被動組件

    上傳時間: 2013-11-16

    上傳用戶:極客

  • 新代系統電控調試文件

    新代系統電控調試文件。

    標簽: 電控 調試

    上傳時間: 2013-11-15

    上傳用戶:1159797854

  • S7200脈沖數出MAP庫文件使用說明

    S7200脈沖數出MAP庫文件使用說明

    標簽: S7200 MAP 脈沖 庫文件

    上傳時間: 2014-01-23

    上傳用戶:chens000

  • Labview:字符串和文件I/O

    Labview:字符串和文件I/O

    標簽: Labview 字符串

    上傳時間: 2013-10-13

    上傳用戶:wmwai1314

  • LCF測量儀資料,HEX文件更新(V0.1)

    LCF測量儀資料,HEX文件更新(V0.1)

    標簽: LCF HEX 0.1 測量儀

    上傳時間: 2013-11-22

    上傳用戶:zhang_yi

  • 光敏電阻解析和典型應用

    光敏電阻,特性解析,典型應用

    標簽: 光敏電阻 典型

    上傳時間: 2013-11-08

    上傳用戶:yzhl1988

  • 基于VC++的DXF數據文件接口程序設計

    基于實際的雕刻控制平臺能有效地讀取CAD軟件設計圖形的數據參數的目的,采用了AutoCAD強大的繪圖功能與C語言強有力的計算、輸入和輸出等功能相結合的方法。通過研究分析AutoCAD的DXF文件數據格式及組成,結合C語言的文件管理功能,設計出了C語言與AutoCAD接口程序,并給出了具體的設計方法。通過自行開發軟件與AutoCAD之間建立數據通道,實現數據傳遞和共享(即對DXF中的實體(如直線、圓等)進行坐標提取)的實驗,證明了該方法的實用性和便利性。

    標簽: DXF VC 數據文件 接口

    上傳時間: 2013-11-02

    上傳用戶:pzw421125

  • USB轉串行口電路原理圖及PCB文件PL2303

    USB轉串行口電路原理圖及PCB文件PL2303 USB轉串行口電路原理圖及PCB文件PL2303 USB轉串行口電路原理圖及PCB文件PL2303

    標簽: 2303 USB PCB PL

    上傳時間: 2013-10-30

    上傳用戶:kernor

  • 如何仿真IP核(建立modelsim仿真庫完整解析)

      IP核生成文件:(Xilinx/Altera 同)   IP核生成器生成 ip 后有兩個文件對我們比較有用,假設生成了一個 asyn_fifo 的核,則asyn_fifo.veo 給出了例化該核方式(或者在 Edit-》Language Template-》COREGEN 中找到verilog/VHDL 的例化方式)。asyn_fifo.v 是該核的行為模型,主要調用了 xilinx 行為模型庫的模塊,仿真時該文件也要加入工程。(在 ISE中點中該核,在對應的 processes 窗口中運行“ View Verilog Functional Model ”即可查看該 .v 文件)。如下圖所示。

    標簽: modelsim 仿真 IP核 仿真庫

    上傳時間: 2013-11-02

    上傳用戶:誰偷了我的麥兜

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