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數(shù)據(jù)讀出

  • 低成本單進三出逆變器設(shè)計經(jīng)驗總結(jié)

    介紹了一款低成本單進三出逆變器的設(shè)計經(jīng)驗,硬件成本控制在60元人民幣以內(nèi)時,可驅(qū)動1 kW以下的三相籠式異步電機。總結(jié)了經(jīng)過近百多次的修改后得到的較為成熟的電路的設(shè)計要點,包括微處理器,功率器件,半橋驅(qū)動,過流保護,控制方法,試驗結(jié)果等方面的內(nèi)容。用該電路實現(xiàn)的變頻調(diào)速可以因低成本而大大擴展其應(yīng)用范圍,稍加修改后可用于直流無刷電機的驅(qū)動。

    標簽: 逆變器 設(shè)計經(jīng)驗

    上傳時間: 2013-11-04

    上傳用戶:alibabamama

  • 從PCB中畫出原理圖

    從PCB中畫出原理圖的方法

    標簽: PCB 原理圖

    上傳時間: 2013-11-21

    上傳用戶:南國時代

  • 跟我學數(shù)字電子技朮

    數(shù)字電子技朮

    標簽:

    上傳時間: 2013-10-09

    上傳用戶:1101055045

  • 創(chuàng)意激發(fā)與創(chuàng)新專題期末報告--能彈出插頭之延長線

    設(shè)計概念:拔起插頭總要費盡力氣才能拔起,且當延長線插卒插滿頭時時,想拔出其中一個,的確很不方便,電線容易受外力扯斷,所以想做出一個方便插拔的延長線。

    標簽: 創(chuàng)意 創(chuàng)新 報告 延長線

    上傳時間: 2013-10-10

    上傳用戶:hjshhyy

  • WP409利用Xilinx FPGA打造出高端比特精度和周期精度浮點DSP算法實現(xiàn)方案

    WP409利用Xilinx FPGA打造出高端比特精度和周期精度浮點DSP算法實現(xiàn)方案: High-Level Implementation of Bit- and Cycle-Accurate Floating-Point DSP Algorithms with Xilinx FPGAs

    標簽: Xilinx FPGA 409 DSP

    上傳時間: 2013-11-07

    上傳用戶:defghi010

  • 74HC595串入并出芯片應(yīng)用

    單片機C語言程序設(shè)計實訓-基于8051+Proteus仿真:74HC595串入并出芯片應(yīng)用。代碼齊全,可以舉一反三!

    標簽: Proteus 8051 595 74

    上傳時間: 2014-03-23

    上傳用戶:ukuk

  • WP409利用Xilinx FPGA打造出高端比特精度和周期精度浮點DSP算法實現(xiàn)方案

    WP409利用Xilinx FPGA打造出高端比特精度和周期精度浮點DSP算法實現(xiàn)方案: High-Level Implementation of Bit- and Cycle-Accurate Floating-Point DSP Algorithms with Xilinx FPGAs

    標簽: Xilinx FPGA 409 DSP

    上傳時間: 2013-10-21

    上傳用戶:huql11633

  • pcb layout design(臺灣硬件工程師15年經(jīng)驗

    PCB LAYOUT 術(shù)語解釋(TERMS)1. COMPONENT SIDE(零件面、正面)︰大多數(shù)零件放置之面。2. SOLDER SIDE(焊錫面、反面)。3. SOLDER MASK(止焊膜面)︰通常指Solder Mask Open 之意。4. TOP PAD︰在零件面上所設(shè)計之零件腳PAD,不管是否鑽孔、電鍍。5. BOTTOM PAD:在銲錫面上所設(shè)計之零件腳PAD,不管是否鑽孔、電鍍。6. POSITIVE LAYER:單、雙層板之各層線路;多層板之上、下兩層線路及內(nèi)層走線皆屬之。7. NEGATIVE LAYER:通常指多層板之電源層。8. INNER PAD:多層板之POSITIVE LAYER 內(nèi)層PAD。9. ANTI-PAD:多層板之NEGATIVE LAYER 上所使用之絕緣範圍,不與零件腳相接。10. THERMAL PAD:多層板內(nèi)NEGATIVE LAYER 上必須零件腳時所使用之PAD,一般稱為散熱孔或?qū)住?1. PAD (銲墊):除了SMD PAD 外,其他PAD 之TOP PAD、BOTTOM PAD 及INNER PAD 之形狀大小皆應(yīng)相同。12. Moat : 不同信號的 Power& GND plane 之間的分隔線13. Grid : 佈線時的走線格點2. Test Point : ATE 測試點供工廠ICT 測試治具使用ICT 測試點 LAYOUT 注意事項:PCB 的每條TRACE 都要有一個作為測試用之TEST PAD(測試點),其原則如下:1. 一般測試點大小均為30-35mil,元件分布較密時,測試點最小可至30mil.測試點與元件PAD 的距離最小為40mil。2. 測試點與測試點間的間距最小為50-75mil,一般使用75mil。密度高時可使用50mil,3. 測試點必須均勻分佈於PCB 上,避免測試時造成板面受力不均。4. 多層板必須透過貫穿孔(VIA)將測試點留於錫爐著錫面上(Solder Side)。5. 測試點必需放至於Bottom Layer6. 輸出test point report(.asc 檔案powerpcb v3.5)供廠商分析可測率7. 測試點設(shè)置處:Setup􀃆pads􀃆stacks

    標簽: layout design pcb 硬件工程師

    上傳時間: 2013-11-17

    上傳用戶:cjf0304

  • Allegro 16.3出GERBER步驟

    Allegro 16.3出GERBER步驟,比較詳細!!

    標簽: Allegro GERBER 16.3

    上傳時間: 2013-10-13

    上傳用戶:lchjng

  • 15入15出繼電器控制板

    15入15出繼電器控制板

    標簽: 繼電器 控制板

    上傳時間: 2013-10-17

    上傳用戶:ajaxmoon

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