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數字頻率合成器

基于可編程邏輯器件CPLD和直接數字頻率合成技術（DDS）的三相多波形函數發生器

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摘要：介紹了基于可編程邏輯器件CPLD和直接數字頻率合成技術（DDS）的三相多波形函數發生器的基本原理

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盡管頻率合成技術已經經歷了大半個世紀的發展史

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高分辨率合成孔徑雷達視頻模擬器FPGA實現技術研究

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頻率合成與鎖相技術-350頁-4.4M.pdf

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頻率合成-206頁-4.4M.pdf

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本系統基于直接數字頻率合成技術；以凌陽SPCE061A單片機為控制核心；采用寬帶運放AD811和AGC技術使得50Ω負載上峰值達到6V±1V；由模擬乘法器AD835產生調幅信號；由數控電位器程控調制度

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術是繼直接頻率合成和間接頻率合成之后

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術是繼直接頻率合成和間接頻率合成之后

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