一個可以計算分壓電路的源碼。 可透過輸出與輸入電壓，計算電阻的大小；或透過輸入電壓與電阻，計算最後輸出之電壓
標簽： 分
上傳時間： 2014-12-09
上傳用戶：hoperingcong
是一個用verilog寫成的加法器電路,可把七個元件加起來
標簽： verilog 加法器 元件
上傳時間： 2014-01-07
上傳用戶：zhangzhenyu
使用硬體描述語言HDL 設計硬體電路，臺灣人寫的PPT講義，非常不錯。VHDL硬件設計入門學習。VHDL基本語法架構，VHDL的零件庫(Library)及包裝(Package)等內容。
標簽： HDL
上傳時間： 2014-01-22
上傳用戶：cxl274287265
5 bits 的加法器與減法器合併電路之原始程式製作
標簽： bits 加法器 法器 程式
上傳時間： 2016-05-18
上傳用戶：ippler8
資料壓縮技術與應用-變動長度編碼壓縮及解壓縮(Run Length Encoding) 整數採用固定長度一個位元組表示法 對於只出現一次的位元組S亦用iS取代
標簽： Encoding Length Run 表示法
上傳時間： 2016-08-15
上傳用戶：GavinNeko
資料壓縮技術與應用-變動長度編碼壓縮(Run Length Encoding)~ 整數採用固定長度一個位元組表示法~ 對於只出現一次的位元組S亦用iS取代~
上傳用戶：asdfasdfd
verilog除頻器可用於編碼段運用可以穩定電路設計
標簽： verilog
上傳時間： 2013-12-26
上傳用戶：372825274
內含fulladder結構檔,電路檔,測試檔(testbench)以及執行檔(.do)
標簽： fulladder testbench do
上傳時間： 2016-11-25
上傳用戶：wxhwjf
S3C44B0-ARM應用板(電路+PCB+程序).rar
標簽： ARM PCB 44
上傳時間： 2013-12-27
上傳用戶：cuiyashuo
SONET 教學V1.0_方便使用者在學習射頻電路模擬上遇到的問題解決方式
標簽： SONET 1.0 模 方式
上傳時間： 2017-01-17
上傳用戶：hasan2015
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