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數(shù)字通信系統(tǒng)(tǒng)

  • matlab通信仿真psk誤碼分析

    MATLAB仿真通信PSK誤碼分析,主要用來測試SNR從0到10時(shí)的系統(tǒng)性能-MATLAB simulation PSK communication error analysis

    標(biāo)簽: matlab psk 通信 仿真

    上傳時(shí)間: 2013-04-24

    上傳用戶:924484786

  • 基于FPGA的JPEG編解碼芯片設(shè)計(jì)

    近年來,隨著微電子技術(shù)的高速發(fā)展,數(shù)字圖像壓縮編碼技術(shù)的逐漸成熟,實(shí)時(shí)圖象處理在多媒體、HDTV、圖像通信等領(lǐng)域有著越來越廣泛的應(yīng)用,圖像壓縮/解壓的IC芯片也已成為多媒體技術(shù)的核心,實(shí)現(xiàn)這些算法芯片的研究成為信息產(chǎn)業(yè)的新熱點(diǎn).該文基于FPGA設(shè)計(jì)了JPEG圖像壓縮編解碼芯片,通過改進(jìn)算法優(yōu)化結(jié)構(gòu),在合理地利用硬件資源的條件下,有效地挖掘出算法內(nèi)在的并行性.在JPEG編碼器設(shè)計(jì)中,改進(jìn)了JEONG的DCT變換算法,采用流水線優(yōu)化算法解決時(shí)間并行性問題,提高了DCT/IDCT模塊的運(yùn)算速度;設(shè)計(jì)了基于查找表結(jié)構(gòu)的定點(diǎn)乘法器,便于在設(shè)計(jì)中共享乘法單元,以適應(yīng)流水線設(shè)計(jì)的要求;依據(jù)Huffman編碼表的規(guī)律性,采用并行查找表結(jié)構(gòu),用較少的存儲單元完成Huffman編解碼的運(yùn)算,同時(shí)也提高了編解碼速度.在JPEG解碼器設(shè)計(jì)中,根據(jù)Huffman碼字本身的特點(diǎn)和JPEG標(biāo)準(zhǔn),設(shè)計(jì)了一種Huffman碼字分組結(jié)構(gòu),基于該結(jié)構(gòu)提出分組Huffman查找表及地址編碼的設(shè)計(jì)方法,進(jìn)而完成了新的快速Huffman解碼算法及其模塊設(shè)計(jì).整個(gè)設(shè)計(jì)及其各個(gè)模塊都在ALTERA公司的EDA工具QUARTUSII平臺上進(jìn)行了邏輯綜合及功能和時(shí)序仿真.綜合和仿真結(jié)果表明,基于FPGA的JPEG圖像編解碼芯片消耗很少的FPGA硬件資源,達(dá)到了較高的工作頻率,在速度和資源利用率方面均達(dá)到了較優(yōu)的狀態(tài),可滿足實(shí)時(shí)JPEG圖像編解碼的要求.在邏輯設(shè)計(jì)的基礎(chǔ)上,該設(shè)計(jì)可以進(jìn)一步作硬件仿真和實(shí)驗(yàn),將源代碼燒錄進(jìn)FPGA芯片,作為獨(dú)立器件或有自主知識產(chǎn)權(quán)的JPEG IP模塊,應(yīng)用于可視電話、手機(jī)和會議電視等低成本JPEG編解碼系統(tǒng)的實(shí)現(xiàn).

    標(biāo)簽: FPGA JPEG 編解碼 芯片設(shè)計(jì)

    上傳時(shí)間: 2013-05-31

    上傳用戶:yuying4000

  • 基于FPGA的列車擴(kuò)頻通信基帶處理器設(shè)計(jì)

      擴(kuò)展頻譜通信系統(tǒng)與常規(guī)的通信系統(tǒng)相比,具有很強(qiáng)的抗人為干擾、窄帶干擾、多徑干擾的能力。  本文介紹了擴(kuò)展頻譜通信的基本原理,對其數(shù)字實(shí)現(xiàn)方法進(jìn)行了深入分析和研究。詳細(xì)闡述了擴(kuò)頻理論基礎(chǔ)一香農(nóng)定理;建立了擴(kuò)頻通信系統(tǒng)的數(shù)學(xué)模型,并對其進(jìn)行了分析;在對偽隨機(jī)序列研究的基礎(chǔ)上,提出了應(yīng)用于本系統(tǒng)的m序列,并對其應(yīng)用特性進(jìn)行了研究;提出了中頻調(diào)制方案DQPSK,對其進(jìn)行了分析;深入研究了接收的同步問題—捕獲和跟蹤,并且在對數(shù)字匹配濾波器原理及其實(shí)現(xiàn)方法進(jìn)行深入研究的基礎(chǔ)上,提出基于數(shù)字匹配濾波器的捕獲和跟蹤方案;采用相關(guān)檢測的解擴(kuò)原理,完成了擴(kuò)頻數(shù)據(jù)的解擴(kuò)。 

    標(biāo)簽: FPGA 列車 擴(kuò)頻通信 基帶處理器

    上傳時(shí)間: 2013-07-12

    上傳用戶:lh25584

  • 基于FPGA的視頻編碼器設(shè)計(jì)

    ISO和ITU-T制定的一系列視頻編碼國際標(biāo)準(zhǔn)的推出,開創(chuàng)了視頻通信和存儲應(yīng)用的新紀(jì)元。從H.261視頻編碼建議,到H.262/3、MPEG-1/2/4等都有一個(gè)共同的不斷追求的目標(biāo),即在盡可能低的碼率(或存儲容量)下獲得盡可能好的圖像質(zhì)量。 本課題的研究建立在目前主流的壓縮算法的基礎(chǔ)上,綜合出各種標(biāo)準(zhǔn)中實(shí)現(xiàn)途徑的共性和優(yōu)勢,將算法的主體移植于FPGA(FieldProgrammableGateArray)平臺上。憑借該種類嵌入式系統(tǒng)配置靈活、資源豐富的特點(diǎn),建立一個(gè)可重構(gòu)的內(nèi)核處理模塊。進(jìn)一步的完善算法(運(yùn)算速度、精度)和外圍系統(tǒng)后,就可作為專用視頻壓縮編碼器進(jìn)行門級電路設(shè)計(jì)的原型,構(gòu)建一個(gè)片上可編程的獨(dú)立系統(tǒng)。 編碼器設(shè)計(jì)有良好的應(yīng)用前景,通過使用離散余弦變換和熵編碼,對運(yùn)動(dòng)圖像從空間上進(jìn)行壓縮編碼,使得編碼后的數(shù)據(jù)流適合于傳輸、通信、存儲和編輯等方面的要求。同時(shí),系統(tǒng)的設(shè)計(jì)將解碼的工作量大幅度降低,功能模塊在作適當(dāng)?shù)母膭?dòng)后可為解碼器的參考設(shè)計(jì)使用。 研究所涉及的各功能模塊都進(jìn)行了系統(tǒng)性的仿真和綜合,滿足工程樣機(jī)的前期研發(fā)需要。

    標(biāo)簽: FPGA 視頻編碼器

    上傳時(shí)間: 2013-04-24

    上傳用戶:xiangwuy

  • Turbo乘積碼的譯碼算法及FPGA實(shí)現(xiàn)

    在信道編碼的發(fā)展進(jìn)程中,編碼研究人員一直致力于追尋性能盡可能的接近Shannon極限,且譯碼復(fù)雜度較低的信道編碼方案。1993年Berrou等提出了Turbo碼,這種碼在接近香農(nóng)極限的低信噪比下仍能夠獲得較低的誤碼率,它的出現(xiàn)在編碼界引起了廣泛的關(guān)注,并成為編碼研究領(lǐng)域最新的發(fā)展方向之一。但Turbo碼也有其缺點(diǎn),由于交織器的存在,致使譯碼復(fù)雜度高,譯碼時(shí)延長且因?yàn)榈痛a重碼字,存在錯(cuò)誤平臺現(xiàn)象。在Turbo碼的基礎(chǔ)上,1994年,Pyndiah等提出了Turbo乘積碼,Turbo乘積碼繼承了Turbo碼的優(yōu)點(diǎn),又因?yàn)門urbo乘積碼的構(gòu)造采用了線性分組碼,所以譯碼方法比Turbo碼簡單。Turbo乘積碼近年來開始被廣泛到應(yīng)用到各種通信場合,大有取代傳統(tǒng)的卷積碼之勢。 本文首先圍繞Turbo乘積碼的編譯碼原理,闡述了涉及到的基礎(chǔ)知識;又據(jù)Turbo乘積碼目前的應(yīng)用狀況,回顧了Turbo碼的發(fā)展歷史;其次,根據(jù)Turbo乘積碼的構(gòu)造原理,探討了構(gòu)造的方法,交織類型,子碼的選擇及子碼的性能;再次,研究了Turbo乘積碼的概率譯碼,基于外信息的迭代算法,研究了Chase的譯碼算法;最后通過軟件仿真實(shí)現(xiàn)了該迭代譯碼算法,得到的結(jié)果達(dá)到了通信接收的要求。 本文還初步的闡述了Turbo乘積碼硬件實(shí)現(xiàn)系統(tǒng)的設(shè)計(jì)方案。據(jù)實(shí)際工作中碰到的非標(biāo)準(zhǔn)信號,給出了整體模塊設(shè)計(jì)圖,及相應(yīng)模塊的功能和模塊問連接的各種參數(shù)。并實(shí)現(xiàn)了模態(tài)下的同步搜索和去除相位模糊功能。最后根據(jù)研究中碰到的各種問題,提出了下一步工作建議和研究方向。

    標(biāo)簽: Turbo FPGA 乘積碼 譯碼算法

    上傳時(shí)間: 2013-07-02

    上傳用戶:ndyyliu

  • linux通信

    詳細(xì)講述了各種基于LINUX的通信實(shí)驗(yàn),包括GPRS,紅外線 ,藍(lán)牙 ,無線網(wǎng)絡(luò)等

    標(biāo)簽: linux 通信

    上傳時(shí)間: 2013-07-07

    上傳用戶:cuicuicui

  • 加密卡的研制與加密算法的FPGA實(shí)現(xiàn)

    隨著安全通信數(shù)據(jù)速率的提高,關(guān)鍵數(shù)據(jù)加密算法的軟件實(shí)施成為重要的系統(tǒng)瓶頸.基于FPGA的高度優(yōu)化的可編程的硬件安全性解決方案提供了并行處理能力,并且可以達(dá)到所要求的加密處理性能(每秒的SSL或RSA運(yùn)算次數(shù))基準(zhǔn).網(wǎng)絡(luò)的迅速發(fā)展,對安全性的需要變得越來越重要.然而,盡管網(wǎng)絡(luò)技術(shù)進(jìn)步很快,安全性問題仍然相對落后.由于FPGA所提供的設(shè)計(jì)優(yōu)勢,特別是新的高速版本,網(wǎng)絡(luò)系統(tǒng)設(shè)計(jì)人員可以在這些網(wǎng)絡(luò)設(shè)備中經(jīng)濟(jì)地實(shí)現(xiàn)安全性支持.FPGA是實(shí)現(xiàn)設(shè)計(jì)靈活性和功能升級的關(guān)鍵,對于容錯(cuò)、IPSec協(xié)議和系統(tǒng)接口問題而言這兩點(diǎn)非常重要.而且,FPGA還為網(wǎng)絡(luò)系統(tǒng)設(shè)計(jì)人員提供了適應(yīng)不同安全處理功能以及隨著安全技術(shù)的發(fā)展方便地增加對新技術(shù)支持的能力.標(biāo)準(zhǔn)加密/解決以及認(rèn)證算法,如RC-4、DES、三次DES、MD-5以及安全哈希算法-1(SHA-1)被廣泛用于全球網(wǎng)絡(luò)安全系統(tǒng)中.本文介紹了基于PCI總線的加密卡的研制,硬件板卡的結(jié)構(gòu),著重論述了加密卡上加密模塊的實(shí)現(xiàn),即用FPGA實(shí)現(xiàn)3DES及IDEA、MD5算法的過程,加密卡的工作原理,加密卡中多種密碼算法的配置原理,最后對3DES算法及IDEA、MD5算法的實(shí)現(xiàn)進(jìn)行仿真,并繪制了板卡的原理圖,對PCI接口原理進(jìn)行了闡述.在論文中,首先闡述了數(shù)據(jù)加密原理.介紹了數(shù)據(jù)加密的算法和數(shù)據(jù)加密的技術(shù)發(fā)展趨勢,并重點(diǎn)說明了3DES的算法.由于加密卡的生存空間在于其高速的加密性能與便捷的使用方式,所以,我們的加密卡采用的是基于PCI插槽的結(jié)構(gòu),遵從的是PCI2.2規(guī)范,理解并掌握PCI總線的規(guī)范是了解整個(gè)系統(tǒng)的重要一環(huán),本文講述了PCI總線的特點(diǎn)和性能,以及總線的信號.由于遵從高速性的要求,我們在硬件選型的時(shí)候,選用的是TI公司高速DSP T M S 3 2 0 C 5 4 x:T I公司新推出的T M S 3 2 0 C 6 x系列D S P功能強(qiáng),速度也非常快,但目前價(jià)格仍然太高,不適合一般加解密使用.而TMS3 2 0 C 5 4 x系列具有性能適中,價(jià)格低廉,產(chǎn)品成熟等特點(diǎn),是較好的選擇.FPGA選用的XILINX公司的XC2V3000,在隨后的文章中,我們將會對這些器件特性做相應(yīng)說明.并由此得出電路原理圖的繪制.文章的重點(diǎn)之一在于3DES算法及IDEA、MD5算法的FPGA實(shí)現(xiàn),以Xilinx公司VIRTEXII結(jié)構(gòu)的VXC2V3000為例,闡述用FPGA高速實(shí)現(xiàn)3DES算法及IDEA、MD5算法的設(shè)計(jì)要點(diǎn)及關(guān)鍵部分的設(shè)計(jì).

    標(biāo)簽: FPGA 加密卡 加密算法

    上傳時(shí)間: 2013-04-24

    上傳用戶:qazwsc

  • CPLD_FPGA的數(shù)字通信系統(tǒng)建模與設(shè)計(jì)

    《CPLD_FPGA的數(shù)字通信系統(tǒng)建模與設(shè)計(jì)》,運(yùn)用VHDL語言詳細(xì)介紹了數(shù)字通信系統(tǒng)的建模與設(shè)計(jì),如HDB3碼的編寫

    標(biāo)簽: CPLD_FPGA 數(shù)字通信 系統(tǒng)建模

    上傳時(shí)間: 2013-06-11

    上傳用戶:hwl453472107

  • 基于DSPFPGA的CAN總線數(shù)據(jù)通信系統(tǒng)

    CAN-bus(Corltroller Area Network)即控制器局域網(wǎng),是國際上應(yīng)用最廣泛的現(xiàn)場總線之一。它是一種多主方式的串行通訊總線,在工業(yè)控制通訊方面擁有高位速率,高抗電磁干擾性,而且能夠檢測出產(chǎn)生的任何錯(cuò)誤。作為一種靈活,可靠的通訊系統(tǒng),CAN總線已被廣泛運(yùn)用于各個(gè)工業(yè)控制現(xiàn)場。 基于FPGA+DSP的CAN總線通訊系統(tǒng)設(shè)計(jì)主要目標(biāo)是完成CAN總線的多節(jié)點(diǎn)可靠高速性傳輸,通過各節(jié)點(diǎn)之間的數(shù)據(jù)通信以及結(jié)點(diǎn)處理單元內(nèi)部對數(shù)據(jù)的處理實(shí)現(xiàn)整個(gè)通信系統(tǒng)間各個(gè)單元的協(xié)同工作。 本論文中的 CAN 總線通訊系統(tǒng)是完成紅外目標(biāo)探測系統(tǒng)和控制系統(tǒng)與圖像處理系統(tǒng)的實(shí)時(shí)通信,其硬件部分采用 DSP+FPGA 作為核心通訊處理單元,通過對 DSP硬件編程和FPGA邏輯模塊的設(shè)計(jì)實(shí)現(xiàn)了在處理單元外部CAN總線多節(jié)點(diǎn)之間的信息可靠性傳輸以及處理單元內(nèi)部DSP和FPGA基于SPI的串行通信,從而完成了在FPGA中對CAN總線數(shù)據(jù)的處理和運(yùn)用。

    標(biāo)簽: DSPFPGA CAN 總線 數(shù)據(jù)通信系統(tǒng)

    上傳時(shí)間: 2013-05-23

    上傳用戶:dyy618

  • 基于vc6.0串口通信動(dòng)態(tài)鏈接庫(DLL)的設(shè)計(jì)與應(yīng)用

    在比較常用串口通信實(shí)現(xiàn)形式的利弊基礎(chǔ)上,針對某廠輪胎里程試驗(yàn)機(jī)監(jiān)控系統(tǒng)的特點(diǎn),設(shè)計(jì)并實(shí)現(xiàn)了串口通信動(dòng)態(tài)鏈接庫(DLL),詳細(xì)介紹了多線程理論、重疊I/O方式,給出了程序流程圖,對一些關(guān)鍵代碼進(jìn)行了說明

    標(biāo)簽: 6.0 DLL vc 串口通信

    上傳時(shí)間: 2013-07-19

    上傳用戶:songnanhua

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