將windows font 轉(zhuǎn)點(diǎn)陣字型lcd 或鉅鎮(zhèn)字型 8051
標(biāo)簽： windows font 8051 lcd
上傳時(shí)間： 2014-01-25
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用VC編的數(shù)碼相機(jī)仿真程序 包括圖像的預(yù)處理 DCT變換 壓縮等 最后可用verify.exe做比較
上傳時(shí)間： 2014-01-16
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使用pic16f873晶片來設(shè)定adi的RGB轉(zhuǎn)HDMI的功能chip。最主要是裡面一些參數(shù)值的設(shè)定必須參考原廠的adi chip規(guī)格
上傳時(shí)間： 2016-07-17
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使用16f873來設(shè)定adi的HDMI轉(zhuǎn)RGB的chip設(shè)定參數(shù)值。
標(biāo)簽： 16f873 HDMI chip adi
上傳時(shí)間： 2013-12-17
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書名：《DSP芯片的原理與開發(fā)應(yīng)用（第2版）》 作者：張雄偉 曹鐵勇 頁數(shù)：306頁 開本：16開 字?jǐn)?shù)：480千字 出版日期：2000年9月 書號(hào)：7-5053-6127-9
上傳時(shí)間： 2013-12-26
上傳用戶：lizhizheng88
書名：《DSP芯片的原理與開發(fā)應(yīng)用（第2版）》 作者：張雄偉 曹鐵勇 頁數(shù)：306頁 開本：16開 字?jǐn)?shù)：480千字 出版日期：2000年9月 書號(hào)：7-5053-6127-9
上傳時(shí)間： 2016-12-18
上傳用戶：xuanjie
書名：《DSP芯片的原理與開發(fā)應(yīng)用（第2版）》 作者：張雄偉 曹鐵勇 頁數(shù)：306頁 開本：16開 字?jǐn)?shù)：480千字 出版日期：2000年9月 書號(hào)：7-5053-6127-9
上傳時(shí)間： 2014-01-22
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利用LTC2624 將數(shù)位信號(hào)轉(zhuǎn)類比信號(hào)
上傳時(shí)間： 2013-12-16
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狀態(tài)機(jī)控制AD轉(zhuǎn)換模塊 該模塊主要實(shí)現(xiàn)對(duì)MAX197的控制：根據(jù)設(shè)計(jì)需要對(duì)芯片進(jìn)行初始化（包括寫控制字選擇輸入電壓值范圍、選擇通道以及工作模式），并把通道數(shù)送指示燈顯示以及用鍵盤控制通道號(hào)（按一下，通道號(hào)加1，同時(shí)點(diǎn)亮相應(yīng)的指示燈，循環(huán)使用個(gè)通道）；控制狀態(tài)機(jī)的工作時(shí)序，并置兩次采集到的數(shù)據(jù)為12位數(shù)據(jù)輸出，并經(jīng)過鎖存進(jìn)程來鎖存數(shù)據(jù)，最后從鎖存器中把輸出數(shù)據(jù)
上傳時(shí)間： 2017-09-05
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近年來,隨著微電子技術(shù)的高速發(fā)展,數(shù)字圖像壓縮編碼技術(shù)的逐漸成熟,實(shí)時(shí)圖象處理在多媒體、HDTV、圖像通信等領(lǐng)域有著越來越廣泛的應(yīng)用,圖像壓縮/解壓的IC芯片也已成為多媒體技術(shù)的核心,實(shí)現(xiàn)這些算法芯片的研究成為信息產(chǎn)業(yè)的新熱點(diǎn).該文基于FPGA設(shè)計(jì)了JPEG圖像壓縮編解碼芯片,通過改進(jìn)算法優(yōu)化結(jié)構(gòu),在合理地利用硬件資源的條件下,有效地挖掘出算法內(nèi)在的并行性.在JPEG編碼器設(shè)計(jì)中,改進(jìn)了JEONG的DCT變換算法,采用流水線優(yōu)化算法解決時(shí)間并行性問題,提高了DCT/IDCT模塊的運(yùn)算速度;設(shè)計(jì)了基于查找表結(jié)構(gòu)的定點(diǎn)乘法器,便于在設(shè)計(jì)中共享乘法單元,以適應(yīng)流水線設(shè)計(jì)的要求;依據(jù)Huffman編碼表的規(guī)律性,采用并行查找表結(jié)構(gòu),用較少的存儲(chǔ)單元完成Huffman編解碼的運(yùn)算,同時(shí)也提高了編解碼速度.在JPEG解碼器設(shè)計(jì)中,根據(jù)Huffman碼字本身的特點(diǎn)和JPEG標(biāo)準(zhǔn),設(shè)計(jì)了一種Huffman碼字分組結(jié)構(gòu),基于該結(jié)構(gòu)提出分組Huffman查找表及地址編碼的設(shè)計(jì)方法,進(jìn)而完成了新的快速Huffman解碼算法及其模塊設(shè)計(jì).整個(gè)設(shè)計(jì)及其各個(gè)模塊都在ALTERA公司的EDA工具QUARTUSII平臺(tái)上進(jìn)行了邏輯綜合及功能和時(shí)序仿真.綜合和仿真結(jié)果表明,基于FPGA的JPEG圖像編解碼芯片消耗很少的FPGA硬件資源,達(dá)到了較高的工作頻率,在速度和資源利用率方面均達(dá)到了較優(yōu)的狀態(tài),可滿足實(shí)時(shí)JPEG圖像編解碼的要求.在邏輯設(shè)計(jì)的基礎(chǔ)上,該設(shè)計(jì)可以進(jìn)一步作硬件仿真和實(shí)驗(yàn),將源代碼燒錄進(jìn)FPGA芯片,作為獨(dú)立器件或有自主知識(shí)產(chǎn)權(quán)的JPEG IP模塊,應(yīng)用于可視電話、手機(jī)和會(huì)議電視等低成本JPEG編解碼系統(tǒng)的實(shí)現(xiàn).
標(biāo)簽： FPGA JPEG 編解碼 芯片設(shè)計(jì)
上傳時(shí)間： 2013-05-31
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