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數(shù)字萬年歷

  • 2012年物聯(lián)網(wǎng)行業(yè)風險分析及發(fā)展趨勢預測

    2012年物聯(lián)網(wǎng)行業(yè)風險分析及發(fā)展趨勢預測

    標簽: 2012 物聯(lián)網(wǎng) 發(fā)展 風險分析

    上傳時間: 2014-01-24

    上傳用戶:wivai

  • 周立功+我的25年嵌入式生涯(轉)

    周立功+我的25年嵌入式生涯(轉)

    標簽: 嵌入式

    上傳時間: 2013-11-05

    上傳用戶:zzbbqq99n

  • 2013年3月計算機二級考試c語言試題及答案

    2013年3月計算機二級考試c語言試題及答案

    標簽: 2013 計算機二級 c語言 試題

    上傳時間: 2013-10-26

    上傳用戶:xiaozhiqban

  • STM32神舟I號從入門到精通2012年3月版

    STM32神舟I號從入門到精通2012年3月版

    標簽: 2012 STM 32 神舟I號

    上傳時間: 2013-11-02

    上傳用戶:ABC677339

  • MC68HC11A0在熱印字機中的應用

    MC68HC11A0在熱印字機中的應用.pdf

    標簽: 11A MC 68 11

    上傳時間: 2013-10-11

    上傳用戶:Wwill

  • 10年經(jīng)驗教你如何學習嵌入式系統(tǒng)

    嵌入式系統(tǒng)學習,十年經(jīng)驗教你如何學習嵌入式系統(tǒng).

    標簽: 經(jīng)驗 學習嵌入式

    上傳時間: 2013-11-24

    上傳用戶:liuchee

  • 2012年無線電第1期

    電子發(fā)燒友為大家提供了2012年無線電第1期,歡迎廣大無線電愛好者下載學習

    標簽: 2012 無線

    上傳時間: 2013-11-18

    上傳用戶:lili123

  • 《FPGA應用開發(fā)入門與典型實例》華清遠見10年特獻版

    作者:華清遠見嵌入式學院。華清遠見10年特獻《FPGA應用開發(fā)入門與典型實例》

    標簽: FPGA 應用開發(fā) 典型

    上傳時間: 2013-12-25

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  • 臺灣硬件工程師15年layout資料

    臺灣硬件工程師15年layout資料

    標簽: layout 硬件工程師

    上傳時間: 2013-11-18

    上傳用戶:asasasas

  • pcb layout design(臺灣硬件工程師15年經(jīng)驗

    PCB LAYOUT 術語解釋(TERMS)1. COMPONENT SIDE(零件面、正面)︰大多數(shù)零件放置之面。2. SOLDER SIDE(焊錫面、反面)。3. SOLDER MASK(止焊膜面)︰通常指Solder Mask Open 之意。4. TOP PAD︰在零件面上所設計之零件腳PAD,不管是否鑽孔、電鍍。5. BOTTOM PAD:在銲錫面上所設計之零件腳PAD,不管是否鑽孔、電鍍。6. POSITIVE LAYER:單、雙層板之各層線路;多層板之上、下兩層線路及內(nèi)層走線皆屬之。7. NEGATIVE LAYER:通常指多層板之電源層。8. INNER PAD:多層板之POSITIVE LAYER 內(nèi)層PAD。9. ANTI-PAD:多層板之NEGATIVE LAYER 上所使用之絕緣範圍,不與零件腳相接。10. THERMAL PAD:多層板內(nèi)NEGATIVE LAYER 上必須零件腳時所使用之PAD,一般稱為散熱孔或導通孔。11. PAD (銲墊):除了SMD PAD 外,其他PAD 之TOP PAD、BOTTOM PAD 及INNER PAD 之形狀大小皆應相同。12. Moat : 不同信號的 Power& GND plane 之間的分隔線13. Grid : 佈線時的走線格點2. Test Point : ATE 測試點供工廠ICT 測試治具使用ICT 測試點 LAYOUT 注意事項:PCB 的每條TRACE 都要有一個作為測試用之TEST PAD(測試點),其原則如下:1. 一般測試點大小均為30-35mil,元件分布較密時,測試點最小可至30mil.測試點與元件PAD 的距離最小為40mil。2. 測試點與測試點間的間距最小為50-75mil,一般使用75mil。密度高時可使用50mil,3. 測試點必須均勻分佈於PCB 上,避免測試時造成板面受力不均。4. 多層板必須透過貫穿孔(VIA)將測試點留於錫爐著錫面上(Solder Side)。5. 測試點必需放至於Bottom Layer6. 輸出test point report(.asc 檔案powerpcb v3.5)供廠商分析可測率7. 測試點設置處:Setup􀃆pads􀃆stacks

    標簽: layout design pcb 硬件工程師

    上傳時間: 2013-11-17

    上傳用戶:cjf0304

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