設(shè)計(jì)一種基于GPRS 和51 單片機(jī)的彩信報(bào)警系統(tǒng)。利用單片機(jī)技術(shù)、帶彩信協(xié)議GPRS 無(wú)線通信模塊、圖像捕獲和圖像壓縮編碼功能模塊，實(shí)現(xiàn)原理圖設(shè)計(jì)到電路板設(shè)計(jì)開發(fā)。
標(biāo)簽： 彩信報(bào)警 系統(tǒng)方案
上傳時(shí)間： 2013-11-10
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555時(shí)基電路的分析和應(yīng)用
上傳時(shí)間： 2013-10-14
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555時(shí)基電路的分析和應(yīng)用
上傳時(shí)間： 2013-11-22
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中興通訊硬件一部巨作－信號(hào)完整性 近年來(lái)，通訊技術(shù)、計(jì)算機(jī)技術(shù)的發(fā)展越來(lái)越快，高速數(shù)字電路在設(shè)計(jì)中的運(yùn)用越來(lái) 越多，數(shù)字接入設(shè)備的交換能力已從百兆、千兆發(fā)展到幾十千兆。高速數(shù)字電路設(shè)計(jì)對(duì)信 號(hào)完整性技術(shù)的需求越來(lái)越迫切。 在中、 大規(guī)模電子系統(tǒng)的設(shè)計(jì)中， 系統(tǒng)地綜合運(yùn)用信號(hào)完整性技術(shù)可以帶來(lái)很多好處， 如縮短研發(fā)周期、降低產(chǎn)品成本、降低研發(fā)成本、提高產(chǎn)品性能、提高產(chǎn)品可靠性。 數(shù)字電路在具有邏輯電路功能的同時(shí)，也具有豐富的模擬特性，電路設(shè)計(jì)工程師需要 通過精確測(cè)定、或估算各種噪聲的幅度及其時(shí)域變化，將電路抗干擾能力精確分配給各種 噪聲，經(jīng)過精心設(shè)計(jì)和權(quán)衡，控制總噪聲不超過電路的抗干擾能力，保證產(chǎn)品性能的可靠 實(shí)現(xiàn)。 為了滿足中興上研一所的科研需要， 我們?cè)谌ツ旰徒衲觋P(guān)于信號(hào)完整性技術(shù)合作的基 礎(chǔ)上，克服時(shí)間緊、任務(wù)重的困難，編寫了這份硬件設(shè)計(jì)培訓(xùn)系列教材的“信號(hào)完整性” 部分。由于我們的經(jīng)驗(yàn)和知識(shí)所限，這部分教材肯定有不完善之處，歡迎廣大讀者和專家 批評(píng)指正。 本教材的對(duì)象是所內(nèi)硬件設(shè)計(jì)工程師， 針對(duì)我所的實(shí)際情況， 選編了第一章——導(dǎo)論、 第二章——數(shù)字電路工作原理、第三章——傳輸線理論、第四章——直流供電系統(tǒng)設(shè)計(jì)， 相信會(huì)給大家?guī)?lái)益處。同時(shí)，也希望通過我們的不懈努力能消除大家在信號(hào)完整性方面 的煩腦。 在編寫本教材的過程中，得到了沙國(guó)海、張亞東、沈煜、何廣敏、鐘建兔、劉輝、曹 俊等的指導(dǎo)和幫助，尤其在審稿時(shí)提出了很多建設(shè)性的意見，在此一并致謝！
標(biāo)簽： 中興通訊 硬件 信號(hào)完整性 基礎(chǔ)知識(shí)
上傳時(shí)間： 2013-11-03
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系統(tǒng)結(jié)構(gòu)如 圖 1所示 ， 從 系統(tǒng) 結(jié) 構(gòu)圖可 以看 出 ， 系統(tǒng)主要包括視頻信 號(hào)輸入模塊 ， 視頻信號(hào)處 理模 塊和視頻信號(hào)輸出模塊等 3個(gè)部分組成。各個(gè)模塊主要功能為： 視頻輸入模塊 將 采 集 的 多路 視 頻 信 號(hào) 轉(zhuǎn) 換成 數(shù) 字 信 號(hào) 送 到F P GA； 視頻處理模塊主要有F P GA 完成 ，根據(jù) 需要 對(duì)輸入 的數(shù)字視頻信號(hào)進(jìn)行處理 ； 視頻輸 出模塊將 F P GA處理后的信號(hào)轉(zhuǎn)換成模擬信號(hào)輸出到顯示器。
上傳時(shí)間： 2013-11-09
上傳用戶：xiaoyunyun
介紹了多入多出-正交頻分復(fù)用（MIMO-OFDM）系統(tǒng)，并分析了其發(fā)射機(jī)的實(shí)現(xiàn)原理。充分利用Altera公司Stratix系列現(xiàn)場(chǎng)可編程門陣列（FPGA）芯片和IP（知識(shí)產(chǎn)權(quán)）核，提出了一種切實(shí)可行的MIMO-OFDM基帶系統(tǒng)發(fā)射機(jī)的FPGA實(shí)現(xiàn)方法。重點(diǎn)論述了適合于FPGA實(shí)現(xiàn)的對(duì)角空時(shí)分層編碼（D-BLAST）的方法和實(shí)現(xiàn)原理以及各個(gè)主要模塊的工作原理。并給出了其在ModelSim環(huán)境下的仿真結(jié)果。結(jié)果表明，本設(shè)計(jì)具有設(shè)計(jì)簡(jiǎn)單、快速、高效和實(shí)時(shí)性好等特點(diǎn)。
標(biāo)簽： MIMO-OFDM FPGA 基帶系統(tǒng) 發(fā)射機(jī)
上傳時(shí)間： 2013-11-01
上傳用戶：wpt
《基于Xilinx FPGA的OFDM通信系統(tǒng)基帶設(shè)計(jì)》附帶的代碼
標(biāo)簽： Xilinx FPGA OFDM 通信系統(tǒng)
上傳時(shí)間： 2013-12-21
上傳用戶：王慶才
隨著SoC設(shè)計(jì)復(fù)雜度的提高，驗(yàn)證已成為集成電路設(shè)計(jì)過程中的瓶頸，而FPGA技術(shù)的快速發(fā)展以及良好的可編程特性使基于FPGA的原型驗(yàn)證越來(lái)越多地被用于SoC系統(tǒng)的設(shè)計(jì)過程。本文討論了GPS基帶的驗(yàn)證方案以及基于FPGA的設(shè)計(jì)實(shí)現(xiàn)，并對(duì)驗(yàn)證過程中的問題進(jìn)行了分析，并提出相應(yīng)的解決辦法。
上傳時(shí)間： 2014-08-04
上傳用戶：1184599859
設(shè)計(jì)工程師通常在FPGA上實(shí)現(xiàn)FIFO(先進(jìn)先出寄存器)的時(shí)候，都會(huì)使用由芯片提供商所提供的FIFO。但是，由于其通用性使得其針對(duì)性變差，某些情況下會(huì)變得不方便或者將增加硬件成本。此時(shí)，需要進(jìn)行自行FIFO設(shè)計(jì)。本文提供了一種基于信元的FIFO設(shè)計(jì)方法以供設(shè)計(jì)者在適當(dāng)?shù)臅r(shí)候選用。這種方法也適合于不定長(zhǎng)包的處理。
標(biāo)簽： FPGA FIFO 信元 設(shè)計(jì)方法
上傳時(shí)間： 2013-11-05
上傳用戶：ch3ch2oh
日本基恩士plc kv-1000編程學(xué)習(xí)。
上傳時(shí)間： 2013-11-06
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