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數(shù)字水印技術(shù)

  • LED數碼管字型生成器

    LED數碼管字型發生器,用了就知道,很好的。

    標簽: LED 數碼管 字型 生成器

    上傳時間: 2013-04-24

    上傳用戶:leesuper

  • fpga功能實現有限字長響應FIR

    fpga功能實現有限字長響應FIR,用verilog編寫

    標簽: fpga FIR 有限字長

    上傳時間: 2013-08-24

    上傳用戶:hz07104032

  • 數控振蕩器的頻率控制字寄存器、相位控制字寄存器、累加器和加法器可以用VHDL語言描述

    數控振蕩器的頻率控制字寄存器、相位控制字寄存器、累加器和加法器可以用VHDL語言描述,集成在一個模塊中,提供VHDL源程序供大家學習和討論。\r\n

    標簽: VHDL 寄存器 數控振蕩器 加法器

    上傳時間: 2013-09-04

    上傳用戶:a471778

  • 基于分塊的多尺度小波頻域數字水印

    數字水印是數字信息安全領域研究的一個熱點。小波變換算法以其多分辨率分析的特性在應用數學方面取得了一定的發展。文中結合小波算法,在數字圖像的低頻域中采用分塊方法來嵌入數字水印,改進了小波多尺度分解算法,通過實驗說明,該數字水印算法對數字水印的穩定性效果明顯

    標簽: 分塊 多尺度 頻域 數字水印

    上傳時間: 2013-11-08

    上傳用戶:199311

  • 一種新的自適應數字水印算法

    為了提高數字水印抗擊各種圖像攻擊的性能和保持圖像的穩健性和不可見性,提出了一種基于離散小波變換(DWT),SVD(singular value decomposition)奇異值分解水印圖像和原始載體圖像的離散余弦變換(DCT)的自適應水印嵌入算法,主要是將水印圖像的兩次小波變換后的低頻分量潛入到原始圖像分塊經過SVD分解的S分量矩陣中,同時根據圖像的JPEG壓縮比的不同計算各個圖像塊的水印調節因子。實驗證明該算法在抗擊JPEG壓縮、中值濾波、加噪等均具有很好的魯棒性,嵌入后的圖像的PSNR達到38,具有良好的視覺掩蔽性

    標簽: 數字水印算法

    上傳時間: 2013-10-09

    上傳用戶:ca05991270

  • 基于HVS的空域分塊數字水印技術

     數字水印作為一種防護技術,在數字產品的保護認證方面越發顯得重要,成為當前計算機領域研究的熱點問題之一。提出了一種在空域采用分塊重復嵌入水印信息和HVS相結合的水印技術。實驗結果說明,分塊技術在空域的使用提高了水印的嵌入強度和降低計算復雜度,該算法在抵抗旋轉、裁剪、縮放方面等有較強能力;水印算法與HVS技術的有效性相結合,數字水印具有很好的掩蔽性。

    標簽: HVS 分塊 數字水印技術

    上傳時間: 2013-10-23

    上傳用戶:qwerasdf

  • pcb layout design(臺灣硬件工程師15年經驗

    PCB LAYOUT 術語解釋(TERMS)1. COMPONENT SIDE(零件面、正面)︰大多數零件放置之面。2. SOLDER SIDE(焊錫面、反面)。3. SOLDER MASK(止焊膜面)︰通常指Solder Mask Open 之意。4. TOP PAD︰在零件面上所設計之零件腳PAD,不管是否鑽孔、電鍍。5. BOTTOM PAD:在銲錫面上所設計之零件腳PAD,不管是否鑽孔、電鍍。6. POSITIVE LAYER:單、雙層板之各層線路;多層板之上、下兩層線路及內層走線皆屬之。7. NEGATIVE LAYER:通常指多層板之電源層。8. INNER PAD:多層板之POSITIVE LAYER 內層PAD。9. ANTI-PAD:多層板之NEGATIVE LAYER 上所使用之絕緣範圍,不與零件腳相接。10. THERMAL PAD:多層板內NEGATIVE LAYER 上必須零件腳時所使用之PAD,一般稱為散熱孔或導通孔。11. PAD (銲墊):除了SMD PAD 外,其他PAD 之TOP PAD、BOTTOM PAD 及INNER PAD 之形狀大小皆應相同。12. Moat : 不同信號的 Power& GND plane 之間的分隔線13. Grid : 佈線時的走線格點2. Test Point : ATE 測試點供工廠ICT 測試治具使用ICT 測試點 LAYOUT 注意事項:PCB 的每條TRACE 都要有一個作為測試用之TEST PAD(測試點),其原則如下:1. 一般測試點大小均為30-35mil,元件分布較密時,測試點最小可至30mil.測試點與元件PAD 的距離最小為40mil。2. 測試點與測試點間的間距最小為50-75mil,一般使用75mil。密度高時可使用50mil,3. 測試點必須均勻分佈於PCB 上,避免測試時造成板面受力不均。4. 多層板必須透過貫穿孔(VIA)將測試點留於錫爐著錫面上(Solder Side)。5. 測試點必需放至於Bottom Layer6. 輸出test point report(.asc 檔案powerpcb v3.5)供廠商分析可測率7. 測試點設置處:Setup􀃆pads􀃆stacks

    標簽: layout design pcb 硬件工程師

    上傳時間: 2013-10-22

    上傳用戶:pei5

  • 準確的電源排序可防止系統受損

    諸如電信設備、存儲模塊、光學繫統、網絡設備、服務器和基站等許多復雜繫統都采用了 FPGA 和其他需要多個電壓軌的數字 IC,這些電壓軌必須以一個特定的順序進行啟動和停機操作,否則 IC 就會遭到損壞。

    標簽: 電源排序 防止

    上傳時間: 2014-12-24

    上傳用戶:packlj

  • 10A高性能負載點DCDC微型模塊

    電路板裝配、PCB 布局和數字 IC 集成的進步造就了新一代的高密度安裝、高性能繫統。

    標簽: DCDC 10A 性能 微型模塊

    上傳時間: 2013-10-17

    上傳用戶:RQB123

  • 基于單片機的門控系統硬件設計

    通過以SD02型熱釋電傳感器等器件組成的紅外感應模塊,將檢測到的人體信號傳送給以STC89C52單片機為核心的單片機模塊;單片機模塊根據設定程序檢測前級送入信號,并作出判斷輸出電信號控制后級驅動模塊;驅動模塊采用SH-215B高性能細分驅動器,其輸出控制電機運行。

    標簽: 單片機 門控系統 硬件設計

    上傳時間: 2013-11-04

    上傳用戶:文993

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