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數(shù)(shù)字信號(hào)處

  • HT46R47對(duì)AC過(guò)零信號(hào)進(jìn)行檢測(cè)

    HT46R47對(duì)AC過(guò)零信號(hào)進(jìn)行檢測(cè)

    標(biāo)簽: 46R R47 HT 46

    上傳時(shí)間: 2014-01-08

    上傳用戶:yph853211

  • HT45F23 OPA 功能

    HT45F23 MCU 含有兩個(gè)運(yùn)算放大器,OPA1 和OPA2,可用於用戶特定的模擬信號(hào)處理,通 過(guò)控制暫存器,OPA 相關(guān)的應(yīng)用可以很容易實(shí)現(xiàn)。本文主要介紹OPA 的操作,暫存器設(shè)定 以及基本OPA 應(yīng)用,例如:同相放大器、反相放大器和電壓跟隨器。 HT45F23 運(yùn)算放大器OPA1/OPA2 具有多個(gè)開關(guān),輸入路徑可選以及多種參考電壓選擇,此 外OPA2 內(nèi)部有8 種增益選項(xiàng),直接通過(guò)軟體設(shè)定。適應(yīng)於各種廣泛的應(yīng)用。

    標(biāo)簽: 45F F23 OPA HT

    上傳時(shí)間: 2013-11-21

    上傳用戶:immanuel2006

  • pcb layout design(臺(tái)灣硬件工程師15年經(jīng)驗(yàn)

    PCB LAYOUT 術(shù)語(yǔ)解釋(TERMS)1. COMPONENT SIDE(零件面、正面)︰大多數(shù)零件放置之面。2. SOLDER SIDE(焊錫面、反面)。3. SOLDER MASK(止焊膜面)︰通常指Solder Mask Open 之意。4. TOP PAD︰在零件面上所設(shè)計(jì)之零件腳PAD,不管是否鑽孔、電鍍。5. BOTTOM PAD:在銲錫面上所設(shè)計(jì)之零件腳PAD,不管是否鑽孔、電鍍。6. POSITIVE LAYER:?jiǎn)巍㈦p層板之各層線路;多層板之上、下兩層線路及內(nèi)層走線皆屬之。7. NEGATIVE LAYER:通常指多層板之電源層。8. INNER PAD:多層板之POSITIVE LAYER 內(nèi)層PAD。9. ANTI-PAD:多層板之NEGATIVE LAYER 上所使用之絕緣範(fàn)圍,不與零件腳相接。10. THERMAL PAD:多層板內(nèi)NEGATIVE LAYER 上必須零件腳時(shí)所使用之PAD,一般稱為散熱孔或?qū)住?1. PAD (銲墊):除了SMD PAD 外,其他PAD 之TOP PAD、BOTTOM PAD 及INNER PAD 之形狀大小皆應(yīng)相同。12. Moat : 不同信號(hào)的 Power& GND plane 之間的分隔線13. Grid : 佈線時(shí)的走線格點(diǎn)2. Test Point : ATE 測(cè)試點(diǎn)供工廠ICT 測(cè)試治具使用ICT 測(cè)試點(diǎn) LAYOUT 注意事項(xiàng):PCB 的每條TRACE 都要有一個(gè)作為測(cè)試用之TEST PAD(測(cè)試點(diǎn)),其原則如下:1. 一般測(cè)試點(diǎn)大小均為30-35mil,元件分布較密時(shí),測(cè)試點(diǎn)最小可至30mil.測(cè)試點(diǎn)與元件PAD 的距離最小為40mil。2. 測(cè)試點(diǎn)與測(cè)試點(diǎn)間的間距最小為50-75mil,一般使用75mil。密度高時(shí)可使用50mil,3. 測(cè)試點(diǎn)必須均勻分佈於PCB 上,避免測(cè)試時(shí)造成板面受力不均。4. 多層板必須透過(guò)貫穿孔(VIA)將測(cè)試點(diǎn)留於錫爐著錫面上(Solder Side)。5. 測(cè)試點(diǎn)必需放至於Bottom Layer6. 輸出test point report(.asc 檔案powerpcb v3.5)供廠商分析可測(cè)率7. 測(cè)試點(diǎn)設(shè)置處:Setup􀃆pads􀃆stacks

    標(biāo)簽: layout design pcb 硬件工程師

    上傳時(shí)間: 2013-10-22

    上傳用戶:pei5

  • pcb layout design(臺(tái)灣硬件工程師15年經(jīng)驗(yàn)

    PCB LAYOUT 術(shù)語(yǔ)解釋(TERMS)1. COMPONENT SIDE(零件面、正面)︰大多數(shù)零件放置之面。2. SOLDER SIDE(焊錫面、反面)。3. SOLDER MASK(止焊膜面)︰通常指Solder Mask Open 之意。4. TOP PAD︰在零件面上所設(shè)計(jì)之零件腳PAD,不管是否鑽孔、電鍍。5. BOTTOM PAD:在銲錫面上所設(shè)計(jì)之零件腳PAD,不管是否鑽孔、電鍍。6. POSITIVE LAYER:?jiǎn)巍㈦p層板之各層線路;多層板之上、下兩層線路及內(nèi)層走線皆屬之。7. NEGATIVE LAYER:通常指多層板之電源層。8. INNER PAD:多層板之POSITIVE LAYER 內(nèi)層PAD。9. ANTI-PAD:多層板之NEGATIVE LAYER 上所使用之絕緣範(fàn)圍,不與零件腳相接。10. THERMAL PAD:多層板內(nèi)NEGATIVE LAYER 上必須零件腳時(shí)所使用之PAD,一般稱為散熱孔或?qū)住?1. PAD (銲墊):除了SMD PAD 外,其他PAD 之TOP PAD、BOTTOM PAD 及INNER PAD 之形狀大小皆應(yīng)相同。12. Moat : 不同信號(hào)的 Power& GND plane 之間的分隔線13. Grid : 佈線時(shí)的走線格點(diǎn)2. Test Point : ATE 測(cè)試點(diǎn)供工廠ICT 測(cè)試治具使用ICT 測(cè)試點(diǎn) LAYOUT 注意事項(xiàng):PCB 的每條TRACE 都要有一個(gè)作為測(cè)試用之TEST PAD(測(cè)試點(diǎn)),其原則如下:1. 一般測(cè)試點(diǎn)大小均為30-35mil,元件分布較密時(shí),測(cè)試點(diǎn)最小可至30mil.測(cè)試點(diǎn)與元件PAD 的距離最小為40mil。2. 測(cè)試點(diǎn)與測(cè)試點(diǎn)間的間距最小為50-75mil,一般使用75mil。密度高時(shí)可使用50mil,3. 測(cè)試點(diǎn)必須均勻分佈於PCB 上,避免測(cè)試時(shí)造成板面受力不均。4. 多層板必須透過(guò)貫穿孔(VIA)將測(cè)試點(diǎn)留於錫爐著錫面上(Solder Side)。5. 測(cè)試點(diǎn)必需放至於Bottom Layer6. 輸出test point report(.asc 檔案powerpcb v3.5)供廠商分析可測(cè)率7. 測(cè)試點(diǎn)設(shè)置處:Setup􀃆pads􀃆stacks

    標(biāo)簽: layout design pcb 硬件工程師

    上傳時(shí)間: 2013-11-17

    上傳用戶:cjf0304

  • look1為電子看板的第二個(gè)芯片

    look1為電子看板的第二個(gè)芯片,使用自制的握手信號(hào)與look通訊,可以進(jìn)行數(shù)據(jù)傳送,以及控制16個(gè)數(shù)碼管顯示,此案例已成功用於生產(chǎn)現(xiàn)志,所用的元件很少,功能較大呢

    標(biāo)簽: look1 芯片

    上傳時(shí)間: 2017-01-02

    上傳用戶:han_zh

  • AVR ATmega48 SPI最簡(jiǎn)單測(cè)試碼! 透過(guò)spi_data[x]陣列寫入想要傳送的資料

    AVR ATmega48 SPI最簡(jiǎn)單測(cè)試碼! 透過(guò)spi_data[x]陣列寫入想要傳送的資料, 而x則是控制傳送第x筆數(shù),而接腳輸出則在PortB的預(yù)設(shè)接腳內(nèi),只要修改spi_data就可以透過(guò)示波器看到SPI的信號(hào)了!

    標(biāo)簽: spi_data ATmega AVR SPI

    上傳時(shí)間: 2014-06-09

    上傳用戶:jcljkh

  • 10Gbits GPON系統(tǒng)的完整,緊湊型APD偏置解決方案

    雪崩光電二極管 (APD) 接收器模塊在光纖通信繫統(tǒng)中被廣泛地使用。APD 模塊包含 APD 和一個(gè)信號(hào)調(diào)理放大器,但並不是完全獨(dú)立。它仍舊需要重要的支持電路,包括一個(gè)高電壓、低噪聲電源和一個(gè)用於指示信號(hào)強(qiáng)度的精準(zhǔn)電流監(jiān)視器

    標(biāo)簽: Gbits GPON APD 10

    上傳時(shí)間: 2013-11-22

    上傳用戶:zhangyigenius

  • 基于FPGA的視頻圖像畫面分割器的設(shè)計(jì)

      系統(tǒng)結(jié)構(gòu)如 圖 1所示 , 從 系統(tǒng) 結(jié) 構(gòu)圖可 以看 出 , 系統(tǒng)主要包括視頻信 號(hào)輸入模塊 , 視頻信號(hào)處 理模 塊和視頻信號(hào)輸出模塊等 3個(gè)部分組成。各個(gè)模塊主要功能為: 視頻輸入模塊 將 采 集 的 多路 視 頻 信 號(hào) 轉(zhuǎn) 換成 數(shù) 字 信 號(hào) 送 到F P GA; 視頻處理模塊主要有F P GA 完成 ,根據(jù) 需要 對(duì)輸入 的數(shù)字視頻信號(hào)進(jìn)行處理 ; 視頻輸 出模塊將 F P GA處理后的信號(hào)轉(zhuǎn)換成模擬信號(hào)輸出到顯示器。

    標(biāo)簽: FPGA 視頻圖像 畫面分割器

    上傳時(shí)間: 2013-11-11

    上傳用戶:shawvi

  • 基于FPGA的視頻圖像畫面分割器的設(shè)計(jì)

      系統(tǒng)結(jié)構(gòu)如 圖 1所示 , 從 系統(tǒng) 結(jié) 構(gòu)圖可 以看 出 , 系統(tǒng)主要包括視頻信 號(hào)輸入模塊 , 視頻信號(hào)處 理模 塊和視頻信號(hào)輸出模塊等 3個(gè)部分組成。各個(gè)模塊主要功能為: 視頻輸入模塊 將 采 集 的 多路 視 頻 信 號(hào) 轉(zhuǎn) 換成 數(shù) 字 信 號(hào) 送 到F P GA; 視頻處理模塊主要有F P GA 完成 ,根據(jù) 需要 對(duì)輸入 的數(shù)字視頻信號(hào)進(jìn)行處理 ; 視頻輸 出模塊將 F P GA處理后的信號(hào)轉(zhuǎn)換成模擬信號(hào)輸出到顯示器。

    標(biāo)簽: FPGA 視頻圖像 畫面分割器

    上傳時(shí)間: 2013-11-09

    上傳用戶:xiaoyunyun

  • Verilog HDL的程式

    Verilog HDL的程式,上網(wǎng)找到SPI程式, vspi.v這程式相當(dāng)好用可用來(lái)接收與傳送SPI,並且寫了一個(gè)傳輸信號(hào)測(cè)試,spidatasent.v這程式就是傳送的資料,分別為00 66... 01 77...... 02 55這樣的資料,並透過(guò)MAX+PULS II軟體進(jìn)行模擬,而最外層的程式是test_createspi.v!

    標(biāo)簽: Verilog HDL 程式

    上傳時(shí)間: 2017-03-06

    上傳用戶:onewq

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