PWM(脈沖寬度調(diào)制)是一種利用數(shù)字信號(hào)來控制模擬電路的控制技術(shù)，廣泛應(yīng)用于電源、電機(jī)、伺服系統(tǒng)、通信系統(tǒng)、電子控制器、功率控制等電力電子設(shè)備。PWM技術(shù)在逆變電路中的應(yīng)用最為廣泛，也是變頻技術(shù)的核心，同時(shí)在機(jī)床，液壓位置控制系統(tǒng)等機(jī)械裝置中也發(fā)揮著重要的作用。PWM技術(shù)已經(jīng)成為控制領(lǐng)域的一個(gè)熱點(diǎn)，因此研究PWM發(fā)生器對(duì)于基礎(chǔ)理論的發(fā)展和技術(shù)的改進(jìn)都有十分重要的意義。 論文研究的主要內(nèi)容是用任意波形作為調(diào)制信號(hào)通過特定的方法來產(chǎn)生所需要的PWM波形，任意波形的合成和PWM波形的生成是兩個(gè)主要任務(wù)。任意波形的合成是課題設(shè)計(jì)的一個(gè)難點(diǎn)，也是影響系統(tǒng)性能的關(guān)鍵因素之一。論文中波形合成采用直接數(shù)字頻率合成(DDS)技術(shù)來實(shí)現(xiàn)。DDS技術(shù)以相位為地址，通過查找離散幅度數(shù)據(jù)進(jìn)行波形合成，具有輸出波形相位變化連續(xù)、分辨率高、頻率轉(zhuǎn)換速率快的優(yōu)點(diǎn)，而且通過設(shè)置控制字可靈活方便地改變輸出頻率，是目前波形合成的主流方法。 實(shí)現(xiàn)PWM發(fā)生器的設(shè)計(jì)方法有多種。在綜合比較了單片機(jī)、DSP、ARM等常用開發(fā)工具特點(diǎn)的基礎(chǔ)上，本文提出了一種以可編程邏輯器件(PLD)為主體，單片機(jī)輔助配合的設(shè)計(jì)方法。隨著計(jì)算機(jī)技術(shù)和微電了技術(shù)的迅速發(fā)展，可編程邏輯器件的集成度和容量越來越大，基于PLD的設(shè)計(jì)方法正逐步成為一種主流于段，是近些年來電子系統(tǒng)設(shè)計(jì)的一個(gè)熱點(diǎn)。整個(gè)系統(tǒng)分為模擬波形產(chǎn)生、單片機(jī)控制電路、FPGA內(nèi)部功能模塊三大部分。FPGA部分的設(shè)計(jì)是以Altera公司的Quartus Ⅱ軟件為開發(fā)平臺(tái)，采用VHDL語(yǔ)言為主要輸入手段來完成內(nèi)部各功能模塊的設(shè)計(jì)輸入、編譯、仿真等調(diào)試工作，目標(biāo)載體選用性價(jià)比比較高的Altera公司的CycloneⅡ系列的器件；單片機(jī)控制電路主要負(fù)責(zé)控制字的設(shè)置和顯示，波形數(shù)據(jù)的接受與發(fā)送；用MATLAB軟件完成仟意波形的繪制和模擬任務(wù)。 論文共分五章，詳細(xì)介紹了課題的背景、PWM發(fā)生器的發(fā)展和應(yīng)用以及選題的目的和意義等，論述了系統(tǒng)設(shè)計(jì)方案的可行性，對(duì)外圍電路和FPAG內(nèi)部功能模塊的設(shè)計(jì)方法進(jìn)行了具體說明，并對(duì)仿真結(jié)果、系統(tǒng)的性能、存在的問題和改進(jìn)方法等進(jìn)行了分析和闡述。整個(gè)設(shè)計(jì)滿足PWM發(fā)生器的任務(wù)和功能要求，設(shè)計(jì)方法可行。
上傳時(shí)間： 2013-04-24
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PWM(脈沖寬度調(diào)制)是一種利用數(shù)字信號(hào)來控制模擬電路的控制技術(shù)，廣泛應(yīng)用于電源、電機(jī)、伺服系統(tǒng)、通信系統(tǒng)、電子控制器、功率控制等電力電子設(shè)備。PWM技術(shù)在逆變電路中的應(yīng)用最為廣泛，也是變頻技術(shù)的核心，同時(shí)在機(jī)床，液壓位置控制系統(tǒng)等機(jī)械裝置中也發(fā)揮著重要的作用。PWM技術(shù)已經(jīng)成為控制領(lǐng)域的一個(gè)熱點(diǎn)，因此研究PWM發(fā)生器對(duì)于基礎(chǔ)理論的發(fā)展和技術(shù)的改進(jìn)都有十分重要的意義。 論文研究的主要內(nèi)容是用任意波形作為調(diào)制信號(hào)通過特定的方法來產(chǎn)生所需要的PWM波形，任意波形的合成和PWM波形的生成是兩個(gè)主要任務(wù)。任意波形的合成是課題設(shè)計(jì)的一個(gè)難點(diǎn)，也是影響系統(tǒng)性能的關(guān)鍵因素之一。論文中波形合成采用直接數(shù)字頻率合成(DDS)技術(shù)來實(shí)現(xiàn)。DDS技術(shù)以相位為地址，通過查找離散幅度數(shù)據(jù)進(jìn)行波形合成，具有輸出波形相位變化連續(xù)、分辨率高、頻率轉(zhuǎn)換速率快的優(yōu)點(diǎn)，而且通過設(shè)置控制字可靈活方便地改變輸出頻率，是目前波形合成的主流方法。 實(shí)現(xiàn)PWM發(fā)生器的設(shè)計(jì)方法有多種。在綜合比較了單片機(jī)、DSP、ARM等常用開發(fā)工具特點(diǎn)的基礎(chǔ)上，本文提出了一種以可編程邏輯器件(PLD)為主體，單片機(jī)輔助配合的設(shè)計(jì)方法。隨著計(jì)算機(jī)技術(shù)和微電了技術(shù)的迅速發(fā)展，可編程邏輯器件的集成度和容量越來越大，基于PLD的設(shè)計(jì)方法正逐步成為一種主流于段，是近些年來電子系統(tǒng)設(shè)計(jì)的一個(gè)熱點(diǎn)。整個(gè)系統(tǒng)分為模擬波形產(chǎn)生、單片機(jī)控制電路、FPGA內(nèi)部功能模塊三大部分。FPGA部分的設(shè)計(jì)是以Altera公司的Quartus Ⅱ軟件為開發(fā)平臺(tái)，采用VHDL語(yǔ)言為主要輸入手段來完成內(nèi)部各功能模塊的設(shè)計(jì)輸入、編譯、仿真等調(diào)試工作，目標(biāo)載體選用性價(jià)比比較高的Altera公司的CycloneⅡ系列的器件；單片機(jī)控制電路主要負(fù)責(zé)控制字的設(shè)置和顯示，波形數(shù)據(jù)的接受與發(fā)送；用MATLAB軟件完成仟意波形的繪制和模擬任務(wù)。 論文共分五章，詳細(xì)介紹了課題的背景、PWM發(fā)生器的發(fā)展和應(yīng)用以及選題的目的和意義等，論述了系統(tǒng)設(shè)計(jì)方案的可行性，對(duì)外圍電路和FPAG內(nèi)部功能模塊的設(shè)計(jì)方法進(jìn)行了具體說明，并對(duì)仿真結(jié)果、系統(tǒng)的性能、存在的問題和改進(jìn)方法等進(jìn)行了分析和闡述。整個(gè)設(shè)計(jì)滿足PWM發(fā)生器的任務(wù)和功能要求，設(shè)計(jì)方法可行。
上傳時(shí)間： 2013-06-03
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本章將介紹Windows CE 的儲(chǔ)存管理。我們將本章內(nèi)容分為兩大部分，前半部會(huì)依序介紹 Windows CE的檔案系統(tǒng)類型、 Windows CE儲(chǔ)存管理結(jié)構(gòu)和每一個(gè)層次、以及如何自行開發(fā)檔案系統(tǒng)並載入之，後半部則以Ramdisk上的檔案系統(tǒng)為例，實(shí)際分析儲(chǔ)存管理相關(guān)的原始程式碼與資料型態(tài)。
上傳時(shí)間： 2015-07-01
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使用md5校驗(yàn)和算法保護(hù)文件 通俗的說，就是為保證數(shù)據(jù)的完整性，用一種指定的算法對(duì)原始數(shù)據(jù)計(jì)算出的一個(gè)校驗(yàn)值。接收方用同樣的算法計(jì)算一次校驗(yàn)值，如果和隨數(shù)據(jù)提供的校驗(yàn)值一樣，就說明數(shù)據(jù)是完整的。
上傳時(shí)間： 2015-11-21
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struts源代碼，手把手教你struts開發(fā)步驟 讓你成爲(wèi)真正的struts開發(fā)高手，包括一個(gè)真實(shí)的案例開發(fā)。
標(biāo)簽： struts
上傳時(shí)間： 2014-12-07
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eeprom of pic18 的書籍源碼範(fàn)例程式，運(yùn)行於APP001實(shí)驗(yàn)板上的C source code
上傳時(shí)間： 2014-01-03
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工程機(jī)器人自主作業(yè)控制程序，內(nèi)含有數(shù)據(jù)采集，通信以及PID運(yùn)算等代碼。
上傳時(shí)間： 2013-12-23
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簡(jiǎn)單命令使用grep等的使用 [zorro@isch ~]$ history 1 ifconfig 2 su 3 exit 4 ls 5 cd Desktop/ 6 ls 7 tar zxcf VMwareTools-8.4.5-324285.tar.gz 8 tar zxvf VMwareTools-8.4.5-324285.tar.gz 9 cd vmware-tools-distrib/ 10 ls 11 ./vmware-install.pl 12 su 13 ls 14 cd .. 15 ls 16 rm VMwareTools-8.4.5-324285.tar.gz 17 rm -r vmware-tools-distrib 18 ls 19 make 20 ls 21 cd redis/ 22 quit 23 ls 24 ca redis/ 25 cd redis/ 26 cd redis-2.8.17 27 make 28 cd redis-2.8.17 29 ls 30 cd redis-2.8.17 31 cd str 32 cd src 33 ls 34 ./redis-cli 35 ls 36 cd redis-2.8.17 tar.gz 37 make 38 cd src 39 ./redis-server .. /redis.conf 40 ./redis-cli 41 ./redis-server ../redis.conf 42 vi test1.sh 43 ./test1.sh 44 vi test.sh 45 ./test.sh 46 ls 47 chmod 777 test.sh 48 ./test.sh 49 vi express 50 $ grep –n ‘the’ express 51 clear 52 grep -n 'the' express 53 vi express 54 grep -n 'the' express 55 grep -vn 'the'express 56 grep -vn 'the' express 57 grep -in 'the' express 58 vi test2.c 59 grep -l 'the' *.c 60 grep -n 't[ae]st' express 61 grep -n 'oo' express 62 grep -n '[^g]oo' express 63 grep -n '[a^z]oo' express 64 grep -n '[0^9]' express 65 grep -n '^the' express 66 vi express 67 sed -e 'd' express 68 sed -e '1d' express 69 sed -e '1~7d' express 70 sed -e '$d' express 71 sed -e '1，/^$/d' express 72 ls 73 cd 74 pwd 75 history [zorro@isch ~]$
標(biāo)簽： 簡(jiǎn)單命令使用
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電子書-FPGA與Matlab聯(lián)合實(shí)戰(zhàn)V1.0 127頁(yè)前言 作為網(wǎng)絡(luò)上第一個(gè)開源此技術(shù)，筆者迫不及待地想將此技術(shù)分享出來。筆者從 2011 年 接觸 FPGA 以來，從各個(gè)方面使用 FPGA，無論是控制、圖像視頻、IC 前端驗(yàn)證、仿真測(cè)試， 各個(gè)部分都有所觸及，2015 年第一次接觸到 FPGA 與 matlab 的硬件在環(huán)實(shí)時(shí)仿真，就對(duì)感 受到技術(shù)的強(qiáng)大，雖然這里面還有很到的問題，但是作為最強(qiáng)大的仿真驗(yàn)證工具 Matlab 與 最強(qiáng)大的可編程器件的結(jié)合，做仿真測(cè)試很方便的，可直接通過 matlab 產(chǎn)生測(cè)試信號(hào)或者 通過 matlab 接收分析 FPGA 處理完成后的信號(hào)。 如今 FPGA 開發(fā)過程勢(shì)必要涉及到一個(gè)過程：驗(yàn)證仿真，驗(yàn)證很多情況下是在 Matlab 上進(jìn)行的，而仿真大部分初學(xué)者都是采用 Modelsim 仿真軟件進(jìn)行。比如設(shè)計(jì)一個(gè)信號(hào)濾波 模塊，驗(yàn)證該濾波模塊是在 Matlab 上進(jìn)行設(shè)計(jì)驗(yàn)證，得到該模塊的設(shè)計(jì)參數(shù)和設(shè)計(jì)結(jié)構(gòu)， 然后再轉(zhuǎn)換為 RTL 代碼，再用 Modelsim 軟件進(jìn)行仿真，這個(gè)過程涉及到采用 matlab 軟件產(chǎn) 生待測(cè)試的信號(hào)，輸入到 RTL 代碼中，然后在通過 Modelsim 軟件進(jìn)行仿真得到處理后的信 號(hào)，再將該信號(hào)輸出到文件，最后通過 Matlab 軟件分析處理后的
上傳時(shí)間： 2021-10-23
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用msp430實(shí)現(xiàn)數(shù)字,語(yǔ)音錄音的功能,免去 錄音帶的源碼.
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