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擾碼多項式

PROTUES中簡單圖片顯示,請多提意見.謝謝!

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標(biāo)簽： PROTUES

上傳時間： 2013-08-20

上傳用戶：wawjj
多路18b20測溫顯示系統(tǒng),可同時測量n個第三18b20

多路18b20測溫顯示系統(tǒng),可同時測量n個第三18b20

標(biāo)簽： 18b20 多路測溫顯示系統(tǒng)

上傳時間： 2013-08-21

上傳用戶：zhangchu0807
關(guān)于FPGA的設(shè)計方面的諸多經(jīng)驗總結(jié)

關(guān)于FPGA的設(shè)計方面的諸多經(jīng)驗總結(jié)，討論了設(shè)計方面應(yīng)該注意的問題。

標(biāo)簽： FPGA 方面經(jīng)驗

上傳時間： 2013-08-21

上傳用戶：onewq
多個Verilog和vhdl程序例子

多個Verilog和vhdl程序例子，可以作為初學(xué)者參考實例，按照電路結(jié)構(gòu)寫出HDL代碼

標(biāo)簽： Verilog vhdl 程序

上傳時間： 2013-08-26

上傳用戶：athjac
一種基于CPLD和多處理器結(jié)構(gòu)的控制網(wǎng)絡(luò)節(jié)點(diǎn)設(shè)計方案

節(jié)點(diǎn)是網(wǎng)絡(luò)系統(tǒng)的基本控制單元，論文提出了一種基于CPLD和多處理器結(jié)構(gòu)的控制網(wǎng)絡(luò)節(jié)點(diǎn)設(shè)計方案，它能夠提高單節(jié)點(diǎn)并行處理能力，其模塊化結(jié)構(gòu)增強(qiáng)了節(jié)點(diǎn)的可靠性。

標(biāo)簽： CPLD 多處理器控制網(wǎng)絡(luò) 節(jié)點(diǎn)設(shè)計

上傳時間： 2013-08-31

上傳用戶：shanxiliuxu
基于CPLD的多功能信號發(fā)生器設(shè)計

基于CPLD的多功能信號發(fā)生器設(shè)計.PDF

標(biāo)簽： CPLD 多功能信號發(fā)生器

上傳時間： 2013-09-02

上傳用戶：lnnn30
大型設(shè)計中FPGA的多時鐘設(shè)計策略,很詳細(xì)的描述了在FPGA設(shè)計中時鐘設(shè)計的方法

大型設(shè)計中FPGA的多時鐘設(shè)計策略,很詳細(xì)的描述了在FPGA設(shè)計中時鐘設(shè)計的方法

標(biāo)簽： FPGA 大型多時鐘策略

上傳時間： 2013-09-04

上傳用戶：妄想演繹師
計PLD/FPGA時通常采用幾種時鐘類型

無淪是用離散邏輯、可編程邏輯，還是用全定制硅器件實現(xiàn)的任何數(shù)字設(shè)計，為了成功地操\r\n作，可靠的時鐘是非常關(guān)鍵的。設(shè)計不良的時鐘在極限的溫度、電壓或制造工藝的偏差情況下將\r\n導(dǎo)致錯誤的行為，并且調(diào)試?yán)щy、花銷很大。在設(shè)計PLD/FPGA時通常采用幾種時鐘類型。時鐘可\r\n分為如下四種類型：全局時鐘、門控時鐘、多級邏輯時鐘和波動式時鐘。多時鐘系統(tǒng)能夠包括上\r\n述四種時鐘類型的任意組合。

標(biāo)簽： FPGA PLD 時鐘

上傳時間： 2013-09-04

上傳用戶：yelong0614
protel 常用封裝內(nèi)有200多個常用元件

protel 常用封裝內(nèi)有200多個常用原件。

標(biāo)簽： protel 200 封裝元件

上傳時間： 2013-09-11

上傳用戶：toyoad
游戲貪吃蛇基于UCOSII多任務(wù) 液晶 proteus仿真.

游戲貪吃蛇基于UCOSII多任務(wù) 液晶 proteus仿真.

標(biāo)簽： proteus UCOSII 貪吃蛇多任務(wù)

上傳時間： 2013-09-30

上傳用戶：icarus

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