基于RS-485的多點數(shù)據(jù)采集與顯示系統(tǒng)。
上傳時間： 2013-05-24
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在團(tuán)簇與激光相互作用的研究中和在團(tuán)簇與加速器離子束的碰撞研究中，需要對加速器束流或者激光束進(jìn)行脈沖化與時序同步，同時用于測量作用產(chǎn)物的探測系統(tǒng)如飛行時間譜儀(TOF)等要求各加速電場的控制具有一定的時序匹配。在整個實驗中，需要用到符合要求的多路脈沖時序信號控制器，而且要求各脈沖序列的周期、占空比、重復(fù)頻率等方便可調(diào)。為此，本論文基于FPGA設(shè)計完成了一款多路脈沖時序控制電路。 本文基于Altera公司的Cyclone系列FPGA芯片EPlC3T100C8，設(shè)計出了一款可以同時輸出8路脈沖序列、各脈沖序列之間具有可調(diào)高精度延遲、可調(diào)脈沖寬度及占空比等。論文討論了FPGA芯片結(jié)構(gòu)及開發(fā)流程，著重討論了較高頻率脈沖電路的可編程實現(xiàn)方法，以及如何利用VHDL語言實現(xiàn)硬件電路軟件化設(shè)計的技巧與方法，給出了整個系統(tǒng)設(shè)計的原理與實現(xiàn)。討論了高精密電源的PWM技術(shù)原理及實現(xiàn)，并由此設(shè)計了FPGA所需電源系統(tǒng)。給出了配置電路設(shè)計、數(shù)據(jù)通信及接口電路的實現(xiàn)。開發(fā)了上層控制軟件來控制各路脈沖時序及屬性。 該電路工作頻率200MHz，輸出脈沖最小寬度可達(dá)到10ns，最大寬度可達(dá)到us甚至ms量級。可以同時提供l路同步脈沖和7路脈沖，并且7路脈沖相對于同步脈沖的延遲時間可調(diào)，調(diào)節(jié)步長為5ns。
上傳時間： 2013-06-15
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反激式開關(guān)電源變壓器的設(shè)計反激式變壓器是反激開關(guān)電源的核心，它決定了反激變換器一系列的重要參數(shù)，如占空比D，最大峰值電流，設(shè)計反激式變壓器，就是要讓反激式開關(guān)
標(biāo)簽： 反激式開關(guān) 電源變壓器
上傳時間： 2013-04-24
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本文研制了一套基于數(shù)碼相機的圖像采集系統(tǒng)，用于拍攝作物葉片。該系統(tǒng)采用漫反射式的多光源正面照明設(shè)計方案，具有實時、高效、可控的特點。研究通過正交試驗對照明系統(tǒng)參數(shù)進(jìn)行優(yōu)化，運用matlab 對
標(biāo)簽： 圖像采集系統(tǒng)
上傳時間： 2013-07-30
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多功能EDA仿真/教學(xué)實驗系統(tǒng)產(chǎn)品簡介北京普立華電子科技有限公司研發(fā)部提供核心模塊-單片機系統(tǒng)核心模塊－CPLD核心模塊－FP
標(biāo)簽： EDA 多功能 仿真 教學(xué)實驗系統(tǒng)
上傳時間： 2013-05-26
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SmartSOPC 多功能教學(xué)實驗開發(fā)平臺――產(chǎn)品特性及技術(shù)參數(shù)概述：SmartSOPC 多功能教學(xué)實驗開發(fā)平臺集眾多種功能于一體，是SOPC
標(biāo)簽： SmartSOPC 多功能 教學(xué)實驗 開發(fā)平臺
上傳時間： 2013-06-07
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數(shù)控系統(tǒng)在工礦領(lǐng)域已得到廣泛應(yīng)用，計算機數(shù)控系統(tǒng)通過對數(shù)字化信息的處理和運算，并轉(zhuǎn)化成脈沖信號，實現(xiàn)對步進(jìn)電機的控制，進(jìn)而控制數(shù)控機床動作和零件加工。隨著嵌入式技術(shù)的發(fā)展，我們可以設(shè)計規(guī)模更小，成本更低，功能更特定的嵌入式系統(tǒng)來完成傳統(tǒng)計算機數(shù)控系統(tǒng)所完成的工作。 步進(jìn)電機以其精度高、控制靈活、定位準(zhǔn)確、起停迅速、工作可靠、能直接接受數(shù)字信號的特點，成為數(shù)控系統(tǒng)中的重要執(zhí)行部件。然而根據(jù)步進(jìn)電機的特性，必須要采取適當(dāng)而有效的升降速控制策略，特別是在多電機連動的系統(tǒng)中，對多個電機連動的速度控制和脈沖分配也很值得研究。在本文中作者將介紹一種三軸連動的速度控制和脈沖分配的優(yōu)化算法，以及其在基于FPGA和ARM配合的高速數(shù)控雕刻機控制系統(tǒng)中的實現(xiàn)。 在本文中還可以看見，為了減小本系統(tǒng)中主控MCU的壓力，作者還將利用FPGA來設(shè)計一個針對多電機連動的速度控制和脈沖分配優(yōu)化算法的外圍定制控制器。 最終實驗結(jié)果表明，作者所提出的優(yōu)化算法及其在本系統(tǒng)的實現(xiàn)方案，完全達(dá)到客戶所提出的高速數(shù)控雕刻機控制系統(tǒng)的各項設(shè)計性能指標(biāo)。
標(biāo)簽： FPGA 數(shù)控 步進(jìn)電機
上傳時間： 2013-07-02
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現(xiàn)代雷達(dá)系統(tǒng)廣泛采用脈沖壓縮技術(shù)，用以解決作用距離與分辨能力之間的矛盾。脈沖壓縮是指雷達(dá)通過發(fā)射寬脈沖，保證足夠的最大作用距離，而接收時，采用相應(yīng)的脈沖壓縮法獲得窄脈沖以提高距離分辨率的過程。同時，數(shù)字信號處理技術(shù)的迅猛發(fā)展和廣泛應(yīng)用，為雷達(dá)脈沖壓縮處理的數(shù)字化實現(xiàn)提供了可能。 本文主要研究雷達(dá)多波形頻域數(shù)字脈沖壓縮系統(tǒng)的硬件系統(tǒng)實現(xiàn)。在匹配濾波理論的指導(dǎo)下，成功研制了基于FPGAEP1K100QC208-1和4片高性能ADSP21160M的多波形頻域數(shù)字脈沖壓縮系統(tǒng)。該系統(tǒng)可處理時寬在42μs以內(nèi)、帶寬在5MHz以下的線性調(diào)頻信號(LFM)，非線性調(diào)頻信號(NLFM)和Taylor四相碼信號，且技術(shù)指標(biāo)完全滿足實用系統(tǒng)的設(shè)計要求。 本文完成的主要工作和創(chuàng)新之處有：(1)基于雙通道模數(shù)轉(zhuǎn)換器AD10242設(shè)計高精度數(shù)據(jù)采集電路，為整個脈壓系統(tǒng)的工作提供必要的條件。完成了前端模擬信號輸入電路的優(yōu)化和差分輸入時鐘的產(chǎn)生，以實現(xiàn)高精度采樣。 (2)根據(jù)協(xié)議和脈壓系統(tǒng)的工作要求，以基于FPGAEP1K100QC208完成系統(tǒng)控制，使整個脈壓系統(tǒng)正確穩(wěn)定地工作。同時以該FPGA生成雙口RAM，實現(xiàn)數(shù)據(jù)暫存，以匹配采樣速率和脈壓系統(tǒng)頻率。 (3)設(shè)計基于4片高性能ADSP21160M的緊耦合并行處理系統(tǒng)，以完成多波形頻域數(shù)字脈沖壓縮的全部運算工作。4片DSP共享外部總線，且各DSP以鏈路口互連，進(jìn)行數(shù)據(jù)通信。各DSP還使用一個鏈路口連接到接口板DSP，將脈壓結(jié)果送出。 (4)以一片ADSP21160M和一片EP1K100QC208為核心，設(shè)計輸出板電路，完成數(shù)據(jù)對齊、求模和數(shù)據(jù)向下一級的輸出，并產(chǎn)生模擬輸出。 (5)調(diào)試并改進(jìn)處理板和輸出板。
標(biāo)簽： FPGA DSP 多波形 壓縮系統(tǒng)
上傳時間： 2013-06-11
上傳用戶：qq277541717
本文首先研究了常規(guī)的數(shù)據(jù)采集的方法，針對由單片機構(gòu)成的數(shù)據(jù)采集系統(tǒng)數(shù)據(jù)處理能力弱的問題提出了基于現(xiàn)場可編程門陣列(FieldProgrammableGateArray,FPGA)為邏輯控制芯片對三片A/D芯片進(jìn)行控制的遠(yuǎn)程多路數(shù)據(jù)采集的解決方案。 本文利用VisualBasic編寫串口通信程序，通過串行端口向FPGA數(shù)據(jù)采集板發(fā)送數(shù)據(jù)采集的參數(shù)指令,FPGA數(shù)據(jù)采集板接受指令后進(jìn)行現(xiàn)場數(shù)據(jù)采集，并通過串行通信將數(shù)據(jù)發(fā)送到PC機，在通信過程中完全遵守RS-232協(xié)議，具有較強的通用性和推廣價值。然后本文重點介紹了該采集系統(tǒng)的硬件設(shè)計原理和軟件設(shè)計框架，實現(xiàn)實時嵌入式微機數(shù)據(jù)采集系統(tǒng)的軟件和硬件設(shè)計方法，將部分軟件的功能改由硬件實現(xiàn)，從邏輯上大大簡化了嵌入式軟件的設(shè)計。
標(biāo)簽： FPGA WEB 遠(yuǎn)程 多路數(shù)據(jù)采集
上傳時間： 2013-04-24
上傳用戶：yaohe123
本文首先研究了常規(guī)的數(shù)據(jù)采集的方法，針對由單片機構(gòu)成的數(shù)據(jù)采集系統(tǒng)數(shù)據(jù)處理能力弱的問題提出了基于現(xiàn)場可編程門陣列(FieldProgrammableGateArray,FPGA)為邏輯控制芯片對三片A/D芯片進(jìn)行控制的遠(yuǎn)程多路數(shù)據(jù)采集的解決方案。 本文利用VisualBasic編寫串口通信程序，通過串行端口向FPGA數(shù)據(jù)采集板發(fā)送數(shù)據(jù)采集的參數(shù)指令,FPGA數(shù)據(jù)采集板接受指令后進(jìn)行現(xiàn)場數(shù)據(jù)采集，并通過串行通信將數(shù)據(jù)發(fā)送到PC機，在通信過程中完全遵守RS-232協(xié)議，具有較強的通用性和推廣價值。然后本文重點介紹了該采集系統(tǒng)的硬件設(shè)計原理和軟件設(shè)計框架，實現(xiàn)實時嵌入式微機數(shù)據(jù)采集系統(tǒng)的軟件和硬件設(shè)計方法，將部分軟件的功能改由硬件實現(xiàn)，從邏輯上大大簡化了嵌入式軟件的設(shè)計。
標(biāo)簽： FPGA WEB 遠(yuǎn)程 多路數(shù)據(jù)采集
上傳時間： 2013-05-30
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