七天玩轉(zhuǎn)Altera：學(xué)習(xí)FPGA必經(jīng)之路包括基礎(chǔ)篇、時(shí)序篇和驗(yàn)證篇三個(gè)部分。
上傳時(shí)間： 2013-10-11
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信息處理機(jī)(圖1)用于完成導(dǎo)彈上多路遙測(cè)信息的采集、處理、組包發(fā)送。主要功能包括高速1553B總線的數(shù)據(jù)收發(fā)、422接口設(shè)備的數(shù)據(jù)加載與檢測(cè)、多路數(shù)據(jù)融合和數(shù)據(jù)接收、處理、組包發(fā)送的功能。其中，總線數(shù)據(jù)和其他422接口送來(lái)的數(shù)據(jù)同時(shí)進(jìn)行并行處理;各路輸入信息按預(yù)定格式進(jìn)行融合與輸出;數(shù)據(jù)輸出速率以高速同步422口的幀同步脈沖為源，如果高速同步422口異常不影響總線數(shù)據(jù)和其它422口的數(shù)據(jù)融合與輸出功能。在CPU發(fā)生異常或總線數(shù)據(jù)異常時(shí)不影響其它422口數(shù)據(jù)的融合與輸出功能;能夠?qū)目偩€上接收的數(shù)據(jù)進(jìn)行二次篩選、組包，并發(fā)送往總線，供其它設(shè)備接收。
標(biāo)簽： FPGA 信息處理 中的應(yīng)用
上傳時(shí)間： 2013-11-22
上傳用戶：suicone
為有效控制固態(tài)功率調(diào)制設(shè)備,提高系統(tǒng)的可調(diào)性和穩(wěn)定性,介紹了一種基于現(xiàn)場(chǎng)可編程門陣列( FPGA)和微控制器(MCU) 的多路高壓IGBT 驅(qū)動(dòng)觸發(fā)器的設(shè)計(jì)方法和實(shí)現(xiàn)電路。該觸發(fā)器可選擇內(nèi)或外觸發(fā)信號(hào),可遙控或本控,能產(chǎn)生多路頻率、寬度和延時(shí)獨(dú)立可調(diào)的脈沖信號(hào),信號(hào)的輸入輸出和傳輸都使用光纖。將該觸發(fā)器用于高壓IGBT(3300 V/ 800 A) 感應(yīng)疊加脈沖發(fā)生器中進(jìn)行實(shí)驗(yàn)測(cè)試,給出了實(shí)驗(yàn)波形。結(jié)果表明,該多路高壓IGBT驅(qū)動(dòng)觸發(fā)器輸出脈沖信號(hào)達(dá)到了較高的調(diào)整精度,頻寬’脈寬及延時(shí)可分別以步進(jìn)1 Hz、0. 1μs、0. 1μs 進(jìn)行調(diào)整,滿足了脈沖發(fā)生器的要求,提高了脈沖功率調(diào)制系統(tǒng)的性能。
標(biāo)簽： FPGA IGBT 多路 驅(qū)動(dòng)
上傳時(shí)間： 2013-10-22
上傳用戶：zhulei420
高速串并轉(zhuǎn)換器的設(shè)計(jì)是FPGA 設(shè)計(jì)的一個(gè)重要方面,傳統(tǒng)設(shè)計(jì)方法由于采用FPGA 的內(nèi)部邏輯資源來(lái)實(shí)現(xiàn),從而限制了串并轉(zhuǎn)換的速度。該研究以網(wǎng)絡(luò)交換調(diào)度系統(tǒng)的FGPA 驗(yàn)證平臺(tái)中多路高速串并轉(zhuǎn)換器的設(shè)計(jì)為例,詳細(xì)闡述了1 :8DDR 模式下高速串并轉(zhuǎn)換器的設(shè)計(jì)方法和16 路1 :8 串并轉(zhuǎn)換器的實(shí)現(xiàn)。結(jié)果表明,采用Xilinx Virtex24 的ISERDES 設(shè)計(jì)的多路串并轉(zhuǎn)換器可以實(shí)現(xiàn)800 Mbit/ s 輸入信號(hào)的串并轉(zhuǎn)換,并且減少了設(shè)計(jì)復(fù)雜度,縮短了開發(fā)周期,能滿足設(shè)計(jì)要求。關(guān)鍵詞:串并轉(zhuǎn)換;現(xiàn)場(chǎng)可編程邏輯陣列;Xilinx ; ISERDES
標(biāo)簽： FPGA 多路 串并轉(zhuǎn)換
上傳時(shí)間： 2013-11-03
上傳用戶：王小奇
AD接收UART發(fā)送模塊
上傳時(shí)間： 2013-10-28
上傳用戶：zhang_yi
光纖收發(fā)模塊接收部分原理
上傳時(shí)間： 2013-11-20
上傳用戶：yimoney
參照3GPP LTE的E-UTRA物理層規(guī)范，提出了一種鏈路自適應(yīng)方案。實(shí)時(shí)調(diào)整傳輸功率以補(bǔ)償信道的衰落，建立SNR-BLER曲線，在給定滿足一定業(yè)務(wù)的目標(biāo)BLER的條件下，找到各個(gè)MCS的SNR切換門限值，從而實(shí)現(xiàn)鏈路自適應(yīng)。仿真結(jié)果表明，在保證通信質(zhì)量的前提下，自適應(yīng)方案比固定MCS有著明顯的頻譜效率增益，使無(wú)線資源得到優(yōu)化配置；同時(shí)刪減了頻譜效率沒(méi)有增益的MCS，降低系統(tǒng)復(fù)雜度。
標(biāo)簽： LTE 鏈路 自適應(yīng)技術(shù) 中的應(yīng)用
上傳時(shí)間： 2013-12-22
上傳用戶：xsnjzljj
在擴(kuò)頻通信中，Rake接收是抵抗多徑衰落的有效方法。本文首先介紹無(wú)線移動(dòng)通信的信道特性，然后對(duì)Rake接收的基本原理和接收機(jī)結(jié)構(gòu)進(jìn)行詳細(xì)描述，并對(duì)Rake接收性能進(jìn)行了仿真比較。仿真結(jié)果表明，在多徑信道條件下，Rake接收方式能很好的改善接收系統(tǒng)誤碼性能；采用GOLD序列擴(kuò)頻比m序列擴(kuò)頻方式時(shí)，Rake接收方法性能提高的更明顯。
上傳時(shí)間： 2013-11-16
上傳用戶：whenfly
PCIE 3.0相對(duì)于它的前一代PCIE 2.0的最主要的一個(gè)區(qū)別是速率由5GT/s提升到了8GT/s。為了保證數(shù)據(jù)傳輸密度和直流平衡以及時(shí)鐘恢復(fù)，PCIE 2.0中使用了8B/10B編碼，即將每8位有效數(shù)據(jù)編碼為10位數(shù)據(jù)進(jìn)行傳輸，這樣鏈路中將會(huì)有20%信息量是無(wú)效的，即使得鏈路的最大傳輸容量打了20%的折扣。而速率提升的目的是為了更快的傳輸數(shù)據(jù)，編碼方式也不可或缺，因此在PCIE 3.0中還通過(guò)使用128B/130B的編碼方式（無(wú)效信息量減低為1.5625%），同時(shí)使用加擾的方式（即數(shù)據(jù)流先和一個(gè)多項(xiàng)式異或得到一個(gè)更加隨機(jī)性的數(shù)據(jù)，到接收端使用同樣的多項(xiàng)式將其恢復(fù)出來(lái)）來(lái)實(shí)現(xiàn)數(shù)據(jù)傳輸密度和直流平衡以及時(shí)鐘恢復(fù)的實(shí)現(xiàn)。
標(biāo)簽： PCIE 3.0 力科 發(fā)射機(jī)
上傳時(shí)間： 2014-12-29
上傳用戶：shaojie2080
51單片機(jī)的nRF905無(wú)線發(fā)射接收程序
標(biāo)簽： nRF 905 51單片機(jī) 無(wú)線發(fā)射
上傳時(shí)間： 2013-10-23
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