在一這期中，我們擴(kuò)大了討論的範(fàn)圍，涵蓋了在飛思卡爾產(chǎn)品系列中采用的多種技術(shù)，包括8位微控制器(MCU)、32位ColdFire控制器、我們曾獲大獎(jiǎng)的16位數(shù)字信號控制器(DSC)及ZigBee® 無線技術(shù)等。此外，我們還增加了一個(gè)來自設(shè)計(jì)聯(lián)盟合作伙伴的內(nèi)容，以及飛思卡爾客戶如何用我們的產(chǎn)品和服務(wù)取得成功的實(shí)例。
上傳時(shí)間： 2013-10-17
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2010 年，科通成為Cadence 公司在中國規(guī)模最大的增值代理商，科通也是Cadence 公司唯一代理區(qū)域覆蓋全國，唯一代理產(chǎn)品范圍覆蓋Cadence PCB 全線（Allegro 和Orcad）的增值服務(wù)商。隨著業(yè)界領(lǐng)先的信號完整性和電源完整性仿真軟件供應(yīng)商Sigrity 成為Cadence 的一員，全新的Cadence 芯片封裝/PCB 板協(xié)同設(shè)計(jì)及仿真解決方案，讓你能夠迅速優(yōu)化芯片和封裝之間的網(wǎng)絡(luò)連接，以及封裝與PCB 之間的網(wǎng)絡(luò)連接。同時(shí)通過網(wǎng)表管理、自動(dòng)優(yōu)化路徑以及信號和電源完整性分析，可以對產(chǎn)品的成本與性能進(jìn)行優(yōu)化。
標(biāo)簽： Cadence_PCB 2013
上傳時(shí)間： 2013-10-22
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飛思卡爾智能車的舵機(jī)測試程序 #include <hidef.h> /* common defines and macros */#include <MC9S12XS128.h> /* derivative information */#pragma LINK_INFO DERIVATIVE "mc9s12xs128" void SetBusCLK_16M(void) { CLKSEL=0X00; PLLCTL_PLLON=1; //鎖相環(huán)電路允許位 SYNR=0x00 | 0x01; //SYNR=1 REFDV=0x80 | 0x01; POSTDIV=0x00; _asm(nop); _asm(nop); while(!(CRGFLG_LOCK==1)); CLKSEL_PLLSEL =1; } void PWM_01(void) { //舵機(jī)初始化 PWMCTL_CON01=1; //0和1聯(lián)合成16位PWM； PWMCAE_CAE1=0; //選擇輸出模式為左對齊輸出模式 PWMCNT01 = 0; //計(jì)數(shù)器清零； PWMPOL_PPOL1=1; //先輸出高電平，計(jì)數(shù)到DTY時(shí)，反轉(zhuǎn)電平 PWMPRCLK = 0X40; //clockA 不分頻,clockA=busclock=16MHz;CLK B 16分頻:1Mhz PWMSCLA = 0x08; //對clock SA 16分頻,pwm clock=clockA/16=1MHz; PWMCLK_PCLK1 = 1; //選擇clock SA做時(shí)鐘源 PWMPER01 = 20000; //周期20ms； 50Hz; PWMDTY01 = 1500; //高電平時(shí)間為1.5ms; PWME_PWME1 = 1;
上傳時(shí)間： 2013-11-04
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2010 年，科通成為Cadence 公司在中國規(guī)模最大的增值代理商，科通也是Cadence 公司唯一代理區(qū)域覆蓋全國，唯一代理產(chǎn)品范圍覆蓋Cadence PCB 全線（Allegro 和Orcad）的增值服務(wù)商。隨著業(yè)界領(lǐng)先的信號完整性和電源完整性仿真軟件供應(yīng)商Sigrity 成為Cadence 的一員，全新的Cadence 芯片封裝/PCB 板協(xié)同設(shè)計(jì)及仿真解決方案，讓你能夠迅速優(yōu)化芯片和封裝之間的網(wǎng)絡(luò)連接，以及封裝與PCB 之間的網(wǎng)絡(luò)連接。同時(shí)通過網(wǎng)表管理、自動(dòng)優(yōu)化路徑以及信號和電源完整性分析，可以對產(chǎn)品的成本與性能進(jìn)行優(yōu)化。
標(biāo)簽： Cadence_PCB 2013
上傳時(shí)間： 2013-10-08
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賽靈思spartan6系列FPGA片內(nèi)資源設(shè)計(jì)指導(dǎo)
標(biāo)簽： spartan6 FPGA 賽靈思 資源
上傳時(shí)間： 2013-10-16
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飛思卡爾的PCB布局布線應(yīng)用筆記，很值得學(xué)習(xí)的
標(biāo)簽： PCB 飛思卡爾 布局布線 應(yīng)用筆記
上傳時(shí)間： 2013-10-21
上傳用戶：aa7821634
深入剖析賽靈思（Xilinx）All Programmable三大創(chuàng)新器件:賽靈思在 28nm 節(jié)點(diǎn)上推出的多種新技術(shù)為客戶帶來了重大的超前價(jià)值，并使賽靈思領(lǐng)先競爭對手整整一代。賽靈思并不是簡單地將現(xiàn)有的 FPGA 架構(gòu)遷移到新的技術(shù)節(jié)點(diǎn)上，而是力求引領(lǐng)多種 FPGA 創(chuàng)新，并率先推出了 All Programmable 3D IC 和 SoC。 今天推出的 All Programmable 產(chǎn)品采用了各種形式的可編程技術(shù)，包括可編程硬件和軟件、數(shù)字信號和模擬混合信號（AMS）、單晶片和多片 3D IC 方案（圖 1）。有了這些全新的 All Programmable 器件，設(shè)計(jì)團(tuán)隊(duì)就能進(jìn)一步提升可編程系統(tǒng)的集成度，提高整體系統(tǒng)性能，降低 BOM 成本，并以更快的速度向市場推出更具創(chuàng)新性的智能產(chǎn)品。
標(biāo)簽： Programmable Xilinx All 賽靈思
上傳時(shí)間： 2013-10-29
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全新賽靈思（Xilinx）FPGA 7系列芯片精彩剖析:賽靈思的最新7系列FPGA芯片包括3個(gè)子系列，Artix-7、 Kintex-7和Virtex-7。在介紹芯片之前，先看看三個(gè)子系列芯片的介紹表，如下表1所示： 表1 全新Xilinx FPGA 7系列子系列介紹表 (1) Artix-7 FPGA系列——業(yè)界最低功耗和最低成本 通過表1我們不難得出以下結(jié)論： 與上一代 FPGA相比，其功耗降低了50%，成本削減了35%，性能提高30%，占用面積縮減了50%，賽靈思FPGA芯片在升級中，功耗和性能平衡得非常好。
標(biāo)簽： Xilinx FPGA 賽靈思 系列芯片
上傳時(shí)間： 2013-12-20
上傳用戶：dongbaobao
本文是關(guān)于賽靈思Artix-7 FPGA 數(shù)據(jù)手冊:直流及開關(guān)特性的詳細(xì)介紹。 文章中也討論了以下問題： 1.全新 Artix-7 FPGA 系列有哪些主要功能和特性? Artix-7 系列提供了業(yè)界最低功耗、最低成本的 FPGA，采用了小型封裝，配合Virtex 架構(gòu)增強(qiáng)技術(shù)，能滿足小型化產(chǎn)品的批量市場需求，這也正是此前 Spartan 系列 FPGA 所針對的市場領(lǐng)域。與 Spartan-6 FPGA 相比，Artix-7 器件的邏輯密度從 20K 到 355K 不等，不但使速度提升 30%，功耗減半，尺寸減小 50%，而且價(jià)格也降了 35%。 2.Artix-7 FPGA 系列支持哪些類型的應(yīng)用和終端市場? Artix-7 FPGA 系列面向各種低成本、小型化以及低功耗的應(yīng)用，包括如便攜式超聲波醫(yī)療設(shè)備、軍用通信系統(tǒng)、高端專業(yè)/消費(fèi)類相機(jī)的 DSLR 鏡頭模塊，以及航空視頻分配系統(tǒng)等。
標(biāo)簽： Artix FPGA 賽靈思 數(shù)據(jù)手冊
上傳時(shí)間： 2013-11-12
上傳用戶：songyue1991
賽靈思FPGA芯片論文，值得一看。
標(biāo)簽： FPGA 賽靈思 芯片架構(gòu) 分
上傳時(shí)間： 2015-01-02
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