信號(hào)處理FPGA實(shí)現(xiàn)參考,IEEE transaction 的一篇文章。主要針對(duì)信號(hào)處理中加窗、FFT、VSLI快速實(shí)現(xiàn)中誤差地等問(wèn)題。
標(biāo)簽： transaction FPGA IEEE 信號(hào)處理
上傳時(shí)間： 2013-08-12
上傳用戶：奇奇奔奔
華為 FPGA 設(shè)計(jì)高級(jí)技巧 Xilinx 篇，涉及 FPGA 綜合、時(shí)序優(yōu)化、編碼風(fēng)格
標(biāo)簽： Xilinx FPGA 華為 高級(jí)技巧
上傳時(shí)間： 2013-08-14
上傳用戶：wivai
AlteraFPGACPLD設(shè)計(jì)高級(jí)篇電子書(shū)籍
標(biāo)簽： Altera FPGA CPLD 電子
上傳用戶：哇哇哇哇哇
Altera FPGA_CPLD設(shè)計(jì) 基礎(chǔ)篇
標(biāo)簽： FPGA_CPLD Altera
上傳時(shí)間： 2013-08-16
上傳用戶：leixinzhuo
華為公司的內(nèi)部資料，關(guān)于如何寫(xiě)好FPGA程序的好教程，Xilinx篇
標(biāo)簽： Xilinx FPGA 程序 教程
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是基于FPGA高速設(shè)計(jì)指導(dǎo)的一篇文章，很好的！
標(biāo)簽： FPGA 高速設(shè)計(jì)
上傳用戶：yuyizhixia
本文是一稿講述cpdl的說(shuō)明文,對(duì)初學(xué)者來(lái)說(shuō)是一篇很好的入門(mén)文件.
標(biāo)簽： cpdl 初學(xué)者
上傳時(shí)間： 2013-08-21
上傳用戶：dudu121
CPLD數(shù)字電路設(shè)計(jì)——使用MAX+plusⅡ入門(mén)篇.rar 不能錯(cuò)過(guò)的書(shū)籍
標(biāo)簽： CPLD plus MAX
上傳時(shí)間： 2013-08-22
上傳用戶：zhtzht
幾篇關(guān)于FPGA做視頻項(xiàng)目論文,希望對(duì)大家有幫助
標(biāo)簽： FPGA 視頻 項(xiàng)目 論文
上傳用戶：squershop
基于ARM和FPGA的嵌入式CCD采集系統(tǒng)的一篇論文，寫(xiě)的不錯(cuò)，值得參考
標(biāo)簽： FPGA ARM CCD 嵌入式
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