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微積分

  • CPLD的程序,分頻,微分等,應用于DPLL

    CPLD的程序,分頻,微分等,應用于DPLL

    標簽: CPLD DPLL 程序 分頻

    上傳時間: 2013-12-11

    上傳用戶:zhyiroy

  • 采用有限差分法計算屏蔽微帶傳輸線的電位及其電容

    采用有限差分法計算屏蔽微帶傳輸線的電位及其電容,程序由matlab實現

    標簽: 有限差分 微帶傳輸線 計算 電位

    上傳時間: 2016-12-09

    上傳用戶:lxm

  • 本套書分上、下冊。上冊以PHILIPS公司的LPC2131 ARM微控制器為核心

    本套書分上、下冊。上冊以PHILIPS公司的LPC2131 ARM微控制器為核心,以EasyARM2131開發板為基礎,深入淺出地對LPC213x系列ARM微控制器的使用進行了詳細、全方位的闡述。全書共分5章。第1章介紹EasyARM2131硬件開發平臺;第2章介紹嵌入式開發軟件平臺;第3章著重介紹 LPC2131微控制器的體系結構和啟動代碼;第4章是本書的核心,以LPC2131微控制器功能部件為主線,詳細介紹該芯片所有功能部件的使用,并提供詳細的例程;第5章介紹LPC213x系列微控制器的硬件結構。 下冊以 C/OS-II為基礎,全面介紹基于OS的各種應用設計,同時介紹LPC214x系列ARM微控制器的原理及其USB驅動開發與源代碼分析。 本套書可作為從事嵌入式系統應用開發工程師的參考資料,也可作為高等院校電子、自動化、機電一體化、計算機等相關專業嵌入式系統的教學參考書,特別適合于進行ARM7嵌入式開發的初學者。

    標簽: PHILIPS 2131 LPC ARM

    上傳時間: 2013-12-26

    上傳用戶:zhouli

  • 項目的研究內容是對硅微諧振式加速度計的數據采集電路開展研究工作。硅微諧振式加速度計敏感結構輸出的是兩路差分的頻率信號

    項目的研究內容是對硅微諧振式加速度計的數據采集電路開展研究工作。硅微諧振式加速度計敏感結構輸出的是兩路差分的頻率信號,因此硅微諧振式加速度計數據采集電路完成的主要任務是測出兩路頻率信號的差值。測量要求是:實現10ms內對中心諧振頻率為20kHz、標度因數為100Hz/g、量程為±50g、分辨率為1mg的硅微諧振式加速度計輸出的頻率信號的測量,等效測量誤差為±1mg。電路的控制核心為單片機,具有串行接口以便將測量結果傳送給PC機從而分析、保存測量結果。 按研究內容設計了軟硬件。軟件采用多周期同步法實現高精度,快速度的頻率測量方案,并使用CPLD編程實現,這也是最難的地方。硬件采用現在流行的3.3V供電系統,選用EPM240T100C5N和較為實用的AVR單片機芯片Atmega64L,對應3.3V供電系統,串行接口使用MAX3232。 最后完成了PCB板的制作,經反復調試后得到了非常好的效果。采集的數據滿足項目研究內容中的要求,當提高有源晶振的頻率時,精度有大大提高了,此時已遠遠滿足了項目中高精度,快速度測量的要求。另外,采用MFC編程編寫了上位機的數據接收和數據處理專用軟件,集數據采集,運算,作圖,保存功能于一體。 此為CPLD語言部分

    標簽: 硅微 加速度計 諧振式 項目

    上傳時間: 2013-12-09

    上傳用戶:奇奇奔奔

  • 項目的研究內容是對硅微諧振式加速度計的數據采集電路開展研究工作。硅微諧振式加速度計敏感結構輸出的是兩路差分的頻率信號

    項目的研究內容是對硅微諧振式加速度計的數據采集電路開展研究工作。硅微諧振式加速度計敏感結構輸出的是兩路差分的頻率信號,因此硅微諧振式加速度計數據采集電路完成的主要任務是測出兩路頻率信號的差值。測量要求是:實現10ms內對中心諧振頻率為20kHz、標度因數為100Hz/g、量程為±50g、分辨率為1mg的硅微諧振式加速度計輸出的頻率信號的測量,等效測量誤差為±1mg。電路的控制核心為單片機,具有串行接口以便將測量結果傳送給PC機從而分析、保存測量結果。 按研究內容設計了軟硬件。軟件采用多周期同步法實現高精度,快速度的頻率測量方案,并使用CPLD編程實現,這也是最難的地方。硬件采用現在流行的3.3V供電系統,選用EPM240T100C5N和較為實用的AVR單片機芯片Atmega64L,對應3.3V供電系統,串行接口使用MAX3232。 最后完成了PCB板的制作,經反復調試后得到了非常好的效果。采集的數據滿足項目研究內容中的要求,當提高有源晶振的頻率時,精度有大大提高了,此時已遠遠滿足了項目中高精度,快速度測量的要求。另外,采用MFC編程編寫了上位機的數據接收和數據處理專用軟件,集數據采集,運算,作圖,保存功能于一體。 此為上位機程序部分

    標簽: 硅微 加速度計 諧振式 項目

    上傳時間: 2017-02-13

    上傳用戶:大三三

  • 基于微震信號多重分形特征的巖石邊坡變形預警研究_毛浩宇

    基于微震信號多重分形特征的巖石邊坡變形預警研究,很好的文章

    標簽: 信號 多重分形 變形 特征 巖石 預警

    上傳時間: 2020-12-31

    上傳用戶:

  • 對硅微諧振式加速度計的數據采集電路開展研究工作

    項目的研究內容是對硅微諧振式加速度計的數據采集電路開展研究工作。硅微諧振式加速度計敏感結構輸出的是兩路差分的頻率信號,因此硅微諧振式加速度計數據采集電路完成的主要任務是測出兩路頻率信號的差值。測量要求是:實現10ms內對中心諧振頻率為20kHz、標度因數為100Hz/g、量程為±50g、分辨率為1mg的硅微諧振式加速度計輸出的頻率信號的測量,等效測量誤差為±1mg。電路的控制核心為單片機,具有串行接口以便將測量結果傳送給PC機從而分析、保存測量結果。\\r\\n按研究內容設計了軟硬件。軟件采用多周期同步法

    標簽: 硅微 加速度計 數據采集電路 諧振式

    上傳時間: 2013-08-11

    上傳用戶:csgcd001

  • 一個恒定Lyapunov指數譜魯棒混沌系統及其微控制器實現

    在基本Sprott-B混沌系統數學模型的基礎上,引入一個控制參數進行系統改造,構建出一個恒定Lyapunov指數譜魯棒混沌系統。通過相軌圖、Lyapunov指數譜和分岔圖等動力學工具對系統進行了仿真分析。研究結果表明,系統對唯一的控制參數保持恒定的Lyapunov指數譜,從而工作于魯棒混沌狀態,理論分析則揭示出控制參數對于系統的混沌振蕩具有線性或非線性調幅作用。此外,在以改進的Euler算法進行離散化后,采用微控制器MSP430F249進行了實驗驗證,證明了系統的可實現性。

    標簽: Lyapunov 魯棒 混沌系統 微控制器

    上傳時間: 2014-01-06

    上傳用戶:Shaikh

  • 基于M CORE微控制器的嵌入式系統

    基于M CORE微控制器的嵌入式系統從應用的角度出發,全面介紹了構成嵌人式系統的微控制器的結構和常用支撐硬件的原理以及設計開發方法。本書共 24章,分為3大部分。第 1部分(第 1~14章)介紹具有 32位 RISC CPU核的M·CORE微控制器的結構及原理,按模塊分章,對各功能模塊的原理及使用方法都有詳盡的講解。眾所周知,微控制器種類繁多,雖然不同種類微控制器的CPU及內部功能模塊有所不同,但基本原理(尤其是一些通用的功能)是一致的。第2部分(第15—19章)介紹嵌入式系統常用外圍電路的原理及設計和使用方法,包括有:異步串行接口的互連及應用舉例、同步串行總線及應用舉例、液晶顯示模塊、液晶控制器、觸摸屏及觸摸屏控制器和各類存儲器的應用舉例。第3部分(第20—24章)介紹嵌人式系統的開發環境與軟件開發,在討論嵌人式系統軟件開發的一般過程和開發工具需求的基礎上,介紹M·CORE軟件開發支持工具集、MMC2107微控制器評估板、M·CORE常用工具軟件、QodeWarrior集成開發環境IDE及M·CORE的基本程序設計技術。 第1部分 M·COREM控制器的結構及原理 第1章 微控制器及其應用技術概述 1.1 微控制器的特點 1.2 微控制器技術的發展 1.3 M·CORE系列微控制器 l.3.1 MMC2107的特點及組成 1.3.2 MMC2107的引腳描述 1.3.3 MMC2107的系統存儲器地址映射 第2章 M·CORE M210中央處理單元(CPU) 2.1 M·CORE處理器綜述 2.1.1 M·CORE處理器的微結構 2.1.2 M·CORE處理器的編程模型 2.1.3 M·CORE的數據格式 2.1.4 M·CORE處理器的寄存器 2.2 M·CORE處理器指令系統簡述 2. 2.l 指令類型和尋址方式

    標簽: CORE 微控制器 嵌入式系統

    上傳時間: 2013-10-28

    上傳用戶:lhw888

  • 分時操作系統思想在單片機編程中的實現

    作為嵌入式系統主控單元——單片機,其軟件往往是一個微觀的實時操作系統,且大部分是為某種應用而專門設計的。系統程序有實時過程控制或實時信息處理的能力,要求能夠及時響應隨機發生的外部事件并對該事件做出快速處理。而分時操作系統卻是把CPU的時間劃分成長短基本相同的時間區間,即“時間片”,通過操作系統的管理,把這些時間片依次輪流地分配給各個用戶使用。如果某個作業在時間片結束之前,整個任務還沒有完成,那么該作業就被暫停下來,放棄CPU,等待下一輪循環再繼續做。此時CPU又分配給另一個作業去使用。由于計算機的處理速度很快,只要時間片的間隔取得適當,那么一個用戶作業從用完分配給它的一個時間片到獲得下一個CPU時間片,中間有所“停頓”;但用戶察覺不出來,好像整個系統全由它“獨占”似的。分時操作系統主要具有以下3個特點:① 多路性。用戶通過各自的終端,可以同時使用一個系統。② 及時性。用戶提出的各種要求,能在較短或可容忍的時間內得到響應和處理。③ 獨占性。在分時系統中,雖然允許多個用戶同時使用一個CPU,但用戶之間操作獨立,互不干涉。分時操作系統主要是針對小型機以上的計算機提出的。一般而言,微處理器(MPU)驅動的通用計算機,系統設計人員對每一臺的最終具體應用都是不得而知的,因此,在價格允許的情況下,硬件設計務求CPU時鐘盡可能的快;計算及管理能力盡可能的強;程序和數據存儲器的容量盡可能的大;各種計算機外設的配接盡可能的詳盡等等,特別是采用分時操作系統的機器,因為是一機多用戶的管理系統,它的要求就更高了。相對而言,微控制器(MCU)俗稱單片機,是一個單片集成系統,它將這些或那些計算機所需的外設,諸如程序和數據存儲器、端口以及有關的子系統集成到一片芯片上。從硬件上,單片機系統與采用分時操作系統的計算機系統是無法比擬的。但是,在單片機系統的設計中,設計人員對其最終具體應用是一清二楚的,它的使用環境相對是單一固定的。所控制的過程的可預見性為分時系統思想的實現提供了可能性。具體一點就是:雖然單片機的CPU速度較低,但其任務是可預見的,這樣作業調度將變得簡單而無須占用很多的CPU時間,同時“時間片”的設計是具體而有針對性的,因此可變得很有效。一、單片機分時系統的設計單片機系統往往是一個嵌入式的控制系統,因此目前絕大部分的單片機系統還是一實時系統。能夠真正體現分時系統的設計思想的往往是那些多路重復檢測控制系統。即便是在這些多路重復檢測控制系統中,它的實時性也是非常重要的。也就是說,在單片機系統中應用了分時系統設計思想,但其及時性應首先進行考慮。

    標簽: 分時操作系統 中的實現 單片機編程

    上傳時間: 2013-12-23

    上傳用戶:佳期如夢

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