PDIUSBD12 是一款帶有并行總線和局部DMA傳輸能力的高速USB 接口器件固件設(shè)計的目標就是 使PDIUSBD12 在USB 上達到最大的傳輸速率外圍設(shè)備例如打印機掃描儀外部的海量存儲器和數(shù)碼 相機都可使用PDIUSBD12 在USB 上傳輸數(shù)據(jù)這些設(shè)備的CPU 要忙于處理許多設(shè)備控制和數(shù)據(jù)以及圖像 處理等任務(wù)PDIUSBD12 的固件設(shè)計成完全的中斷驅(qū)動當CPU 處理前臺任務(wù)時USB 的傳輸可在后臺 進行這就確保了最佳的傳輸速率和更好的軟件結(jié)構(gòu)同時簡化了編程和調(diào)試 后臺ISR 中斷服務(wù)程序和前臺主程序循環(huán)之間的數(shù)據(jù)交換通過事件標志和數(shù)據(jù)緩沖區(qū)來實現(xiàn)例 如PDIUSBD12 的批量輸出端點可使用循環(huán)的數(shù)據(jù)緩沖區(qū)當PDIUSBD12 從USB 收到一個數(shù)據(jù)包那 么就對CPU 產(chǎn)生一個中斷請求CPU 立即響應(yīng)中斷在ISR中固件將數(shù)據(jù)包從PDIUSBD12 內(nèi)部緩沖區(qū) 移到循環(huán)數(shù)據(jù)緩沖區(qū)并在隨后清零PDIUSBD12 的內(nèi)部緩沖區(qū)以使能接收新的數(shù)據(jù)包CPU 可以繼續(xù)它當 前的前臺任務(wù)直到完成例如打印當前頁然后返回到主循環(huán)檢查循環(huán)緩沖區(qū)內(nèi)是否有新的數(shù)據(jù)并開始其 它的前臺任務(wù)
標簽： PDIUSBD USB 12 DMA
上傳時間： 2016-04-10
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用openMP寫的barnes-hut問題,buildQuadtree和computeandupdateforce實現(xiàn)了并行計算
標簽： computeandupdateforce buildQuadtree barnes-hut openMP
上傳時間： 2014-01-13
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OpenMP下的并行計算Barnes-Hut問題. 只實現(xiàn)了computeandupdateforce部分的并行
標簽： computeandupdateforce Barnes-Hut OpenMP 并行計算
上傳時間： 2014-01-15
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平凡的單片機,MCS-51單片機教程 1、何謂單片機 一臺能夠工作的計算機要有這樣幾個部份構(gòu)成：CPU（進行運算、控制）、RAM（數(shù)據(jù)存儲）、ROM（程序存儲）、輸入/輸出設(shè)備（例如：串行口、并行輸出口等）。在個人計算機上這些部份被分成若干塊芯片，安裝一個稱之為主板的印刷線路板上。而在單片機中，這些部份，全部被做到一塊集成電路芯片中了，所以就稱為單片（單芯片）機，而且有一些單片機中除了上述部份外，還集成了其它部份如A/D，D/A等。
標簽： MCS CPU RAM ROM
上傳時間： 2016-04-11
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8.2并行接口電壓輸出型DA轉(zhuǎn)換器的控制
標簽： 8.2 并行接口 DA轉(zhuǎn)換器 電壓輸出
上傳時間： 2016-04-13
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8.3并行接口電流輸出型DA轉(zhuǎn)換器的控制
標簽： 8.3 并行接口 DA轉(zhuǎn)換器 電流輸出
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CRC校驗并行實現(xiàn),Verilog源碼.8位數(shù)據(jù)輸入,實現(xiàn)速度快,適用與各種類型的器件.
標簽： Verilog CRC 并行 器件
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提出了利用FPGA的現(xiàn)場可編程以及可并行處理的特性，對基于人工神經(jīng)網(wǎng)絡(luò)的圖像處理結(jié)構(gòu)進行自動生成的一種技術(shù)。作者：Andre B. Soares, Altamiro A. Susin，Leticia V. Guimaraes
標簽： FPGA 現(xiàn)場可編程 并行處理
上傳時間： 2016-04-14
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基于VHDL的8255可編程并行擴展接口芯片設(shè)計
標簽： VHDL 8255 可編程 并行
上傳時間： 2016-04-15
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此為用c++語言編寫的用于并行算法的源代碼。
標簽： 語言 編寫 并行算法 源代碼
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