FPGA采樣AD9238數據并通過VGA波形顯示例程 Verilog邏輯源碼Quartus工程文件+文檔說明,FPGA型號Cyclone4E系列中的EP4CE6F17C8，Quartus版本17.1。ADC 模塊型號為 AN9238，最大采樣率 65Mhz，精度為12 位。實驗中把 AN9238 的 2 路輸入以波形方式在 HDMI 上顯示出來，我們可以用更加直觀的方式觀察波形，是一個數字示波器雛形。module top( input clk, input rst_n, output ad9238_clk_ch0, output ad9238_clk_ch1, input[11:0] ad9238_data_ch0, input[11:0] ad9238_data_ch1, //vga output output vga_out_hs, //vga horizontal synchronization output vga_out_vs, //vga vertical synchronization output[4:0] vga_out_r, //vga red output[5:0] vga_out_g, //vga green output[4:0] vga_out_b //vga blue);wire video_clk;wire video_hs;wire video_vs;wire video_de;wire[7:0] video_r;wire[7:0] video_g;wire[7:0] video_b;wire grid_hs;wire grid_vs;wire grid_de;wire[7:0] grid_r;wire[7:0] grid_g;wire[7:0] grid_b;wire wave0_hs;wire wave0_vs;wire wave0_de;wire[7:0] wave0_r;wire[7:0] wave0_g;wire[7:0] wave0_b;wire wave1_hs;wire wave1_vs;wire wave1_de;wire[7:0] wave1_r;wire[7:0] wave1_g;wire[7:0] wave1_b;wire adc_clk;wire adc0_buf_wr;wire[10:0] adc0_buf_addr;wire[7:0] adc0_bu
上傳時間： 2021-10-27
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四路20秒聲光顯示計分搶答器Multisim14仿真源文件+設計文檔資料摘要數字搶答器由主體電路與擴展電路組成。優先編碼電路、鎖存器、譯碼電路將參賽隊的輸入信號在顯示器上輸出；用控制電路和主持人開關啟動報警電路，以上兩部分組成主體電路。通過定時電路和譯碼電路將秒脈沖產生的信號在顯示器上輸出實現計時功能，構成擴展電路。經過布線、焊接、調試等工作后數字搶答器成形。關鍵字：開關陣列電路；觸發鎖存電路；解鎖電路；編碼電路；顯示電路一，設計目的本設計是利用已學過的數電知識，設計的4人搶答器。（1）重溫自己已學過的數電知識；（2）掌握數字集成電路的設計方法和原理；（3）通過完成該設計任務掌握實際問題的邏輯分析，學會對實際問題進行邏輯狀態分配、化簡；（4）掌握數字電路各部分電路與總體電路的設計、調試、模擬仿真方法。二，整體設計（一）設計任務與要求：1.搶答器同時供4名選手或4個代表隊比賽，分別用4個按鈕S0 ~ S3表示。2.設置一個系統清除和搶答控制開關S，該開關由主持人控制。3.搶答器具有鎖存與顯示功能。即選手按動按鈕，鎖存相應的編號，并在LED數碼管上顯示，同時揚聲器發出報警聲響提示。選手搶答實行優先鎖存，優先搶答選手的編號一直保持到主持人將系統清除為止。4.參賽選手在設定的時間內進行搶答，搶答有效，定時器停止工作，顯示器上顯示選手的編號和搶答的時間，并保持到主持人將系統清除為止。5.如果定時時間已到，無人搶答，本次搶答無效。（二）設計原理與參考電路搶答器的組成框圖搶答器的一般組成框圖如下圖所示。它主要由開關陣列電路、觸發鎖存電路、解鎖電路、編碼電路和顯示電路等幾部分組成。
上傳時間： 2021-11-06
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摘要：在當今高速數字系統設計中，電源完整性的重要性日益突出。其中，電容的正確使用是保證電源完整性的關鍵所在。本文針對旁路電容的濾波特性以及理想電容和實際電容之間的差別，提出了旁路電容選擇的一些建議；在此基礎上，探討了電源擾動及地彈噪聲的產生機理，給出了旁路電容放置的解決方案，具有一定的工程應用價值。 1.引言---隨著系統體積的減小，工作頻率的提高，系統的功能復雜化，這樣就需要多個不同的嵌入式功能模塊同時工作。只有各個模塊具有良好的EMC和較低的EMI，才能保證整個系統功能的實現。這就要求系統自身不僅需要具有良好的屏蔽外界干擾的性能，同時還要求在和其他的系統同時工作時，不能對外界產生嚴重的EMI。另外，開關電源在高速數字系統設計中的應用越來越廣泛，一個系統中往往需要用到多種電源。不僅電源系統容易受到干擾，而且電源供應時產生的噪聲會給整個系統帶來嚴重的EMC問題。因此，在高速PCB設計中，如何更好的濾除電源噪聲是保證良好電源完整性的關鍵。本文分析了電容的濾波特性，電容的寄生電感電容的濾波性能帶來的影響，以及PCB中的電流環現象，繼而針對如何選擇旁路電容做出了一些總結。本文還著重分析了電源噪聲和地彈噪聲的產生機理并在其基礎上對旁路電容在PCB中的各種擺放方式做出了分析和比較。
上傳時間： 2021-11-09
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本論文以西安電子科技大學電路CAD所的科研項目“電源管理類集成電路關鍵技術理論研究與設計”為背景，設計了一款高性能降壓型DC-DC和LDO雙路輸出控制器XD8912.論文首先對電源管理技術的現狀以及發展趨勢作了介紹；隨后分析了線性穩壓器及開關穩壓器的基本結構和工作原理，并對電壓模降壓型PWM DC-DC的原理及其環路穩定性做了深入的研究；最后詳細介紹了XD8912的設計過程，包括芯片性能系統規劃、特性分析、電路實現以及仿真驗證。XD8912不僅集成了大電流、高效率的電壓模降壓型PWM控制器，而且也集成了小電流、低噪聲的線性穩壓控制器，可以為高性能顯卡、主板等設備供電。芯片采用同步整流技術，避免了肖特基二極管的使用，大大提高了芯片的工作效率。芯片內部設計了微調電路提高了電壓基準的精度。設計了內部頻率補償電路取代芯片外部的補償電容，有效提高了芯片的集成度。另外，芯片還集成了完備的保護電路，包括過溫保護、欠壓保護、過流保護等.文中對XD8912的系統及主要功能模塊進行了詳細的分析，并基于0.6um BCD工藝，利用Viewdraw，Hspice等EDA軟件，完成了電路的設計和前仿真驗證仿真結果表明，電路功能和性能指標均已達到設計要求。
上傳時間： 2022-06-23
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Atmel芯片的LINUX菜鳥調試之路目標很明確：1.先直接下載官方的.Bin文件運行，看運行效果2.自己編譯官方源碼，得到.bin文件運行，看運行效果是否和官方的.bin文件一致。3.可以自行修改官方源碼，得到自己設計板子的.bin文件并運行成功。其中bootstrap對于VXworks同樣適用如果是自己做的板子，那么就直接從本文檔的第二個階段開始看即可。首先擁有一塊Atmel的開發板，開發板一般可以向廠家申請（沒有開發板也行，只要你有Atmel的任意一款，自己設計的也可以，可以運行操作系統的板子，例如9260，9200，9625，9G45，9X25等等都行，方法都一樣），此處使用的是AT91SAM9X5-EK，開發板的主CPU是AT91SAM9X25。板子是Atmel官方提供的。要調試板子需要一些對應的軟件環境。1CPU核心板可以貼SAM9G15，SAM9G25，SAM9G35，SAM9×25，SAM9X35等幾個PlIN-TO-PIN的片子，他們的管腳PCB封裝兼容2頻率CPU為400MHZ，總線133MHZ3晶振時鐘晶振12MHZ，32.768KHZ4RAM用的是1Gbit=1204/8=128MB的（DDR2）（miro 美光1.8V的MT47H64M16HR，16位的64M*16bit/8=128MB）5NAND用的是2Gbit=2048/8=256MB的FLASH（miro美光3.3V的MT29F2G08AAD，8位的）6Dataflash SPl的Dataflash是32Mbits=32/8=4MB的7EEPROM EEPROM是512Kbits是512/8=64KB的
上傳時間： 2022-07-24
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壓電陶瓷換能器在醫學超音波儀器的應用
上傳時間： 2013-07-13
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深圳森霸光電公司 光敏傳感器系列
標簽： 光敏傳感器
上傳時間： 2013-05-16
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電子連接器設計基礎
標簽： 接器
上傳時間： 2013-06-21
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交互設計之路
標簽： 交互設計
上傳時間： 2013-04-15
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開關電源基本原理與設計介紹 ppt
標簽： 開關電源
上傳時間： 2013-07-24
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