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布局技術(shù)(shù)

  • 高速電路設(shè)計(jì) 詳細(xì)基礎(chǔ)理論知識(shí)

    設(shè)計(jì)高速電路必須考慮高速訊 號(hào)所引發(fā)的電磁干擾、阻抗匹配及串音等效應(yīng),所以訊號(hào)完整性 (signal  integrity)將是考量設(shè)計(jì)電路優(yōu)劣的一項(xiàng)重要指標(biāo),電路日異複雜必須仰賴可 靠的軟體來(lái)幫忙分析這些複雜的效應(yīng),才比較可能獲得高品質(zhì)且可靠的設(shè)計(jì), 因此熟悉軟體的使用也將是重要的研究項(xiàng)目之一。另外了解高速訊號(hào)所引發(fā)之 各種效應(yīng)(反射、振鈴、干擾、地彈及串音等)及其克服方法也是研究高速電路 設(shè)計(jì)的重點(diǎn)之一。目前高速示波器的功能越來(lái)越多,使用上很複雜,必須事先 進(jìn)修學(xué)習(xí),否則無(wú)法全盤了解儀器之功能,因而無(wú)法有效發(fā)揮儀器的量測(cè)功能。 其次就是高速訊號(hào)量測(cè)與介面的一些測(cè)試規(guī)範(fàn)也必須熟悉,像眼圖分析,探針 效應(yīng),抖動(dòng)(jitter)測(cè)量規(guī)範(fàn)及高速串列介面量測(cè)規(guī)範(fàn)等實(shí)務(wù)技術(shù),必須充分 了解研究學(xué)習(xí),進(jìn)而才可設(shè)計(jì)出優(yōu)良之教學(xué)教材及教具。

    標(biāo)簽: 高速電路

    上傳時(shí)間: 2021-11-02

    上傳用戶:jiabin

  • 網(wǎng)絡(luò)奇技贏巧大搜捕

    網(wǎng)絡(luò)奇技贏巧大搜捕

    標(biāo)簽: 網(wǎng)絡(luò)

    上傳時(shí)間: 2013-04-15

    上傳用戶:eeworm

  • Tanner Pro集成電路設(shè)計(jì)與布局實(shí)戰(zhàn)指導(dǎo)

    Tanner Pro集成電路設(shè)計(jì)與布局實(shí)戰(zhàn)指導(dǎo)

    標(biāo)簽: Tanner Pro 集成電路設(shè)計(jì) 布局

    上傳時(shí)間: 2013-07-11

    上傳用戶:eeworm

  • CMOS電路設(shè)計(jì)·布局與仿真

    CMOS電路設(shè)計(jì)·布局與仿真

    標(biāo)簽: CMOS 電路設(shè)計(jì) 布局 仿真

    上傳時(shí)間: 2013-06-16

    上傳用戶:eeworm

  • --CMOS電路設(shè)計(jì)·布局與仿真-711頁(yè)-62.5M.pdf

    專輯類-實(shí)用電子技術(shù)專輯-385冊(cè)-3.609G --CMOS電路設(shè)計(jì)·布局與仿真-711頁(yè)-62.5M.pdf

    標(biāo)簽: CMOS 62.5 711

    上傳時(shí)間: 2013-06-11

    上傳用戶:love_stanford

  • Tanner-Pro集成電路設(shè)計(jì)與布局實(shí)戰(zhàn)指導(dǎo)-233頁(yè)-3.9M.pdf

    專輯類-EDA仿真相關(guān)專輯-56冊(cè)-2.30G Tanner-Pro集成電路設(shè)計(jì)與布局實(shí)戰(zhàn)指導(dǎo)-233頁(yè)-3.9M.pdf

    標(biāo)簽: Tanner-Pro 233 3.9

    上傳時(shí)間: 2013-04-24

    上傳用戶:royzhangsz

  • 網(wǎng)絡(luò)奇技贏巧大搜捕.pdf

    專輯類-網(wǎng)絡(luò)及電腦相關(guān)專輯-114冊(cè)-4.31G 網(wǎng)絡(luò)奇技贏巧大搜捕.pdf

    標(biāo)簽: 網(wǎng)絡(luò)

    上傳時(shí)間: 2013-07-25

    上傳用戶:小寶愛考拉

  • FPGA低功耗布局布線算法的研究與改進(jìn).rar

    本文對(duì)嵌入硬核的FPGA布線通道寬度分布和改進(jìn)FPGA布局算法進(jìn)行了研究。文章在嵌入硬核的FPGA布線通道寬度分布研究中,引入了四種架構(gòu),其布線通道寬度分布函數(shù)分別為均勻、脈沖、高斯和三角分布。通過(guò)修改VPR工具的源代碼,使平臺(tái)適用于具有嵌入硬核的FPGA架構(gòu),利用MCNC基準(zhǔn)電路來(lái)測(cè)試這四種架構(gòu)的性能。實(shí)驗(yàn)結(jié)果表明:在以網(wǎng)線平均長(zhǎng)度作為指標(biāo)的測(cè)試中,通道寬度均勻分布的架構(gòu)具有更短的布線長(zhǎng)度、更優(yōu)的性能。

    標(biāo)簽: FPGA 低功耗 布局布線

    上傳時(shí)間: 2013-06-01

    上傳用戶:JGR2013

  • 經(jīng)典的DCDC_PCB_布局指南

    TI公司的一片介紹DC-DC的布局的文章,說(shuō)的非常的精彩!也很實(shí)用,可以說(shuō)對(duì)設(shè)計(jì)電源的工程師來(lái)說(shuō),是個(gè)難得的好教程!

    標(biāo)簽: DCDC_PCB 布局

    上傳時(shí)間: 2013-07-27

    上傳用戶:william345

  • 數(shù)字地模擬地的布局原則及布線規(guī)則.pdf

    關(guān)于數(shù)字地和模擬地的布局原則和布線原則,

    標(biāo)簽: 數(shù)字地 布局 布線規(guī)則

    上傳時(shí)間: 2013-07-27

    上傳用戶:WMC_geophy

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