實現(xiàn)了巴特沃斯濾波。用C語言寫的。實現(xiàn)了巴特沃斯濾波。用C語言寫的。
上傳時間： 2017-09-26
上傳用戶：sy_jiadeyi
設(shè)計一個模擬低通巴特沃斯濾波器，我們用MATLAB語言來實現(xiàn)功能
上傳時間： 2016-05-18
上傳用戶：sssforever
有源濾波器精確設(shè)計手冊第107頁2階MFB巴特沃斯帶通濾波器例子的計算
標簽： 有源濾波器
上傳時間： 2022-06-01
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有源濾波器精確設(shè)計手冊第107頁2階MFB巴特沃斯帶通濾波器例子的計算
標簽： 有源濾波器
上傳時間： 2022-06-02
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有源濾波器精確設(shè)計手冊第21頁MFB巴特沃斯低通濾波器例子的計算
上傳時間： 2022-06-03
上傳用戶：wangshoupeng199
巴特渥斯濾波器設(shè)計(butterworth),根據(jù)設(shè)計參數(shù)需要,設(shè)計出符合要求的濾波器,并提供示意圖
標簽： butterworth 波器設(shè)計 設(shè)計參數(shù) 濾波器
上傳時間： 2013-12-29
上傳用戶：古谷仁美
DSP中巴特沃思濾波器的設(shè)計使用Verilog編寫.
上傳時間： 2015-05-06
上傳用戶：三人用菜
本源碼是用于現(xiàn)代譜估計的一種方法：巴特利特主分量估計算法，對3個頻率進行分辨。
上傳時間： 2016-08-10
上傳用戶：busterman
電纜偏心嚴重影響電纜的質(zhì)量，因此在電纜生產(chǎn)時必須要進行偏心檢測。該文針對目前我國電纜偏心檢測技術(shù)落后的現(xiàn)狀，提出采用電渦流檢測方法來研制可以對電纜進行在線實時偏心檢測的自動化系統(tǒng)，并對此項檢測技術(shù)進行了詳細研究。 該文先從偏心傳感器、數(shù)據(jù)采集器和上位機系統(tǒng)三大部分對電渦流式電纜偏心檢測系統(tǒng)進行了整體設(shè)計。完成了偏心傳感器探頭的設(shè)計并解決了偏心傳感器振蕩電路的電源供應(yīng)問題和信號從旋轉(zhuǎn)部件到靜止部件的傳輸問題。以TLC2543A/D轉(zhuǎn)換器和AT89C52單片機為核心器件設(shè)計了數(shù)據(jù)采集器，完成模擬信號到數(shù)字信號的轉(zhuǎn)換，并通過RS-232串行通訊把采樣數(shù)據(jù)傳輸給PC機。利用VisualBasic語言開發(fā)了軟件系統(tǒng)，對接收的數(shù)據(jù)進行了處理并對結(jié)果進行了輸出顯示。 為了提高檢測系統(tǒng)的精度，系統(tǒng)中采用了模擬濾波器和數(shù)字濾波器。根據(jù)檢測系統(tǒng)中信號的特點，分別確定了模擬濾波器和數(shù)字濾波器的性能指標，設(shè)計了抗混疊的3階巴特沃思模擬濾波器和5階橢圓型ⅡR低通數(shù)字濾波器，并采用適當?shù)姆椒ㄟM行了實現(xiàn)。在靜態(tài)的電纜偏心檢測實驗系統(tǒng)中對濾波器的性能進行了驗證。 偏心傳感器是檢測系統(tǒng)中的關(guān)鍵部件，它的性能至關(guān)重要。該文通過構(gòu)造的靜態(tài)實驗系統(tǒng)對偏心傳感器的性能進行了研究，分析了被測電纜線芯直徑、檢測線圈的匝數(shù)和檢測探頭的尺寸對偏心傳感器性能的影響。
上傳時間： 2013-06-19
上傳用戶：yt1993410
作為電子類專業(yè)學(xué)生，實驗是提高學(xué)生對所學(xué)知識的印象以及發(fā)現(xiàn)問題和解決問題的能力，增加學(xué)生動手能力的必須環(huán)節(jié)。本設(shè)計的目的就是開發(fā)一套滿足學(xué)生實驗需求的信號源，基于此目的本信號源并不需要突出的性能，但經(jīng)濟上要求低成本，同時要求操作簡單，能夠輸出多種波形，并且利于學(xué)生在此平臺上認識信號源原理，同時方便在此平臺上進行拓展開發(fā)。 設(shè)計中運用虛擬儀器技術(shù)將計算機屏幕作為儀器面板，采用EPP接口，同時在FPGA上開發(fā)控制電路，為后續(xù)開發(fā)留下了空間，同時節(jié)省了成本。本設(shè)計采用地址線16位，數(shù)據(jù)線12位的靜態(tài)RAM作為信號源的波形存儲器，后端采用兩種濾波類型對需要濾波的信號進行濾波。啟動信號時軟件需要先將波形數(shù)據(jù)預(yù)存在存儲器中便于調(diào)用，最后得到的結(jié)果基本滿足教學(xué)實驗的需求。 本文結(jié)構(gòu)上首先介紹了直接采用DDS芯片制作信號源的利弊，及作者采用這種設(shè)計的初衷，然后介紹了信號源的整體結(jié)構(gòu)，總體模塊。以下章節(jié)首先介紹FPGA內(nèi)部設(shè)計，包括總體結(jié)構(gòu)和幾大部分模塊，包括：時鐘產(chǎn)生電路，相位累加器，數(shù)據(jù)輸入控制電路，濾波器控制電路，信號源啟動控制電路。 然后介紹了其他模塊的設(shè)計，包括存儲器選擇，幅度控制電路的設(shè)計以及濾波器電路的設(shè)計，本設(shè)計的幅度控制采用兩級DA級聯(lián)，以及后端電阻分壓網(wǎng)絡(luò)調(diào)節(jié)的方式進行設(shè)計，提高了幅度調(diào)節(jié)的范圍。對于濾波器的設(shè)計，依據(jù)不同的信號頻率，分成了4個部分，對于500K以下的信號采用的是二階巴特沃斯有源低通濾波，對于500K以上至5M以下信號采用的五階RC低通濾波器。 在軟件設(shè)計部分，分成兩個部分，對于底層驅(qū)動程序采用以Labwindows/CVI為平臺進行開發(fā)，利用其編譯和執(zhí)行速度快，并且和LabVIEW能夠很好連接的特性。對于上層控制軟件，采用以LabVIEW為平臺進行開發(fā)，充分利用其圖化設(shè)計，易于擴展。 論文最后對所做工作進行了總結(jié)，提出了進一步改進的方向。
上傳時間： 2013-04-24
上傳用戶：afeiafei309
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