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工程熱物理;燃燒

  • 基于Altera FPGA CPLD的電子系統設計及工程實踐

    講解到位,工程例子很全,適合下載學習。

    標簽: Altera FPGA CPLD 電子系統設計

    上傳時間: 2013-10-29

    上傳用戶:Pzj

  • MagicSOPC例程編譯異常及解決方法

    1.1 問題產生的環境1.1.1 軟件環境1. PC機的系統為Microsoft Window XP Professional版本2002 Service Pack 2;2. Quartus II V7.0軟件,并安裝了MegaCore IP V7.0;3. NiosII IDE 7.0軟件。1.1.2 硬件環境核心板的芯片是EP2C35F672C8N的MagicSOPC實驗箱的硬件系統。硬件的工作環境是在普通的環境下。1.2 問題的現象在使用MagicSOPC實驗箱的光盤例程時,使用Quartus II編譯工程時出現編譯錯誤,錯誤提示信息如圖1.1、圖1.2所示。

    標簽: MagicSOPC 編譯

    上傳時間: 2013-11-18

    上傳用戶:zhyiroy

  • 基于FPGA 的千兆以太網的設計

    摘要:本文簡要介紹了Xilinx最新的EDK9.1i和ISE9.1i等工具的設計使用流程,最終在采用65nm工藝級別的Xilinx Virtex-5 開發板ML505 上同時設計實現了支持TCP/IP 協議的10M/100M/1000M 的三態以太網和千兆光以太網的SOPC 系統,并對涉及的關鍵技術進行了說明。關鍵詞:FPGA;EDK;SOPC;嵌入式開發;EMAC;MicroBlaze 本研究采用業界最新的Xilinx 65ns工藝級別的Virtex-5LXT FPGA 高級開發平臺,滿足了對于建造具有更高性能、更高密度、更低功耗和更低成本的可編程片上系統的需求。Virtex-5以太網媒體接入控制器(EMAC)模塊提供了專用的以太網功能,它和10/100/1000Base-T外部物理層芯片或RocketIOGTP收發器、SelectIO技術相結合,能夠分別實現10M/100M/1000M的三態以太網和千兆光以太網的SOPC 系統。

    標簽: FPGA 千兆以太網

    上傳時間: 2013-10-14

    上傳用戶:sun_pro12580

  • FPGA連接DDR2的問題討論

    我采用XC4VSX35或XC4VLX25 FPGA來連接DDR2 SODIMM和元件。SODIMM內存條選用MT16HTS51264HY-667(4GB),分立器件選用8片MT47H512M8。設計目標:當客戶使用內存條時,8片分立器件不焊接;當使用直接貼片分立內存顆粒時,SODIMM內存條不安裝。請問專家:1、在設計中,先用Xilinx MIG工具生成DDR2的Core后,管腳約束文件是否還可更改?若能更改,則必須要滿足什么條件下更改?生成的約束文件中,ADDR,data之間是否能調換? 2、對DDR2數據、地址和控制線路的匹配要注意些什么?通過兩只100歐的電阻分別連接到1.8V和GND進行匹配 和 通過一只49.9歐的電阻連接到0.9V進行匹配,哪種匹配方式更好? 3、V4中,PCB LayOut時,DDR2線路阻抗單端為50歐,差分為100歐?Hyperlynx仿真時,那些參數必須要達到那些指標DDR2-667才能正常工作? 4、 若使用DDR2-667的SODIMM內存條,能否降速使用?比如降速到DDR2-400或更低頻率使用? 5、板卡上有SODIMM的插座,又有8片內存顆粒,則物理上兩部分是連在一起的,若實際使用時,只安裝內存條或只安裝8片內存顆粒,是否會造成信號完成性的影響?若有影響,如何控制? 6、SODIMM內存條(max:4GB)能否和8片分立器件(max:4GB)組合同時使用,構成一個(max:8GB)的DDR2單元?若能,則布線阻抗和FPGA的DCI如何控制?地址和控制線的TOP圖應該怎樣? 7、DDR2和FPGA(VREF pin)的參考電壓0.9V的實際工作電流有多大?工作時候,DDR2芯片是否很燙,一般如何考慮散熱? 8、由于多層板疊層的問題,可能頂層和中間層的銅箔不一樣后,中間的夾層后度不一樣時,也可能造成阻抗的不同。請教DDR2-667的SODIMM在8層板上的推進疊層?

    標簽: FPGA DDR2 連接 問題討論

    上傳時間: 2013-10-12

    上傳用戶:han_zh

  • 通信工程施工新技術

    通信工程施工新技術

    標簽: 通信 工程施工 新技術

    上傳時間: 2013-11-06

    上傳用戶:后時代明明

  • 鏈路自適應技術在LTE中的應用

    參照3GPP LTE的E-UTRA物理層規范,提出了一種鏈路自適應方案。實時調整傳輸功率以補償信道的衰落,建立SNR-BLER曲線,在給定滿足一定業務的目標BLER的條件下,找到各個MCS的SNR切換門限值,從而實現鏈路自適應。仿真結果表明,在保證通信質量的前提下,自適應方案比固定MCS有著明顯的頻譜效率增益,使無線資源得到優化配置;同時刪減了頻譜效率沒有增益的MCS,降低系統復雜度。

    標簽: LTE 鏈路 自適應技術 中的應用

    上傳時間: 2013-12-22

    上傳用戶:xsnjzljj

  • 信息網絡工程實習資料

    信息網絡工程實習資料

    標簽: 信息網絡 工程 實習

    上傳時間: 2013-10-18

    上傳用戶:dalidala

  • 力科PCIE 3.0系列文章之三——PCIE 3.0的接收機物理層測試方案

    隨著信號速率的不斷提升,只對高速信號的發送端物理層測試已經不能夠完全反應系統的特性,因此接收機測試也已成為了高速信號的必測項目,尤其是對于信號速率高于5Gbps以上,規范均會規定要求產品必須通過接收機一致性測試。接收端測試的基本原理是測試儀器(通常使用誤碼分析儀或者信號源和能分析誤碼的專用協議分析儀來完成)發出特定的碼型給被測接收端,接收端在環回(Loopback)模式下再將數據接收、恢復后通過其Tx端發送回測試儀器,由測試儀器完成其發出去的數據和接收到的數據的對比,從而分析出誤碼的數量。

    標簽: PCIE 3.0 力科 接收機

    上傳時間: 2013-10-22

    上傳用戶:zukfu

  • 西電通信工程培養方案

    西電通信工程培養方案

    標簽: 通信工程 方案

    上傳時間: 2013-11-07

    上傳用戶:ppeyou

  • 網絡工程概述

    網絡工程概述

    標簽: 網絡工程

    上傳時間: 2013-11-04

    上傳用戶:1109003457

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