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工程測量

  • FPGA開發(fā)光盤各章節(jié)實例的設(shè)計工程與源碼

    附錄 光盤說明\r\n本書附贈的光盤包括各章節(jié)實例的設(shè)計工程與源碼,所有工程在下列軟件環(huán)境下運行通過:\r\n? Windows XP SP2\r\n? MATLAB\r\n? Altera Quartus II \r\n? synplify8.4\r\n? modelsim_ae6.1\r\n\r\n光盤目錄與實例名稱的對應(yīng)關(guān)系如下:\r\n\r\n cht02文件夾中存放的是書中第2章中的例子,讀者可以將一些簡單例子的代碼 \r\n拷貝到MATLAB命令窗口進(jìn)行運行,也可以把

    標(biāo)簽: FPGA 發(fā)光 工程 源碼

    上傳時間: 2013-08-11

    上傳用戶:ecooo

  • FPGA-CPLD在軟件無線電中的工程應(yīng)用 基礎(chǔ)知識

    FPGA-CPLD在軟件無線電中的工程應(yīng)用,基礎(chǔ)知識,課件

    標(biāo)簽: FPGA-CPLD 軟件無線電 工程 基礎(chǔ)知識

    上傳時間: 2013-08-13

    上傳用戶:葉立炫95

  • 很好的幾個FPGA工程設(shè)計實例,Verilog編寫

    很好的幾個FPGA工程,對提高FPGA設(shè)計有一定的幫助(注:代碼為Verilog編寫)。

    標(biāo)簽: Verilog FPGA 工程 設(shè)計實例

    上傳時間: 2013-08-21

    上傳用戶:英雄

  • 在文件夾YL2440_CPLD中有做好的CPLD工程

    在文件夾YL2440_CPLD中有做好的CPLD工程,請用Xilinx ISE 6.2打開.

    標(biāo)簽: CPLD 2440 YL 工程

    上傳時間: 2013-08-26

    上傳用戶:cainaifa

  • USB、串口、并口是PC機(jī)和外設(shè)進(jìn)行通訊的常用接口

    USB、串口、并口是PC機(jī)和外設(shè)進(jìn)行通訊的常用接口,但對于數(shù)據(jù)量大的圖像來說,若利用串行RS-232協(xié)議進(jìn)行數(shù)據(jù)采集,速度不能達(dá)到圖像數(shù)據(jù)采集所需的要求;而用USB進(jìn)行數(shù)據(jù)采集,雖能滿足所需速度,但要求外設(shè)必須支持USB協(xié)議,而USB協(xié)議與常用工程軟件的接口還不普及,給使用帶來困難。有些用戶為了利用標(biāo)準(zhǔn)并行口(SPP)進(jìn)行數(shù)據(jù)采集,但SPP協(xié)議的150kb/s傳輸率對于圖像數(shù)據(jù)采集,同樣顯得太低。因此,為了采集數(shù)據(jù)量大的圖像數(shù)據(jù),本文采用了具有較高傳輸速率的增強(qiáng)型并行口協(xié)議(EPP)和FPGA,實現(xiàn)對OV

    標(biāo)簽: USB PC機(jī) 串口 并口

    上傳時間: 2013-08-31

    上傳用戶:wsf950131

  • 該工程文件實現(xiàn)ARM系統(tǒng)中CPLD的邏輯工作

    該工程文件實現(xiàn)ARM系統(tǒng)中CPLD的邏輯工作,起到外圍資源的邏輯地址譯碼功能

    標(biāo)簽: CPLD ARM 工程

    上傳時間: 2013-09-05

    上傳用戶:zcs023047

  • EDA工程建模及其管理方法研究2

    EDA工程建模及其管理方法研究2 1 隨著微電子技術(shù)與計算機(jī)技術(shù)的日益成熟,電子設(shè)計自動化(EDA)技術(shù)在電子產(chǎn)品與集成電路 (IC)芯片特別是單片集成(SoC)芯片的設(shè)計應(yīng)用中顯得越來越重要。EDA技術(shù)采用“自上至下”的設(shè)計思想,允許設(shè)計人員能夠從系統(tǒng)功能級或電路功能級進(jìn)行產(chǎn)品或芯片的設(shè)計,有利于產(chǎn)品在系統(tǒng)功能上的綜合優(yōu)化,從而提高了電子設(shè)計項目的協(xié)作開發(fā)效率,降低新產(chǎn)品的研發(fā)成本。 近十年來,EDA電路設(shè)計技術(shù)和工程管理方面的發(fā)展主要呈現(xiàn)出兩個趨勢: (1) 電路的集成水平已經(jīng)進(jìn)入了深亞微米的階段,其復(fù)雜程度以每年58%的幅度迅速增加,芯片設(shè)計的抽象層次越來越高,而產(chǎn)品的研發(fā)時限卻不斷縮短。 (2) IC芯片的開發(fā)過程也日趨復(fù)雜。從前期的整體設(shè)計、功能分,到具體的邏輯綜合、仿真測試,直至后期的電路封裝、排版布線,都需要反復(fù)的驗證和修改,單靠個人力量無法完成。IC芯片的開發(fā)已經(jīng)實行多人分組協(xié)作。由此可見,如何提高設(shè)計的抽象層次,在較短時間內(nèi)設(shè)計出較高性能的芯片,如何改進(jìn)EDA工程管理,保證芯片在多組協(xié)作設(shè)計下的兼容性和穩(wěn)定性,已經(jīng)成為當(dāng)前EDA工程中最受關(guān)注的問題。

    標(biāo)簽: EDA 工程建模 管理方法

    上傳時間: 2013-11-10

    上傳用戶:yan2267246

  • 基于參數(shù)自整定的瀝青灑布量控制

      根據(jù)比例因子與系統(tǒng)性能的關(guān)系和整定原則,得到可行的整定規(guī)則表,對瀝青撒布控制系統(tǒng)采用了參數(shù)自整定模糊控制算法控制噴灑的壓力,實現(xiàn)了灑布量的穩(wěn)定精確控制,提高了灑布質(zhì)量和生產(chǎn)效率。

    標(biāo)簽: 參數(shù) 自整定 瀝青 控制

    上傳時間: 2013-11-01

    上傳用戶:竺羽翎2222

  • 匹配傅里葉變換快速算法及在雷達(dá)信號處理中應(yīng)用

    為了減小匹配傅里葉變換分析的計算量,提出了一種基于快速傅里葉變換的快速算法。根據(jù)匹配傅里葉變換的分解將積分形式轉(zhuǎn)化為離散形式,推導(dǎo)出快速算法表達(dá)式。該算法與直接的數(shù)值離散匹配傅里葉變換算法相比較,計算量大大減少。同時給出了其在雷達(dá)信號處理中線性調(diào)頻信號的檢測與參數(shù)估計的應(yīng)用。理論及計算機(jī)仿真結(jié)果表明了該算法的有效性和精確性,有良好的工程應(yīng)用前景。

    標(biāo)簽: 傅里葉變換 快速算法 雷達(dá)信號處理

    上傳時間: 2013-10-21

    上傳用戶:chongchong1234

  • 開環(huán)電壓增益AVOL的定義與量測方法

    運算放大器,開環(huán)電壓增益AVOL的定義與量測方法。

    標(biāo)簽: AVOL 開環(huán) 增益 定義

    上傳時間: 2013-11-18

    上傳用戶:rtsm07

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