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小實(shí)驗(yàn)

  • LED結(jié)溫預(yù)算軟件_測試貼片熱阻小軟件

    測試貼片熱阻小軟件

    標(biāo)簽: LED 軟件 結(jié)溫 測試

    上傳時(shí)間: 2013-11-03

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  • mil與mm換算的一個(gè)小軟件(對(duì)LAYOUT工作者是個(gè)不錯(cuò)的工具)

    mil 與mm換算的一個(gè)小軟件,對(duì)LAYOUT工作者是個(gè)不錯(cuò)的工具。

    標(biāo)簽: LAYOUT mil 軟件

    上傳時(shí)間: 2013-11-18

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  • 小U盤變身最強(qiáng)大路由器

    小U盤變身最強(qiáng)大路由器

    標(biāo)簽: U盤 路由器

    上傳時(shí)間: 2013-10-15

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  • PCB阻抗匹配計(jì)算工具(附教程)

    附件是一款PCB阻抗匹配計(jì)算工具,點(diǎn)擊CITS25.exe直接打開使用,無需安裝。附件還帶有PCB連板的一些計(jì)算方法,連板的排法和PCB聯(lián)板的設(shè)計(jì)驗(yàn)驗(yàn)。 PCB設(shè)計(jì)的經(jīng)驗(yàn)建議:       1.一般連板長寬比率為1:1~2.5:1,同時(shí)注意For FuJi Machine:a.最大進(jìn)板尺寸為:450*350mm,       2.針對(duì)有金手指的部分,板邊處需作掏空處理,建議不作為連板的部位.     3.連板方向以同一方向?yàn)閮?yōu)先,考量對(duì)稱防呆,特殊情況另作處理.     4.連板掏空長度超過板長度的1/2時(shí),需加補(bǔ)強(qiáng)邊.       5.陰陽板的設(shè)計(jì)需作特殊考量.       6.工藝邊需根據(jù)實(shí)際需要作設(shè)計(jì)調(diào)整,軌道邊一般不少於6mm,實(shí)際中需考量板邊零件的排布,軌道設(shè)備正常卡壓距離為不少於3mm,及符合實(shí)際要求下的連板經(jīng)濟(jì)性.       7.FIDUCIAL MARK或稱光學(xué)定位點(diǎn),一般設(shè)計(jì)在對(duì)角處,為2個(gè)或4個(gè),同時(shí)MARK點(diǎn)面需平整,無氧化,脫落現(xiàn)象;定位孔設(shè)計(jì)在板邊,為對(duì)稱設(shè)計(jì),一般為4個(gè),直徑為3mm,公差為±0.01inch.       8.V-cut深度需根據(jù)連板大小及基板板厚考量,角度建議為不少於45°.       9.連板設(shè)計(jì)的同時(shí),需基於基板的分板方式考量<人工(治具)還是使用分板設(shè)備>.  10.使用針孔(郵票孔)聯(lián)接:需請(qǐng)考慮斷裂后的毛刺,及是否影響COB工序的Bonding機(jī)上的夾具穩(wěn)定工作,還應(yīng)考慮是否有無影響插件過軌道,及是否影響裝配組裝. 

    標(biāo)簽: PCB 阻抗匹配 計(jì)算工具 教程

    上傳時(shí)間: 2013-10-15

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  • 帶指示燈的中九小板電路圖

    帶指示燈的中九小板電路圖

    標(biāo)簽: 指示燈 小板電路

    上傳時(shí)間: 2013-11-03

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  • DVB-DVD通用升級(jí)小板2

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    標(biāo)簽: DVB-DVD

    上傳時(shí)間: 2013-11-12

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  • Allegro顯示及操作小技巧七條

    Allegro顯示及操作小技巧七條

    標(biāo)簽: Allegro 操作

    上傳時(shí)間: 2013-11-11

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  • 電工小軟件合集

    電工小軟件合集

    標(biāo)簽: 電工 軟件

    上傳時(shí)間: 2013-11-23

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  • ResCal1一款電阻串并連快速計(jì)算小工具

    一款電阻串并連快速計(jì)算小工具

    標(biāo)簽: ResCal1 電阻 計(jì)算

    上傳時(shí)間: 2013-10-08

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  • 寫給小白們的FPGA入門設(shè)計(jì)實(shí)驗(yàn)

      寫給小白們的FPGA入門設(shè)計(jì)實(shí)驗(yàn):   1. 寫在前面的話    2   2. Lab 1 : LCD1602 字符顯示設(shè)計(jì)  3   2.1. 摘要   2.2. 內(nèi)容   2.3. 程序   2.4. 結(jié)果(問題,解決,體會(huì))   3. Lab 2 : 4 位減法、加法器設(shè)計(jì)   3.1. 摘要   3.2. 內(nèi)容   3.3. 程序   3.4. 結(jié)果(問題,解決,體會(huì))   4. Lab 3 :三位二進(jìn)制乘法器設(shè)計(jì)   4.1. 摘要   4.2. 內(nèi)容   4.3. 程序   4.4. 結(jié)果(問題,解決,體會(huì))   5. Lab 4 :序列檢測器設(shè)計(jì)   6. Lab 5 :變模計(jì)數(shù)器設(shè)計(jì)   

    標(biāo)簽: FPGA 設(shè)計(jì)實(shí)驗(yàn)

    上傳時(shí)間: 2013-11-07

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