太陽能發電在世界能源危機的今天飛速發展,已成為新能源的主流之一。逆變器作為主要的能量變換裝置器件,其性能的好壞直接影響著整個光伏系統的效率。本文采用電壓外環、電流內環的雙環控制策略,保證了系統的動態響應速度快,穩態誤差小。為此,論文主要對系統的電路拓撲結構、數學模型、控制方法以及基于FPGA的軟件實現方法等技術進行了分析研究。 本文首先通過對幾種常見的數學模型分析方法的比較,選擇適合本文的數學建模方法。文中給出了逆變器的拓撲結構,詳細論述了其工作原理,對該逆變器不同工作狀態下的等效電路進行分析,并利用狀態空間平均法建立了逆變器數學模型,確定主要元件的參數。 隨后對當前比較流行的幾種逆變電路的控制方法進行了對比分析。本文采用的基于SPWM控制的電壓電流雙環控制的算法,具有開關頻率固定、物理意義清晰、實現方便的優點,保證系統的穩態誤差小,動態響應速度快。通過分析幾種最大功率跟蹤算法各自的優缺點,最后給出了改進的最大功率跟蹤算法,保證系統輸出最大功率。 最后用FPGA實現了系統控制方案的設計。整機測試結果表明:該逆變器的性能指標基本達到了設計要求,驗證了數學模型和控制策略的有效性和理論分析的正確性和可行性。
上傳時間: 2013-07-25
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現實生活中的語音不可避免的要受到周圍環境的影響,背景噪聲例如機械噪聲、街頭音樂噪音,其他說話者的話音等均會嚴重地影響語音信號的質量:此外傳輸系統本身也會產生各種噪聲,因此接收端的信號為帶噪語音信號。混疊在語音信號中的噪聲按類別可分為環境噪聲等的加法性噪聲及電器線路干擾等的乘法性噪聲;按性質可分為平穩噪聲和非平穩噪聲。 語音增強的根本目的就是凈化語音質量。把不需要的噪音減低到最小程度。但是由于噪音的復雜性,很難歸納出一個統一的特征,因此不可能尋求一種算法完全適應于所有的噪音消除,因此語音增強是一個復雜的工程。 有關抗噪聲技術的研究以及實際環境下的語音信號處理系統的開發,在國內外已經成為語音信號處理非常重要的研究課題,已經作了大量的研究工作,取得了豐富的研究成果。本文僅對加性噪聲下的語音增強技術做了較為仔細的討論,我們先給出語音信號處理的基本理論,它是語音增強算法研究和實現的理論基礎,在此基礎總結了自適應信號處理技術的特點以及在語音增強方面的應用。選取工程領域最常用的自適應LMS濾波算法和RLS濾波算法作為研究對象,提出了利用最小均方誤差意義下自適應濾波器的輸出信號與主通道噪聲信號的等效關系,得到濾波器最佳自適應參數的方法,并分析了在平穩和非平穩噪聲環境下,L M S濾波器族和R L S濾波器在不同噪音輸入下的權系數收斂速度、權系數穩定性、跟蹤輸入信號的能力和信噪比的改善等特性。 研究了MATLAB語言程序設計和使用MALTLAB對語音算法進行仿真、并輸入了多種實際環境下的噪音進行濾波仿真并對仿真的結果進行比較和分析。總結出了LMS、NLMS、SIGN-ERROR-LMS、RLS自適應濾波器在語音濾波方面的特點 和應用情況。 最后在MATLAB仿真的基礎上,利用Altera公司的Cyclone2系列FPGA芯片和多種EDA工具,完成了L M S自適應濾波器的FPGA設計。 關鍵詞:語音增強,背景噪音,自適應濾波器,LMS,RLS,FPGA
上傳時間: 2013-04-24
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無刷直流電機以體積小、重量輕、效率高、調速性能好、無換向火花及無勵磁損耗等諸多優點被大量應用于家電、交通、醫療器械、數控機床及機器人等領域,現代工業的快速發展對無刷直流電機控制系統的性能要求也越來越高。可以預見,隨著永磁材料和電力電子器件價格進一步的降低,無刷直流電機驅動理論的研究不斷深入,無刷直流電機的應用前景將更加廣泛。 本文通過閱讀大量文獻資料,介紹了無刷直流電機的發展現狀、研究動態及工作原理等。在控制策略上,采用了基于智能控制思想的模糊控制,其特點是不依賴于對象模型,利用制定的控制規則進行了模糊推理從而獲得合適的控制量。運用Matlab/Simulink對控制系統進行了建模和仿真,其中速度環采用模糊PI調節,電流環采用傳統的PI調節,為后面的實驗提供了理論分析的基礎。 結合無刷直流電機的結構,利用電機內部的霍爾元件檢測轉子位置。根據模糊控制器的設計方法,給出了模糊控制查詢表。采用TI公司的數字信號處理器TMS320F2812作為主控芯片,在硬件上設計了整流電路、逆變電路、驅動電路、調理及保護電路等;在DSP軟件開發環境CCS下,采用C語言和匯編語言進行了混合編程,實現了轉子位置信號的讀取、PWM波的產生、AD采樣、速度模糊PI調節及電流調節等功能。 通過對整個控制系統的軟硬件聯合調試,進行了相關實驗。相對傳統的控制系統,采用模糊PI控制的系統具有響應速度快、超調量小、穩定性好等優點。實驗結果表明了無刷直流電機模糊控制系統設計的正確性。最后對整個設計進行了總結,對后續的工作給出了自己的見解。
上傳時間: 2013-04-24
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諧振變換器相對硬開關PWM變換器,具有開關頻率高、關斷損耗小、效率高、重量輕、體積小、EMI噪聲小、開關應力小等優點。而LLC諧振變換器具有原邊開關管易實現全負載范圍內的ZVS,次級二極管易實現ZCS諧振電感和變壓器易實現磁性元件的集成,以及輸入電壓范圍寬等優點,因而得到了廣泛的關注。 本文對諧振變換器的基本分類和各種諧振變換器的優缺點進行了比較和總結,并與傳統PWM變換器進行了對比,總結出LLC諧振變換器的主要優點。并以400W LLC諧振變換器為目標設計,LLC前級使用APFC電路,后一級是LLC諧振變換器。 首先,基于FHA(基波分析法)的方法對LLC諧振變換器進了穩態電路的分析,并詳細闡述了LLC諧振變換器在各個開關頻率范圍內的工作原理和工作特性。隨后,文章詳細比較了LLC諧振變換器與傳統的諧振變換器和半橋PWM變換器不同之處。 然后,文章分別采用分段線性法和擴展描述函數法建立了LLC諧振變換器的小信號模型。由于分段線性法建立的小信號模型僅考慮了LLC諧振變換器工作在滿負載的情況下,為了建立更具一般性的模型,論文又采用了擴展描述函數法建模,用以指導控制環路的設計。 接著,論文對整個系統進行了綜合設計。文章給出了APFC部分的主電路和控制補償回路的具體設計;同時,也做出了LLC諧振變換器主電路的具體設計,而LLC諧振變換器控制回路的設計,仍需要更深一步的研究,并需提出一種切實可行的設計方法。 最后,采用Pspiee軟件建立了仿真模型。仿真結果得出LLC諧振變換器能在負載和輸入電壓變化范圍都很大的情況下實現輸出電壓的穩定調節,并能實現場效應管和二極管的軟開關,驗證了理論分析的正確性;由于實驗條件的限制,制作的實驗電路板處于調試之中,希望進一步驗證理論設計的正確性。
上傳時間: 2013-04-24
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由于世界能源危機的日益嚴重和全球環境的不斷惡化,大規模開發清潔可再生能源成為當前能源戰略的主要方向。太陽能作為當前世界上最清潔、最現實、最有大規模開發利用前景的可再生能源之一,得到了各界的廣泛關注。在太陽能的利用中,光伏發電并網又是其主要發展方向之一。 由于光伏產業界目前還沒有統一的標準,又因為功率等級及應用場合的不同,使各種拓撲結構的光伏并網變流器都得以嘗試使用。本文就是在此背景下,對當前使用的各類光伏并網變流器的拓撲結構和控制方法進行比較,并結合光伏并網系統實際應用中暴露的主要缺陷,從適應光伏陣列輸出特性和提高系統整體的可靠性兩方面入手,提出Z-source變換器結合PWM整流器的拓撲結構。 文章首先介紹了光伏并網系統中并網變流器的三種隔離回路方式,及應用于小功率和中大功率場合的不同主電路拓撲結構及控制策略,比較其優缺點,提出了Z-source變換器結合PWM整流組成的光伏發電系統。這種拓撲結構可以減小系統中電解電容的體積容量,并解決由太陽能電池板輸出電壓大范圍變化所帶來一系列問題,同時可以在一定程度上改善系統的可靠性問題。其次,文中分析介紹了Z-source變換器的工作原理,對比了三種升壓控制的實現方式和性能差異,并簡述了逆變器的三種SPWM電流控制策略及其優缺點。最后,結合整體系統需要,將Z-source變換器的升壓控制與PWM整流器的并網控制融合,提出完成逆變并網功能和最大功率點跟蹤的控制思想。 根據上述分析和研究,選定整體光伏系統的硬件結構和控制方案。詳細闡述了系統硬件部分的設計計算,提供了系統主電路結構、參數計算、元件選型和控制電路的設計的詳細說明,并完成了主電路硬件的制作。根據空間狀態方程法對光伏發電系統進行仿真建模,仿真模型包括主電路拓撲及各控制子模塊,文中簡要說明各控制模塊的功能,給出仿真結果并進行分析。驗證該系統可以較好的實現本文提出的控制方案所應完成的各項功能,系統工作穩定可靠,性能良好。
上傳時間: 2013-07-12
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本書主要闡述設計射頻與微波功率放大器所需的理論、方法、設計技巧,以及將分析計算與計算機輔助設計相結合的優化設計方法。這些方法提高了設計效率,縮短了設計周期。本書內容覆蓋非線性電路設計方法、非線性主動設備建模、阻抗匹配、功率合成器、阻抗變換器、定向耦合器、高效率的功率放大器設計、寬帶功率放大器及通信系統中的功率放大器設計。 本書適合從事射頻與微波動功率放大器設計的工程師、研究人員及高校相關專業的師生閱讀。 作者簡介 Andrei Grebennikov是M/A—COM TYCO電子部門首席理論設計工程師,他曾經任教于澳大利亞Linz大學、新加坡微電子學院、莫斯科通信和信息技術大學。他目前正在講授研究班課程,在該班上,本書作為國際微波年會論文集。 目錄 第1章 雙口網絡參數 1.1 傳統的網絡參數 1.2 散射參數 1.3 雙口網絡參數間轉換 1.4 雙口網絡的互相連接 1.5 實際的雙口電路 1.5.1 單元件網絡 1.5.2 π形和T形網絡 1.6 具有公共端口的三口網絡 1.7 傳輸線 參考文獻 第2章 非線性電路設計方法 2.1 頻域分析 2.1.1 三角恒等式法 2.1.2 分段線性近似法 2.1.3 貝塞爾函數法 2.2 時域分析 2.3 NewtOn.Raphscm算法 2.4 準線性法 2.5 諧波平衡法 參考文獻 第3章 非線性有源器件模型 3.1 功率MOSFET管 3.1.1 小信號等效電路 3.1.2 等效電路元件的確定 3.1.3 非線性I—V模型 3.1.4 非線性C.V模型 3.1.5 電荷守恒 3.1.6 柵一源電阻 3.1.7 溫度依賴性 3.2 GaAs MESFET和HEMT管 3.2.1 小信號等效電路 3.2.2 等效電路元件的確定 3.2.3 CIJrtice平方非線性模型 3.2.4 Curtice.Ettenberg立方非線性模型 3.2.5 Materka—Kacprzak非線性模型 3.2.6 Raytheon(Statz等)非線性模型 3.2.7 rrriQuint非線性模型 3.2.8 Chalmers(Angek)v)非線性模型 3.2.9 IAF(Bemth)非線性模型 3.2.10 模型選擇 3.3 BJT和HBT汀管 3.3.1 小信號等效電路 3.3.2 等效電路中元件的確定 3.3.3 本征z形電路與T形電路拓撲之間的等效互換 3.3.4 非線性雙極器件模型 參考文獻 第4章 阻抗匹配 4.1 主要原理 4.2 Smith圓圖 4.3 集中參數的匹配 4.3.1 雙極UHF功率放大器 4.3.2 M0SFET VHF高功率放大器 4.4 使用傳輸線匹配 4.4.1 窄帶功率放大器設計 4.4.2 寬帶高功率放大器設計 4.5 傳輸線類型 4.5.1 同軸線 4.5.2 帶狀線 4.5.3 微帶線 4.5.4 槽線 4.5.5 共面波導 參考文獻 第5章 功率合成器、阻抗變換器和定向耦合器 5.1 基本特性 5.2 三口網絡 5.3 四口網絡 5.4 同軸電纜變換器和合成器 5.5 wilkinson功率分配器 5.6 微波混合橋 5.7 耦合線定向耦合器 參考文獻 第6章 功率放大器設計基礎 6.1 主要特性 6.2 增益和穩定性 6.3 穩定電路技術 6.3.1 BJT潛在不穩定的頻域 6.3.2 MOSFET潛在不穩定的頻域 6.3.3 一些穩定電路的例子 6.4 線性度 6.5 基本的工作類別:A、AB、B和C類 6.6 直流偏置 6.7 推挽放大器 6.8 RF和微波功率放大器的實際外形 參考文獻 第7章 高效率功率放大器設計 7.1 B類過激勵 7.2 F類電路設計 7.3 逆F類 7.4 具有并聯電容的E類 7.5 具有并聯電路的E類 7.6 具有傳輸線的E類 7.7 寬帶E類電路設計 7.8 實際的高效率RF和微波功率放大器 參考文獻 第8章 寬帶功率放大器 8.1 Bode—Fan0準則 8.2 具有集中元件的匹配網絡 8.3 使用混合集中和分布元件的匹配網絡 8.4 具有傳輸線的匹配網絡 8.5 有耗匹配網絡 8.6 實際設計一瞥 參考文獻 第9章 通信系統中的功率放大器設計 9.1 Kahn包絡分離和恢復技術 9.2 包絡跟蹤 9.3 異相功率放大器 9.4 Doherty功率放大器方案 9.5 開關模式和雙途徑功率放大器 9.6 前饋線性化技術 9.7 預失真線性化技術 9.8 手持機應用的單片cMOS和HBT功率放大器 參考文獻
上傳時間: 2013-04-24
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51單片機最最小系統,作為學習參考,對大家有幫助
上傳時間: 2013-07-28
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現場可編程門陣列(FPGA)的發展已經有二十多年,從最初的1200門發展到了目前數百萬門至上千萬門的單片FPGA芯片。現在,FPGA已廣泛地應用于通信、消費類電子和車用電子類等領域,但國內市場基本上是國外品牌的天下。 在高密度FPGA中,芯片上時鐘分布質量變的越來越重要,時鐘延遲和時鐘偏差已成為影響系統性能的重要因素。目前,為了消除FPGA芯片內的時鐘延遲,減小時鐘偏差,主要有利用延時鎖相環(DLL)和鎖相環(PLL)兩種方法,而其各自又分為數字設計和模擬設計。雖然用模擬的方法實現的DLL所占用的芯片面積更小,輸出時鐘的精度更高,但從功耗、鎖定時間、設計難易程度以及可復用性等多方面考慮,我們更愿意采用數字的方法來實現。 本論文是以Xilinx公司Virtex-E系列FPGA為研究基礎,對全數字延時鎖相環(DLL)電路進行分析研究和設計,在此基礎上設計出具有自主知識產權的模塊電路。 本文作者在一年多的時間里,從對電路整體功能分析、邏輯電路設計、晶體管級電路設計和仿真以及最后對設計好的電路仿真分析、電路的優化等做了大量的工作,通過比較DLL與PLL、數字DLL與模擬DLL,深入的分析了全數字DLL模塊電路組成結構和工作原理,設計出了符合指標要求的全數字DLL模塊電路,為開發自我知識產權的FPGA奠定了堅實的基礎。 本文先簡要介紹FPGA及其時鐘管理技術的發展,然后深入分析對比了DLL和PLL兩種時鐘管理方法的優劣。接著詳細論述了DLL模塊及各部分電路的工作原理和電路的設計考慮,給出了全數字DLL整體架構設計。最后對DLL整體電路進行整體仿真分析,驗證電路功能,得出應用參數。在設計中,用Verilog-XL對部分電路進行數字仿真,Spectre對進行部分電路的模擬仿真,而電路的整體仿真工具是HSIM。 本設計采用TSMC0.18μmCMOS工藝庫建模,設計出的DLL工作頻率范圍從25MHz到400MHz,工作電壓為1.8V,工作溫度為-55℃~125℃,最大抖動時間為28ps,在輸入100MHz時鐘時的功耗為200MW,達到了國外同類產品的相應指標。最后完成了輸出電路設計,可以實現時鐘占空比調節,2倍頻,以及1.5、2、2.5、3、4、5、8、16時鐘分頻等時鐘頻率合成功能。
上傳時間: 2013-06-10
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移動無線信道特性對移動通信系統性能具有重要影響,移動信道建模和仿真對移動通信系統的研發具有重要意義。因此,對移動信道建模與仿真進行研究,具有重要的理論意義和實際應用價值。 本文從無線電波的傳播特點出發,分析了無線電波的傳播模型和描述信道特性的主要參數,重點分析了移動小尺度衰落模型;結合無線電波傳輸環境的特點,研究了平坦衰落信道和頻率選擇性信道的特點,設計了基于FPGA的移動無線信道仿真器,同時給予了軟硬件驗證。 本文從衰落的數學模型角度研究了信道傳輸特性,以及各項參數對信道特性的影響。主要做了以下幾個方面的工作: 1.簡要介紹了無線電通信的發展史及信道建模與仿真的意義;論述了信道對無線信號主要的三類影響:自由空間的路徑損失、陰影衰落、多徑衰落;分析了無線通信傳播環境,移動無線通信信道仿真的基本模型,同時介紹了用正弦波疊加法和成型濾波器法建立信道確定型仿真模型的具體實現方法。 2.對移動無線信道特性進行了Matlab仿真,對仿真結果進行了對比分析,對影響信道特性的主要參數設置進行了分析仿真。 3.設計了一種基于FPGA的移動無線信道仿真器,并對實現該仿真器的關鍵技術和實現方法進行了分析。該信道仿真器能夠實時模擬窄帶信號條件下無線信道的主要特點,如多徑時延、多普勒頻移、瑞利衰落等,其主要的技術指標達到了設計要求。該模擬器結構簡單,參數可調,易于擴展,通用性強,可以部分或全部集成到處于研制階段的接收機中,以便于性能測試,也可應用于教學實踐。
上傳時間: 2013-04-24
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人臉自動識別技術是模式識別、圖像處理等學科的一個最熱門研究課題之一。隨著社會的發展,各方面對快速有效的自動身份驗證的要求日益迫切,而人臉識別技術作為各種生物識別技術中最重要的方法之一,已經越來越多的受到重視。對于具有實時,快捷,低誤識率的高性能算法以及對算法硬件加速的研究也逐漸展開。 本文詳細分析了智能人臉識別算法原理,發展概況和前景,包括人臉檢測算法,人眼定位算法,預處理算法,PCA和ICA 算法,詳細分析了項目情況,系統劃分,軟硬件平臺的資源和使用。并在ISE軟件平臺上,用硬件描述語言(verilog HDL)對算法部分嚴格按照FPGA代碼風格進行了RTL 硬件建模,并對C++算法進行了優化處理,通過仿真與軟件算法結果進行比對,評估誤差,最后在VirtexII Pro FPGA 上進行了綜合實現。 主要研究內容如下: 首先,對硬件平臺xilinx的VirtexII Pro FPGA 上的系統資源進行了描述和研究,對存儲器sdram,RS-232 串口,JTAG 進行了研究和調試,對Coreconnect的OPB總線仲裁機理進行了兩種算法的比較,RTL 設計,仿真和綜合。利用ISE和VC++軟件平臺,對verilog和C++算法進行同步比較測試,使每步算法對應正確的結果。對軟硬件平臺的合理使用使得在項目中能盡可能多的充分利用硬件資源,制板時正確選型,以及加快設計和調試進度。其次,對人臉識別算法流程中的人臉檢測,人眼定位,預處理,識別算法分別進行了比較研究,選取其中各自性能最好的一種算法對其原理進行了分析討論。人臉檢測采用adaboost 算法,因其速度和精度的綜合性能表現優異。人眼定位采用小塊合并算法,因為它具有快速,準確,弱時實的特點。預處理算法采用直方圖均衡加平滑的算法,簡單,高效。 識別算法采用PCA 加ICA 算法,它能最大的弱化姿態和光照對人臉識別的影響。 最后,使用Verilog HDL 硬件描述語言進行算法的RTL 建模,在C++算法的基礎上,保證原來效果的前提下,根據FPGA 硬件特點對算法進行了優化。視頻輸入輸出是人臉識別的前提,它提供FPGA 上算法需要處理的數據,預處理算法在C++算法的基礎上進行了優化,最大的減少了運算量,提高了運算速度,16 位計算器模塊使得在算法實現時可以根據系統要求,在FPGA的ip 核和自己設計的模塊之間選擇性能更好的一個來調用,FIFO的設計提供同步和異步時鐘域的數據緩存。設計在ISE和VC++軟件平臺同時進行,隨時對verilog和C++數據進行監測和比對。全部設計模塊通過仿真,達到預定的性能要求,并在FPGA 上綜合實現。
上傳時間: 2013-07-13
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