全加器的VHDL程序實現及仿真
標簽： VHDL 全加器 仿真 程序
上傳時間： 2014-01-13
上傳用戶：hoperingcong
分枝定界法，運籌學
標簽： 分
上傳時間： 2013-12-11
上傳用戶：Shaikh
隨機產生10道互不相同的20以內的加減法（加減數及和差均<=20）待用戶答完題后，顯示用戶的得分、評語及正確答案。并帶彩色，計時器和系統日期和時間。這是我的匯編課程設計！
標簽： lt 20 隨機 減法
上傳時間： 2014-01-07
上傳用戶：李彥東
vc小計算器,實現加減乘除功能.
標簽： 計算器 減
上傳時間： 2015-03-04
上傳用戶：851197153
VHDL實現的超前進位加法器
標簽： VHDL 進位 加法器
上傳用戶：leehom61
des加解密程序
標簽： des 加解密 程序
上傳用戶：kernaling
windows下的DES文件加解密程序
標簽： windows DES 文件加解密 程序
上傳時間： 2015-03-07
上傳用戶：yd19890720
linux下的DES文件加解密
標簽： linux DES 文件加解密
上傳用戶：yangbo69
aes加解密算法源代碼
標簽： aes 加解密 算法 源代碼
上傳時間： 2013-12-09
上傳用戶：sy_jiadeyi
verilog編寫的32位浮點加法器
標簽： verilog 編寫 浮點 加法器
上傳時間： 2015-03-09
上傳用戶：372825274
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