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定位芯片

  • AD6525芯片參考設計電路原理圖

    基帶芯片AD6525的應用電路。在05年之前的手機中應用非常廣泛,配合AD652x的幾款芯片便可完成手機信號處理中的大部分功能。

    標簽: 6525 AD 芯片 參考設計

    上傳時間: 2013-04-24

    上傳用戶:guanliya

  • LED顯示屏單元板芯片介紹

    LED顯示屏單元板芯片介紹 IC的管腳功能 IC芯片分別:74HC245、74HC595、74HC138、74HC04、4953。各IC管腳功能如下: A: 74HC245功能是放大及緩沖。各引腳如圖 20 和1接電源(+5V) 19腳和10腳接電源地(GND)

    標簽: LED 顯示屏 單元板 芯片介紹

    上傳時間: 2013-05-17

    上傳用戶:小楊高1

  • ISD4004-16M語音芯片的循環錄放電路設計

    針對ISD 語音芯片的特點, 設計一種由單片機控制, 能夠循環錄放的語音電路,可作為錄音機、復讀機、音頻記錄儀使用, 既節省存儲空間, 又降低成本, 具有較高的實用價值。

    標簽: 4004 ISD 16 語音芯片

    上傳時間: 2013-06-24

    上傳用戶:yiwen213

  • 四關節實驗室機器人控制器的研制

    在機器人學的研究領域中,如何有效地提高機器人控制系統的控制性能始終是研究學者十分關注的一個重要內容。在分析了工業機器人的發展歷程和機器人控制系統的研究現狀后,本論文的主要目標是針對四關節實驗室機器人特有的機械結構和數學模型,建立一個新型全數字的基于DSP和FPGA的機器人位置伺服控制系統的軟、硬件平臺,實現對四關節實驗室機器人的精確控制。 本論文從實際情況出發,首先分析了所研究的四關節實驗室機器人的本體結構,并對其抽象簡化得到了它的運動學數學模型。在明確了實現機器人精確位置伺服控制的控制原理后,我們對機器人控制系統的諸多可行性方案進行了充分論證,并最終決定采用了三級CPU控制的控制體系結構:第一級CPU為上位計算機,它實現對機器人的系統管理、協調控制以及完成機器人實時軌跡規劃等控制算法的運算;第二級CPU為高性能的DSP處理器,它輔之以具有高速并行處理能力的FPGA芯片,實現了對機器人多個關節的高速并行驅動;第三級CPU為交流伺服驅動處理器,它實現了機器人關節伺服電機的精確三閉環誤差驅動控制,以及電機的故障診斷和自動保護等功能。此外,我們采用比普通UART速度快得多的USB來實現上位計算機.與下位控制器之間的數據通信,這樣既保證了兩者之間連接方便,又有效的提高了控制系統的通信速度和可靠性。 機器人系統的軟件設計包括兩個部分:一是采用VC++實現的上位監控軟件系統,它主要負責機器人實時軌跡規劃等控制算法的運算,同時完成用戶與機器人系統之間的信息交互;二是采用C語言實現的下位DSP控制程序,它主要負責接收上位監控系統或者下位控制箱發送的控制信號,實現對機器人的實時驅動,同時還能夠實時的向上位監控系統或者下位控制箱反饋機器人的當前狀態信息。 研究開發出來的四關節實驗室機器人控制器具有控制實時性好、定位精度高、運行穩定可靠的特點,它允許用戶通過上位控制計算機實現對機器人的各種設定作業的控制,也可以讓用戶通過機器人控制箱現場對機器人進行回零、示教等各項操作。

    標簽: 實驗室 機器人控制器

    上傳時間: 2013-04-24

    上傳用戶:極客

  • Altera FPGA芯片的封裝尺寸選擇指南

    Altera FPGA芯片的封裝尺寸選擇指南

    標簽: Altera FPGA 芯片 封裝尺寸

    上傳時間: 2013-06-04

    上傳用戶:edisonfather

  • 基于ISD4004芯片的語音錄放設計

    基于ISD4004芯片的語音錄放設計,內含詳細說明,程序代碼。

    標簽: 4004 ISD 芯片 語音錄放

    上傳時間: 2013-06-29

    上傳用戶:hakim

  • 基于FPGA的擴頻通信系統的實現

    擴頻通信技術是信息時代的三大高技術通信傳輸方式之一,與常規的通信技術相比。具有低截獲率、強抗噪聲、抗干擾性,具有信息隱蔽和多址通信等特點,目前已從軍事領域向民用領域迅速發展。在民用化之后,它被迅速推廣到各種公用和專用通信網絡之中,如衛星通信、數據傳輸、定位、測距等系統中。 擴頻通信技術中,最常見的是直接序列擴頻通信(DSSS)系統,然而目前專用擴頻芯片大部分功能都已固化。缺少產品開發的靈活性。其次,目前用FPGA與DSP相結合實現的直接序列擴頻的收發系統比較多,系統復雜且成本高。另外,現代擴頻通信系統在接收和發送端需要完成許多快速復雜的信號處理,這對電路的可靠性和處理速度提出了更高的要求。因此,設計一個全部用FPGA技術實現的擴頻通信收、發系統具有較強的實際應用價值。 根據FPGA的高速并行處理能力和全硬件實現的特點,采用直接序列擴頻技術,借助QuartusⅡ6.0及Protel99se工具,完成了系統的軟件仿真和硬件電路設計。實驗結果表明,比用傳統的FPGA與DSP相結合實現方式,提高了處理速度,減少了硬件延時。同時采用了流水線技術,提高了系統并行處理的能力。并且系統功能可以通過程序來修改和升級,與專用擴頻芯片相比,具有很大的靈活性。所有模塊都集成在一個芯片中,提高了系統的穩定性和可靠性。

    標簽: FPGA 擴頻通信

    上傳時間: 2013-05-18

    上傳用戶:天天天天

  • 基于FPGA的擴頻通信芯片設計及應用

    隨著網絡技術和通信技術的突飛猛進,人們對通信的保密性能,抗干擾能力的要求越來越高,而且對信息隱蔽、多址保密通信等特性提出了更高的要求。這些要求的實現都離不開擴頻通信技術的應用,而擴頻通信芯片作為擴頻通信網絡的核心器件,自然也成了研究的重點。本論文旨在借鑒國內外相關研究成果,并以家庭電力線通信環境為背景,驗證了一種CDMA碼分多址通信的實現方案,并通過智能家庭系統展示了其應用效果。 本課題以構建家庭電力載波通信網絡為目標,首先,以兩塊Cyclone系列FPGA開發板為基礎,分別作為發送單元和接收單元,構建了系統的硬件開發平臺;以QuartusⅡ 7.2為開發環境,運用Verilog硬件描述語言,編寫擴頻模塊和解擴模塊,并且進行了測試、仿真和綜合,驗證了通過專用芯片實現擴頻通信系統的可行性。應用方面,采用電力線載波通信芯片,提出了一種由智能插線板和嵌入式網關構成的家電控制系統。用戶通過WEB方式登陸嵌入式網關,智能插線板能夠在嵌入式網關的控制下控制電器的電源、發送紅外遙控指令,實現對家電的遠程遙控。使用兩塊FPGA開發板,實現了擴頻通信基本收發是本設計得主要成果;將擴頻通訊技術、嵌入式Web技術引入到智能家庭系統的設計當中是本文的一個特點。 仿真和實驗表明:采用電力線載波通信芯片組建家庭網絡的方案可行,由智能插線板和嵌入式網關構成的家電控制系統能靈活、便捷地實施家電控制,并具有一定的節能效果。

    標簽: FPGA 擴頻通信 芯片設計

    上傳時間: 2013-06-17

    上傳用戶:vaidya1bond007b1

  • 基于FPGA的路徑識別圖像傳感器的設計

    基于彩色路徑識別的視覺導航方法是當前自動導航小車領域的研究熱點和方向。視覺導航是指根據地面路徑和被控對象之間的位置偏差控制其運行的方向,因此,地面彩色路徑圖像的攝取及其識別處理就成為視覺導航系統中的基礎和關鍵。在當前的視覺導航系統設計中,圖像處理的硬件平臺都是基于通用微處理器,嵌入式微處理器或者DSP進行設計的。這些處理器一個共同的特點就是數據串行處理,而圖像處理過程涉及大量的并行處理操作,因此傳統的串行處理方式滿足不了圖像處理的實時性要求。 鑒于微處理器這方面的不足,作者提出一種使用FPGA實現圖像識別的并行處理方案,并據此設計一個智能圖像傳感器。該傳感器采用先進的FPGA技術,將圖像采集及其顯示,路徑的識別處理以及通信控制等模塊集成在一個芯片上,形成一個片上系統(SOC)。其主要功能是對所采集的彩色路徑圖像進行識別處理,獲得彩色路徑的坐標及其方向角,并將處理結果發送給上位機,為自動導航提供控制依據。 本文將彩色路徑的識別處理過程劃分為三個階段,第一階段為顏色聚類識別,以獲得二值路徑圖像,第二階段為數學形態學運算,用于對第一階段中獲得的二值圖像進行去斑處理,第三階段為路徑中心線的定位及其方向角的測量。圖像傳感器與上位機的通信采用異步串行方式,由于上位機需要控制該傳感器執行多種任務,作者定義一種基于異步串行通信的應用層協議,用于上位機對傳感器的控制。在圖像的顯示中,為了彌補圖像采集的速率和VGA顯示速率的不匹配,作者提出一種基于單端口存儲器的圖像幀緩沖機制,通過VGA接口將采集的圖像實時地顯示出來。 根據上述思想,作者完成了系統的硬件電路設計,并對整個系統進行了現場調試。調試結果表明,傳感器系統的各個模塊都能正常工作,FPGA中的數字邏輯電路能夠實時地將路徑從圖像中準確地識別出來,.充分體現了FPGA對路徑圖像的高速處理優勢,達到了設計預期目標,在一定程度上豐富了路徑圖像識別處理的技術和方法。

    標簽: FPGA 路徑識別 圖像傳感器

    上傳時間: 2013-04-24

    上傳用戶:ghostparker

  • 基于FPGA的GPS中頻數字接收機

    本文進行了基于FPGA的GPS直序偽碼擴頻接收機的設計和數字化硬件實現。論文首先對GPS衛星導航定位系統進行了分析,并對與數字化接收機直接相關聯的GPS信號中頻部分結合實際系統要求進行了設計和分析,由此確定了數字化偽碼捕獲跟蹤接收機研制的具體要求,之后完成了接收機中頻數字化方案設計。同時對偽碼捕獲跟蹤后端的載波捕獲跟蹤的實現方案進行了描述和分析。最后利用EDA工具在FPGA芯片上實現了GPS數字化接收機的偽碼捕獲跟蹤。 受工作環境的制約,GPS衛星接收機系統首先表現為功率受限系統,接收機必須滿足在低信噪比條件下工作。同時接收機與衛星間高動態產生的多普勒頻率,給接收機實現快速捕獲帶來了難度。通過仿真分析,綜合了實現難度和性能兩方面因素,針對小信噪比工作條件提出了改進型的序貫偽碼捕獲實施方案。同時按照捕獲概率和時間的要求,對接收機偏壓、上、下門限、NCO增益等進行了設計和仿真分析,確定了捕獲的數字化實現方案,偽碼跟蹤采用超前滯后環方案。捕獲完成后可使本地偽碼與接收偽碼的相對誤差保持在±1/4碼元范圍內,而跟蹤環路的跟蹤范圍為±4/3碼元,保證了捕獲到跟蹤的可靠銜接,同時采用可變環路帶寬措施解決了跟蹤速度和精度的矛盾。 在數字化實現設計中,給出了詳細的數字化實現方案和分析,這樣在保證工作精度的同時盡量減少硬件資源的開銷,利用EDA工具,采用Veilog設計語言在Xilinx的VirtexII系列的XC2V500fg256的FPGA上完成數字化接收機偽碼捕獲跟蹤的實現,并在其開發平臺上對數字化接收機進行了仿真驗證,在給定的工作條件下達到了設計性能和指標要求。

    標簽: FPGA GPS 中頻 數字接收機

    上傳時間: 2013-04-24

    上傳用戶:15510133306

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