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多頻信號

  • 基于FPGA的多路視頻合成系統的設計

    　　摘 要：研究一種基于FPGA的多路視頻合成系統。系統接收16路ITU656格式的視頻數據，按照畫面分割的要求對視頻數據流進行有效抽取和幀合成處理，經過視頻編碼芯片轉換成模擬信號輸出到顯示器，以全屏或多窗口模式顯示多路視頻畫面。系統利用FPGA的高速并行處理能力的優勢，應用靈活的的多路視頻信號的合成技術和數字圖像處理算法，實現實時處理多路視頻數據。

    標簽： FPGA 多路 視頻合成

    上傳時間： 2014-12-05

    上傳用戶：jiangfire

  • 用FPGA設計多功能數字鐘

    用FPGA設計多功能數字鐘

    標簽： FPGA 多功能 數字

    上傳時間： 2013-11-16

    上傳用戶：1234567890qqq

  • 基于LPC2138的AES3數字音頻接口設計

         隨著數字音頻技術的不斷發展，數字化音頻設備已廣泛應用于廣播電視節目領域。鑒于專業數字音頻設備越來越多地需求，以及專用接收發送設備的復雜性，本設計采用Philips公司的ARM7控制芯片LPC2138結合音響設備專用芯片，設計一個簡單的AES/EBU（AES3）數字音頻收發系統，實現了專業AES3數字音頻的接收與發送。實驗顯示，在輸入1 kHz，24 dBu時，本設計的總諧波失真小于0.005%，信噪比大于90 dBu。  

    標簽： 2138 AES3 LPC 數字音頻

    上傳時間： 2013-11-11

    上傳用戶：ruan2570406

  • 基于DDS的多波形信號發生器設計

    基于DDS的多波形信號發生器設計

    標簽： DDS 多波形 信號發生器

    上傳時間： 2013-11-08

    上傳用戶：kqc13037348641

  • 大規模FPGA設計中的多點綜合技術

      本文介紹了在大規模FPGA設計中可以提高綜合效率和效果的多點綜合技術，本文適合大規模FPGA的設計者和Synplify pro的用戶閱讀。  

    標簽： FPGA 大規模 多點

    上傳時間： 2013-11-23

    上傳用戶：lbbyxmraon

  • 基于Actel FPGA的多串口擴展設計

    基于Actel FPGA 的多串口擴展設計采用了Actel 公司高集成度，小體積，低功耗，低系統成本，高安全性和可靠性的小容量FPGA—A3P030 進行設計，把若干接口電路的功能集成到A3P030 中，實現了三路以上的串口擴展。該設計靈活性高，可根據需求靈活實現并行總線擴展三路UART 或者SPI 擴展三路UART，波特率可以靈活設置。

    標簽： Actel FPGA 多串口 擴展設計

    上傳時間： 2013-10-18

    上傳用戶：JIEWENYU

  • 在FPGA中基于信元的FIFO設計方法實戰方法

    　　設計工程師通常在FPGA上實現FIFO(先進先出寄存器)的時候，都會使用由芯片提供商所提供的FIFO。但是，由于其通用性使得其針對性變差，某些情況下會變得不方便或者將增加硬件成本。此時，需要進行自行FIFO設計。本文提供了一種基于信元的FIFO設計方法以供設計者在適當的時候選用。這種方法也適合于不定長包的處理。

    標簽： FPGA FIFO 信元 設計方法

    上傳時間： 2014-01-13

    上傳用戶：mengmeng444425

  • 采用FPGA的多路高壓IGBT驅動觸發器研制

    為有效控制固態功率調制設備,提高系統的可調性和穩定性,介紹了一種基于現場可編程門陣列( FPGA)和微控制器(MCU) 的多路高壓IGBT 驅動觸發器的設計方法和實現電路。該觸發器可選擇內或外觸發信號,可遙控或本控,能產生多路頻率、寬度和延時獨立可調的脈沖信號,信號的輸入輸出和傳輸都使用光纖。將該觸發器用于高壓IGBT(3300 V/ 800 A) 感應疊加脈沖發生器中進行實驗測試,給出了實驗波形。結果表明,該多路高壓IGBT驅動觸發器輸出脈沖信號達到了較高的調整精度,頻寬’脈寬及延時可分別以步進1 Hz、0. 1μs、0. 1μs 進行調整,滿足了脈沖發生器的要求,提高了脈沖功率調制系統的性能。

    標簽： FPGA IGBT 多路 驅動

    上傳時間： 2013-10-22

    上傳用戶：zhulei420

  • 基于FPGA的多路高速串并轉換器設計

    高速串并轉換器的設計是FPGA 設計的一個重要方面,傳統設計方法由于采用FPGA 的內部邏輯資源來實現,從而限制了串并轉換的速度。該研究以網絡交換調度系統的FGPA 驗證平臺中多路高速串并轉換器的設計為例,詳細闡述了1 :8DDR 模式下高速串并轉換器的設計方法和16 路1 :8 串并轉換器的實現。結果表明,采用Xilinx Virtex24 的ISERDES 設計的多路串并轉換器可以實現800 Mbit/ s 輸入信號的串并轉換,并且減少了設計復雜度,縮短了開發周期,能滿足設計要求。關鍵詞:串并轉換;現場可編程邏輯陣列;Xilinx ; ISERDES

    標簽： FPGA 多路 串并轉換

    上傳時間： 2013-11-03

    上傳用戶：王小奇

  • 基于Android平臺的自發短信系統設計與實現

    基于Android手機操作系統開發了一款自發短信系統。利用SQLite數據庫存儲技術、Service啟動服務技術及Runnable接口，設計并實現了好友管理、短信管理、后臺檢測發送短信等功能，并給出了運行效果圖。該系統的實現為指定時間發送定制短信提供了很大的方便性。

    標簽： Android 短信 系統設計

    上傳時間： 2013-11-29

    上傳用戶：lunshaomo

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