在多數(shù)情況下,集成電路芯片的管腳不會全部被使用。例如74ABT16244系列器件最多可以使用16路I/O管腳,但實(shí)際上通常不會全部使用,這樣就會存在懸空端子。所有數(shù)字邏輯器件的無用端子必須連接到一個高電平或低電平,以防止電流漂移（具有總線保持功能的器件無需處理不用輸入管腳）。究竟上拉還是下拉由實(shí)際器件在何種方式下功耗最低確定。
標(biāo)簽： 16244 ABT 管腳 端子
上傳時間： 2013-12-04
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多通道AD轉(zhuǎn)換程序,基于ARM編的,可實(shí)現(xiàn)8路AD轉(zhuǎn)換
標(biāo)簽： ARM AD轉(zhuǎn)換 多通道 8路
上傳時間： 2014-01-20
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完整的空時碼鏈路仿真多發(fā)射天線多接收天線空時分集系統(tǒng)的具體代碼實(shí)現(xiàn)和誤碼性能評估
標(biāo)簽： 空時碼 仿真 代碼 發(fā)射天線
上傳時間： 2015-12-29
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基于Java多線程實(shí)現(xiàn)所有頂點(diǎn)間最短路徑的并行算法
標(biāo)簽： Java 多線程 最短路徑 并行算法
上傳時間： 2013-12-26
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mimo-mc-cdma系統(tǒng)上行鏈路中分別針對單用戶和多用戶的不同檢測算法的比較
標(biāo)簽： mimo-mc-cdma 上行鏈路 分
上傳時間： 2014-01-07
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并行算法是適合在并行計算機(jī)上實(shí)現(xiàn)的算法。一個“好的”并行算法應(yīng)該能夠充分 發(fā)揮并行計算機(jī)多處理機(jī)的計算能力。
標(biāo)簽： 并行算法 并行計算機(jī) 分 多處理機(jī)
上傳時間： 2014-06-24
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上傳時間： 2013-12-18
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并行端口傳輸數(shù)據(jù)時是一次性傳送8個位（一個字節(jié)）或更多數(shù)據(jù)的傳輸速度要比串口快
標(biāo)簽： 并行端口 傳輸數(shù)據(jù) 串口 傳送
上傳時間： 2016-02-21
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用EPM7032（CPLD）做的２路８位并行輸入ＤＡＣ，帶內(nèi)部環(huán)型振蕩器（不用外接時鐘振蕩源）。
標(biāo)簽： 7032 CPLD EPM 并行
上傳時間： 2013-12-13
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上傳時間： 2016-04-20
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