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外圍電路設(shè)計

Programming Windows程式開發(fā)設(shè)計指南

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這是一堆verilog的source code.包含許多常用的小電路.還不錯用.

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這個程式可以用來觀察其他程式的VCL組態(tài)、記憶體內(nèi)容。幫助設(shè)計時的runtime debug。當(dāng)然也可以用來看別人程式中用了什麼元件、設(shè)計了什麼property

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系統(tǒng)能夠產(chǎn)生正弦波、方波、三角波。同時還可以作為頻率計測頻率。函數(shù)信號的產(chǎn)生由MAX038和外圍電路完成

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簡單的串列埠自我測試持式測試硬體電路是否正確

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FastReport3.0程序設(shè)計手冊,愛好編程的朋友可以參考本手冊.

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一本對象程序設(shè)計 For Delphi的書籍,內(nèi)容詳細(xì)講解了Delphi的面向?qū)幊谭椒ㄅc技巧!

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設(shè)計VHDL24小時的時鐘

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Oracle9iデータベース物理設(shè)計方針表領(lǐng)域編

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PCB Layout Rule Rev1.70, 規(guī)範(fàn)內(nèi)容如附件所示, 其中分為: 為確保產(chǎn)品之製造性, R&D在設(shè)計階段必須遵循Layout相關(guān)規(guī)範(fàn), 以利製造單位能順利生產(chǎn), 確保產(chǎn)品良率

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