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基于FPGA的超聲波避障系統(tǒng)(tǒng)設(shè)計(jì)

  • 基于FPGA的光纖通信系統(tǒng)中幀同步頭檢測(cè)設(shè)計(jì)

    　為實(shí)現(xiàn)設(shè)備中存在的低速數(shù)據(jù)光纖通信的同步復(fù)接/ 分接,提出一種基于FPGA 的幀同步頭信號(hào)提取檢測(cè)方案,其中幀頭由7 位巴克碼1110010 組成,在數(shù)據(jù)的接收端首先從復(fù)接數(shù)據(jù)中提取時(shí)鐘信號(hào),進(jìn)而檢測(cè)幀同步信號(hào),為數(shù)字分接提供起始信號(hào),以實(shí)現(xiàn)數(shù)據(jù)的同步分接。實(shí)驗(yàn)表明,此方案成功地在光纖通信系統(tǒng)的接收端檢測(cè)到幀同步信號(hào),從而實(shí)現(xiàn)了數(shù)據(jù)的正確分接。

    標(biāo)簽： FPGA 光纖通信系統(tǒng) 幀同步 檢測(cè)

    上傳時(shí)間： 2013-10-22

    上傳用戶：rnsfing

  • 基于FPGA的新型高性能永磁同步電機(jī)驅(qū)動(dòng)系統(tǒng)設(shè)計(jì)

    為了研制高性能的全數(shù)字永磁同步電機(jī)驅(qū)動(dòng)系統(tǒng)，本文提出了一種基于FPGA的單芯片驅(qū)動(dòng)控制方案。它采用硬件模塊化的現(xiàn)代EDA設(shè)計(jì)方法，使用VHDL硬件描述語(yǔ)言，實(shí)現(xiàn)了永磁同步電機(jī)矢量控制系統(tǒng)的設(shè)計(jì)。方案包括矢量變換、空間矢量脈寬調(diào)制(SVPWM)、電流環(huán)、速度環(huán)以及串行通訊等五部分。經(jīng)過(guò)仿真和實(shí)驗(yàn)表明，系統(tǒng)具有良好的穩(wěn)定性和動(dòng)態(tài)性能，調(diào)節(jié)轉(zhuǎn)速的范圍可以達(dá)到0.5r/min~4200r/min，對(duì)干擾誤差信號(hào)具有較強(qiáng)的容錯(cuò)性，能夠滿足高性能的運(yùn)動(dòng)控制領(lǐng)域?qū)τ来磐诫姍C(jī)驅(qū)動(dòng)系統(tǒng)的要求。

    標(biāo)簽： FPGA 性能 永磁同步 電機(jī)驅(qū)動(dòng)

    上傳時(shí)間： 2015-01-02

    上傳用戶：921005047

  • 基于FPGA 的單精度浮點(diǎn)數(shù)乘法器設(shè)計(jì)

    設(shè)計(jì)了一個(gè)基于FPGA的單精度浮點(diǎn)數(shù)乘法器.設(shè)計(jì)中采用改進(jìn)的帶偏移量的冗余Booth3算法和跳躍式Wallace樹(shù)型結(jié)構(gòu),并提出對(duì)Wallace樹(shù)產(chǎn)生的2個(gè)偽和采用部分相加的方式,提高了乘法器的運(yùn)算速度;加入對(duì)特殊值的處理模塊,完善了乘法器的功能.本設(shè)計(jì)在Altera DE2開(kāi)發(fā)板上進(jìn)行了驗(yàn)證.

    標(biāo)簽： FPGA 精度 浮點(diǎn)數(shù) 乘法器設(shè)計(jì)

    上傳時(shí)間： 2013-10-13

    上傳用戶：yl1140vista

  • 基于FPGA的多通道HDLC通信系統(tǒng)設(shè)計(jì)與實(shí)現(xiàn)

    為了滿足某測(cè)控平臺(tái)的設(shè)計(jì)要求，設(shè)計(jì)并實(shí)現(xiàn)了基于FPGA的六通道HDLC并行通信系統(tǒng)。該系統(tǒng)以FPGA為核心，包括FPGA、DSP、485轉(zhuǎn)換接口等部分。給出了系統(tǒng)的電路設(shè)計(jì)、關(guān)鍵模塊及軟件流程圖。測(cè)試結(jié)果表明，系統(tǒng)通訊速度為1 Mb/s，并且工作穩(wěn)定，目前該設(shè)計(jì)已經(jīng)成功應(yīng)用于某樣機(jī)中。

    標(biāo)簽： FPGA HDLC 多通道 通信

    上傳時(shí)間： 2013-10-12

    上傳用戶：as275944189

  • 基于FPGA的數(shù)據(jù)采集系統(tǒng)設(shè)計(jì)

    設(shè)計(jì)了一個(gè)基于FPGA的數(shù)據(jù)采集系統(tǒng)，并用Verilog HDL語(yǔ)言作為描述語(yǔ)言實(shí)現(xiàn)了對(duì)TLC0820的采樣控制和FPGA的數(shù)據(jù)處理等過(guò)程的控制，以Xilinx ISE 9.1i軟件為平臺(tái)，進(jìn)行了設(shè)計(jì)輸入、分析與綜合、仿真與驗(yàn)證等過(guò)程仿真實(shí)現(xiàn)了這一系統(tǒng)。

    標(biāo)簽： FPGA 數(shù)據(jù)采集 系統(tǒng)設(shè)計(jì)

    上傳時(shí)間： 2013-10-08

    上傳用戶：13686209316

  • 基于fpga的嵌入系統(tǒng)的設(shè)計(jì)

    基于fpga的嵌入系統(tǒng)的設(shè)計(jì)

    標(biāo)簽： fpga 嵌入系統(tǒng)

    上傳時(shí)間： 2014-11-25

    上傳用戶：253189838

  • 基于LMS的雙向回波削除源碼

    基于LMS的雙向回波削除源碼，不過(guò)回波幅度不要大于0.2,否則算法認(rèn)為DOUBLE TALK DETECT。各位可修改此閥值，試試效果

    標(biāo)簽： LMS 回波 源碼

    上傳時(shí)間： 2015-03-09

    上傳用戶：lnnn30

  • 基于fpga的usb實(shí)現(xiàn)

    基于fpga的usb實(shí)現(xiàn)，包含簡(jiǎn)介，程序，原理圖，與大家分享！

    標(biāo)簽： fpga usb

    上傳時(shí)間： 2015-03-27

    上傳用戶：woshini123456

  • 基于FPGA的16點(diǎn)FFT快速傅立葉變換的Verilog源代碼。

    基于FPGA的16點(diǎn)FFT快速傅立葉變換的Verilog源代碼。

    標(biāo)簽： Verilog FPGA FFT 傅立葉變換

    上傳時(shí)間： 2015-04-02

    上傳用戶：aysyzxzm

  • 基于fpga的邏輯分析儀可顯示八路波形

    基于fpga的邏輯分析儀可顯示八路波形，實(shí)時(shí)分析八路波形

    標(biāo)簽： fpga 邏輯分析儀 波形

    上傳時(shí)間： 2015-04-14

    上傳用戶：jcljkh

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