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均衡器

數(shù)字均衡器是通訊信道抗碼間干擾的重要環(huán)節(jié),這是一個(gè)用vhdl寫的代碼以及用SYNPLIFY8.0綜合的RTL電路圖它包含三個(gè)模塊FILTER,ERR_DECISION,ADJUST 希望對大家有用.

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描述了一個(gè)用于微波傳輸設(shè)備的16QAM接收機(jī)解調(diào)芯片的FPGA實(shí)現(xiàn),芯片集成了定時(shí)恢復(fù)、載波恢復(fù)和自適應(yīng)盲判決反饋均衡器(DFE),采用恒模算法(CMA)作為均衡算法。芯片支持高達(dá)25M波特的符號速率

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HART協(xié)議的均衡器設(shè)計(jì) DCT LMS 設(shè)計(jì) + 位同步設(shè)計(jì)

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研究利用RLS算法自適應(yīng)均衡器糾正存在加性白噪聲的信道的畸變。討論特征值擴(kuò)散度對學(xué)習(xí)曲線的影響。比較RLS算法和LMS算法在不同信噪比情況下的學(xué)習(xí)曲線。

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具有檢測FIR濾波器單位脈沖響應(yīng)h[n]中零系數(shù)（zero tap detection）功能的LMS算法自適應(yīng)均衡器

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基于DSP的數(shù)字音頻均衡器設(shè)計(jì)

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電池管理系統(tǒng)（含均衡器）設(shè)計(jì)簡述

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數(shù)字電視地面?zhèn)鬏斨袉屋d波均衡器的FPGA設(shè)計(jì)與實(shí)現(xiàn).rar

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一種基于子帶分解技術(shù)的寬帶盲均衡器結(jié)構(gòu)和算法

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無線信道仿真和均衡器的FPGA設(shè)計(jì)與實(shí)現(xiàn)

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