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verilog實現鎖存器，共有四個文件，包含測試文件
標簽： verilog 鎖存器
上傳時間： 2013-12-25
上傳用戶：wpwpwlxwlx
交流電橋的電路結構中，由電阻、電抗元件或 它們的組合構成四臂，并用檢流計、耳機或其它儀器作為檢驗電橋是否平衡的“示零器”．利用交流電橋的平衡條件進行測量，這就是它的基本原理．
標簽： 交流電橋 電路結構
上傳時間： 2014-01-22
上傳用戶：66666
SDL_mixer 是一個基于 SDL 的混音器，它可使同時播放的多個音頻流混合成一個聲道播放
標簽： SDL_mixer SDL 混音器
上傳時間： 2013-12-10
上傳用戶：sssl
一個編碼器，能編解碼位流，適用于壓縮算法的編碼輸出。
標簽： 編碼器
上傳時間： 2015-09-12
上傳用戶：qoovoop
基于網絡的視頻監控系統 隨著時代的發展，人們對安全防范也越來越重視，而數字化視頻監控系統在音視頻錄像、報警錄像聯動、硬盤存儲、多畫面顯示等方面都有突出表現，因此在安防領域逐漸占有了一席之地。本文提出的基于網絡的視頻監控系統實現了對數字硬盤錄像機的控制功能，其遠程客戶端軟件可以同時播放四路具有高達Dl分辨率的圖像數據。 第一章論述了視頻監控系統和數據壓縮技術的發展動態。 第二章對客戶端軟件的開發環境及平臺進行了選擇，并就其中使用的關鍵技術:windows sockets編程技術、windows多線程技術、windows圖像顯示技術、MPEG-4編解碼與數據傳術技術、流媒體技術做了簡介。 第三章詳細論述了客戶端軟件的設計及實現。包括客戶端軟件的整體設計和各模塊的設計實現，最后給出了實現結果。 第四章是論述了實時流媒體播放器的設計和實現，包括主要模塊設計實現 (網絡接收模塊、解碼模塊、顯示模塊、操作控制模塊)、其他模塊設計實現(顯卡能力探測模塊、表面管理模塊)、性能優化(緩沖、共享內存、線程模型)。 第五章對系統進行了總結，并為系統進一步發展提出了展望和規劃。
標簽： 網絡 發展 視頻監控系統
上傳用戶：lingzhichao
用verilog設計密勒解碼器 一、題目： 設計一個密勒解碼器電路 二、輸入信號： 1． DIN：輸入數據 2． CLK：頻率為2MHz的方波，占空比為50％ 3． RESET：復位信號，低有效 三、輸入信號說明： 輸入數據為串行改進密勒碼，每個碼元持續時間為8μs，即16個CLK時鐘；數據流是由A、B、C三種信號組成； A：前8個時鐘保持“1”，接著5個時鐘變為“0”，最后3個時鐘為“1”。 B：在整個碼元持續時間內都沒有出現“0”，即連續16個時鐘保持“1”。 C：前5個時鐘保持“0”，后面11個時鐘保持“1”。 改進密勒碼編碼規則如下： 如果碼元為邏輯“1”，用A信號表示。 如果碼元為邏輯“0”，用B信號表示，但以下兩種特例除外：如果出現兩個以上連“0”，則從第二個“0”起用C信號表示；如果在“通信起始位”之后第一位就是“0”，則用C信號表示，以下類推； “通信起始位”，用C信號表示； “通信結束位”，用“0”及緊隨其后的B信號表示。 “無數據”，用連續的B信號表示。
標簽： verilog 2MHz DIN CLK
上傳時間： 2013-12-02
上傳用戶：wang0123456789
無線技術的發展使得流媒體技術可以被應用到Ad-hoc無線網絡上，W-Player無線網絡流媒體播放器是流媒體技術在無線網絡中的一個應用。
標簽： Ad-hoc 無線技術 發展 流媒體技術
上傳時間： 2014-12-21
上傳用戶：lanwei
采用單一感知器神經元解決一個簡單的分類問題，將四個輸入矢量分為兩類，其中 ％ 兩個矢量對應的目標值為1，另兩個矢量對應的目標值為0
標簽： 分類
上傳時間： 2015-10-21
上傳用戶：wyc199288
AVR單片機入門及C語言高效設計實踐（四） ATMEAG16L的I／O端口特點及使用 ATMEAG16L單片機有32個通用I／O口，分為PA、PB、PC和PD四組，每組都是8位。這些I／O口都可以通過各自的端口寄存器設置成輸入和輸出（即作為普通端口使用），有些I／O口還具有第二功能（我們在后面使用到這些第二功能時再介紹）。
標簽： ATMEAG 16L 16 AVR
上傳時間： 2014-01-19
上傳用戶：rocketrevenge
并行AVS實時編解碼器設計與實現 介紹了一種并行AVS實時編碼器的設計，它包括音視頻數據輸入、音視頻編碼、傳輸流系統復用器、輸出和控制部分，其 中重點介紹了視頻編碼器和傳輸流系統復用器的設計和實現。實驗結果證明，實現標清AVS實時編碼器是可行的。
標簽： AVS 并行 編解碼器 編碼器
上傳時間： 2015-11-27
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