信號與信息處理是信息科學(xué)中近幾年來發(fā)展最為迅速的學(xué)科之一,隨著片上系統(tǒng)(SOC,System On Chip)時(shí)代的到來,FPGA正處于革命性數(shù)字信號處理的前沿。基于FPGA的設(shè)計(jì)可以在系統(tǒng)可再編程及在系統(tǒng)調(diào)試,具有吞吐量高,能夠更好地防止授權(quán)復(fù)制、元器件和開發(fā)成本進(jìn)一步降低、開發(fā)時(shí)間也大大縮短等優(yōu)點(diǎn)。然而,FPGA器件是基于SRAM結(jié)構(gòu)的編程工藝,掉電后編程信息立即丟失,每次加電時(shí),配置數(shù)據(jù)都必須重新下載,并且器件支持多種配置方式,所以研究FPGA器件的配置方案在FPGA系統(tǒng)設(shè)計(jì)中具有極其重要的價(jià)值,這也給用于可編程邏輯器件編程的配置接口電路和實(shí)驗(yàn)開發(fā)設(shè)備提出了更高的要求。 本論文基于IEEE1149.1標(biāo)準(zhǔn)和USB2.0技術(shù),完成了FPGA配置接口電路及實(shí)驗(yàn)開發(fā)板的設(shè)計(jì)與實(shí)現(xiàn)。作者在充分理解IEEE1149.1標(biāo)準(zhǔn)和USB技術(shù)原理的基礎(chǔ)上,針對Altcra公司專用的USB數(shù)據(jù)配置電纜USB-Blaster,對其內(nèi)部工作原理及工作時(shí)序進(jìn)行測試與詳細(xì)分析,完成了基于USB配置接口的FPGA芯片開發(fā)實(shí)驗(yàn)電路的完整軟硬件設(shè)計(jì)及功能時(shí)序仿真。作者最后進(jìn)行了軟硬件調(diào)試,完成測試與驗(yàn)證,實(shí)現(xiàn)了對Altera系列PLD的配置功能及實(shí)驗(yàn)開發(fā)板的功能。 本文討論的USB下載接口電路被驗(yàn)證能在Altera的QuartusII開發(fā)環(huán)境下直接使用,無須在主機(jī)端另行設(shè)計(jì)通信軟件,其兼容性較現(xiàn)有設(shè)計(jì)有所提高。由于PLD(Programmable Logic Device)廠商對其知識產(chǎn)權(quán)嚴(yán)格保密,使得基于USB接口的配置電路應(yīng)用受到很大限制,同時(shí)也加大了自行對其進(jìn)行開發(fā)設(shè)計(jì)的難度。 與傳統(tǒng)的基于PC并口的下載接口電路相比,本設(shè)計(jì)的基于USB下載接口電路及FPGA實(shí)驗(yàn)開發(fā)板具有更高的編程下載速率、支持熱插拔、體積小、便于攜帶、降低對PC硬件傷害,且具備其它下載接口電路不具備的SignalTapII嵌入式邏輯分析儀和調(diào)試NiosII嵌入式軟核處理器等明顯優(yōu)勢。從成本來看,本設(shè)計(jì)的USB配置接口電路及FPGA實(shí)驗(yàn)開發(fā)板與其同類產(chǎn)品相比有較強(qiáng)的競爭力。
標(biāo)簽： 實(shí)驗(yàn) 評估板
上傳時(shí)間： 2013-06-07
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ATMEGA128最小系統(tǒng)原理圖ATMEGA128最小系統(tǒng)原理圖ATMEGA128最小系統(tǒng)原理圖
標(biāo)簽： ATMEGA 128 最小系統(tǒng) 原理圖
上傳時(shí)間： 2013-04-24
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文章首先分析比較了光伏并網(wǎng)逆變器的各種主電路結(jié)構(gòu)優(yōu)缺點(diǎn)，提出適合小 功率光伏系統(tǒng)的兩級式并網(wǎng)結(jié)構(gòu)，并對前級DC-DC電路和后級DC-AC分別進(jìn)行 了電路結(jié)構(gòu)的選擇。
上傳時(shí)間： 2013-06-14
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ISO 4-20mA電流環(huán)隔離芯片是單片兩線制隔離接口芯片，該IC內(nèi)部包含有電流信號調(diào)制解調(diào)電路、信號耦合隔離變換電路等。很小的輸入等效電阻，使該IC的輸入電壓達(dá)到超寬范圍（7.5—32V），以滿足用
上傳時(shí)間： 2013-07-29
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隨著多媒體技術(shù)的發(fā)展，數(shù)字圖像處理已經(jīng)成為眾多應(yīng)用系統(tǒng)的核心和基礎(chǔ)。它的發(fā)展主要依賴于兩個(gè)性質(zhì)不同、自成體系但又緊密相關(guān)的研究領(lǐng)域：圖像處理算法及其相應(yīng)的電路實(shí)現(xiàn)。圖像處理系統(tǒng)的硬件實(shí)現(xiàn)—般有三種方式：專用的圖像處理器件集成芯片(Application Specific Integrated Circuit)、數(shù)字信號處理器(Digital Signal Process)和現(xiàn)場可編程門陣列(Field Programmable Gate Array)以及相關(guān)電路組成。它們可以實(shí)時(shí)高速完成各種圖像處理算法。圖像處理中，低層的圖像預(yù)處理的數(shù)據(jù)量很大，要求處理速度快，但運(yùn)算結(jié)果相對比較簡單。相對于其他兩種方式，基于FPGA的圖像處理方式的系統(tǒng)更適合于圖像的預(yù)處理。本文設(shè)計(jì)了—種基于FPGA的小波域圖像去噪系統(tǒng)。首先，闡述了基于小波變換的圖像去噪算法原理，重點(diǎn)討論了小波鄰域閾值(NeighShrink)去噪算法，并給出了該算法相應(yīng)的Matlab 仿真；然后，為了改進(jìn)鄰域閾值去噪算法中對每個(gè)分解子帶都采用相同鄰域和閾值的缺點(diǎn)，本文提出了基于最小二乘支持向量機(jī)(LS-SVM)分類的鄰域閾值去噪算法和以斯坦無偏估計(jì) (SURE)為準(zhǔn)則同時(shí)結(jié)合小波系數(shù)尺度間關(guān)系的鄰域閾值去噪算法。經(jīng)Matlab實(shí)驗(yàn)表明，相比于其他幾種經(jīng)典算法，本文提出的兩種改進(jìn)算法在濾除噪聲的同時(shí)能更好地保護(hù)圖像細(xì)節(jié)，并在較高噪聲情況下能獲得更高的峰值信噪比。在此基礎(chǔ)上本文將提出的改進(jìn)小波鄰域閾值去噪算法進(jìn)行了相應(yīng)的簡化，以滿足低噪聲處理要求且易于在FPGA上實(shí)現(xiàn)；最后，給出了基于 FPGA的小波鄰域閾值去噪系統(tǒng)的總體結(jié)構(gòu)和FPGA內(nèi)部各功能模塊的具體實(shí)現(xiàn)方案，包括二維離散小波變換模塊、二維離散小波逆變換模塊、SDRAM存儲器控制模塊、去噪計(jì)算模塊和系統(tǒng)核心控制模塊，并對各個(gè)系統(tǒng)模塊和整體進(jìn)行了仿真驗(yàn)證，結(jié)果表明本文設(shè)計(jì)的基于FPGA 的小波鄰域閾值去噪系統(tǒng)能滿足實(shí)際的圖像處理要求，具有一定的理論和實(shí)際應(yīng)用價(jià)值。關(guān)鍵詞：圖像處理系統(tǒng)，F(xiàn)PGA，圖像去噪算法，小波變換
上傳時(shí)間： 2013-05-16
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數(shù)字超聲診斷設(shè)備在臨床診斷中應(yīng)用十分廣泛，研制全數(shù)字化的醫(yī)療儀器已成為趨勢。盡管很多超聲成像儀器設(shè)計(jì)制造中使用了數(shù)字化技術(shù)，但是我們可以說現(xiàn)代VLSI 和EDA 技術(shù)在其中并沒有得到充分有效的應(yīng)用。隨著現(xiàn)代電子信息技術(shù)的發(fā)展，PLD 在很多與B 型超聲成像或多普勒超聲成像有關(guān)的領(lǐng)域都得到了較好的應(yīng)用，例如數(shù)字通信和相控雷達(dá)領(lǐng)域。 在研究現(xiàn)代超聲成像原理的基礎(chǔ)上，我們首先介紹了常見的數(shù)字超聲成像儀器的基本結(jié)構(gòu)和模塊功能，同時(shí)也介紹了現(xiàn)代FPGA 和EDA 技術(shù)。隨后我們詳細(xì)分析討論了B 超中，全數(shù)字化波束合成器的關(guān)鍵技術(shù)和實(shí)現(xiàn)手段。我們設(shè)計(jì)實(shí)現(xiàn)了片內(nèi)高速異步FIFO 以降低采樣率，仿真結(jié)果表明資源使用合理且訪問時(shí)間很小。正交檢波方法既能給出灰度超聲成像所需要的回波的幅值信息，也能給出多普勒超聲成像所需要的回波的相移信息。我們設(shè)計(jì)實(shí)現(xiàn)了基于直接數(shù)字頻率合成原理的數(shù)控振蕩器，能夠給出一對幅值和相位較平衡的正交信號，且在FPGA 片內(nèi)實(shí)現(xiàn)方案簡單廉價(jià)。數(shù)控振蕩器輸出波形的頻率可動態(tài)控制且精度較高，對于隨著超聲在人體組織深度上的穿透衰減，導(dǎo)致回波中心頻率下移的聲學(xué)物理現(xiàn)象，可視作將回波接收機(jī)的中心頻率同步動態(tài)變化進(jìn)行補(bǔ)償。 還設(shè)計(jì)實(shí)現(xiàn)了B 型數(shù)字超聲診斷儀前端發(fā)射波束聚焦和掃描控制子系統(tǒng)。在單片F(xiàn)PGA 芯片內(nèi)部設(shè)計(jì)實(shí)現(xiàn)了聚焦延時(shí)、脈寬和重復(fù)頻率可動態(tài)控制的發(fā)射驅(qū)動脈沖產(chǎn)生器、線掃控制、探頭激勵(lì)控制、功能碼存儲等功能模塊，功能仿真和時(shí)序分析結(jié)果表明該子系統(tǒng)為設(shè)計(jì)實(shí)現(xiàn)高速度、高精度、高集成度的全數(shù)字化超聲診斷設(shè)備打下了良好的基礎(chǔ)，將加快其研發(fā)和制造進(jìn)程，為生物醫(yī)學(xué)電子、醫(yī)療設(shè)備和超聲診斷等方面帶來新思路。
標(biāo)簽： 全數(shù)字 中的應(yīng)用 超聲診斷儀
上傳時(shí)間： 2013-05-30
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PCI（Peripheral Component Interconnect）局部總線是微型計(jì)算機(jī)中處理器、存儲器與外圍控制部件、擴(kuò)展卡之間的互連接口，由于其速度快、可靠性高、成本低、兼容性好等特點(diǎn)，在各種計(jì)算機(jī)總線標(biāo)準(zhǔn)占有重要地位，基于PCI標(biāo)準(zhǔn)的接口設(shè)計(jì)已經(jīng)成為相關(guān)項(xiàng)目開發(fā)中的一個(gè)重要的選擇。 目前，現(xiàn)場可編程門陣列FPGA（Field Programmable Gates）得到了廣泛應(yīng)用。由于其具有規(guī)模大，開發(fā)過程投資小，可反復(fù)編程，且支持軟硬件協(xié)同設(shè)計(jì)等特點(diǎn)，因此已逐步成為復(fù)雜數(shù)字硬件電路設(shè)計(jì)的首選。 PCI接口的開發(fā)有多種方法，主要有兩種：一是使用專用接口芯片，二是使用可編程邏輯器件，如FPGA。本論文基于成本和實(shí)際需要的考慮，采用第二種方法進(jìn)行設(shè)計(jì)。 本論文采用自上而下（Top-To-Down）和模塊化的設(shè)計(jì)方法，使用FPGA和硬件描述語言（VHDL和Verilog HDL）設(shè)計(jì)了一個(gè)PCI接口核，并通過自行設(shè)計(jì)的試驗(yàn)板對其進(jìn)行驗(yàn)證。為使設(shè)計(jì)準(zhǔn)確可靠，在具體模塊的設(shè)計(jì)中廣泛采用流水線技術(shù)和狀態(tài)機(jī)的方法。 論文最終設(shè)計(jì)完成了一個(gè)33M32位的PCI主從接口，并把它作為以NIOSⅡ?yàn)楹诵牡腟OPC片內(nèi)外設(shè)，與通用計(jì)算機(jī)成功進(jìn)行了通訊。 論文對PCI接口進(jìn)行了功能仿真，仿真結(jié)果和PCI協(xié)議的要求一致，表明本論文設(shè)計(jì)正確。把設(shè)計(jì)下載進(jìn)FPGA芯片EP2C8Q208C7之后，論文給出了使用SIGNALTAPⅡ觀察到的信號實(shí)際波形，波形顯示PCI接口能夠滿足本設(shè)計(jì)中系統(tǒng)的需要。本文最后還給出試驗(yàn)板的具體設(shè)計(jì)步驟及驅(qū)動程序的安裝。
標(biāo)簽： FPGA PCI 接口的設(shè)計(jì)
上傳時(shí)間： 2013-07-28
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幾個(gè)C語言小游戲源碼,推箱子,掃雷,五子棋,等收集,希望大家用的愉快
上傳時(shí)間： 2013-05-27
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·摘要： 以電機(jī)控制專用芯片TMS320F240DSP為控制核心,空間矢量脈寬調(diào)制(SVPWM)技術(shù)為理論依據(jù),設(shè)計(jì)了一款高性價(jià)比的全數(shù)字小功率變頻器;采用現(xiàn)代電力電子變換技術(shù)(AC-DC-AC)和高級數(shù)字信號處理器等技術(shù),給出了一種小功率通用變頻器的設(shè)計(jì)方案和詳細(xì)硬件軟件設(shè)計(jì)過程,利用軟件實(shí)現(xiàn)了七段式SVPWM的生成,通過實(shí)驗(yàn)說明,所提出并設(shè)計(jì)的這種新型變頻器結(jié)構(gòu)簡單,經(jīng)濟(jì)實(shí)用,具有良
標(biāo)簽： 空間矢量脈寬調(diào)制 小功率 變頻器
上傳時(shí)間： 2013-04-24
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·期刊論文：小波變換在數(shù)字圖像處理中的應(yīng)用
標(biāo)簽： 論文 小波變換 中的應(yīng)用 數(shù)字圖像處理
上傳時(shí)間： 2013-06-23
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